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LMK1D1204P 時(shí)鐘緩沖器能夠以超小的時(shí)鐘分配延 遲，將兩個(gè)中的任一可選時(shí)鐘輸入（IN0 和 IN1）分配 給 4 對(duì)差分 LVDS 時(shí)鐘輸出（OUT0 至 OUT3）。輸 入可以為 LVDS、LVPECL、LVCMOS、HCSL 或 CML。 LMK1D1204P 專為驅(qū)動(dòng) 50? 傳輸線路而設(shè)計(jì)。在單端 模式下驅(qū)動(dòng)輸入時(shí)，對(duì)未使用的負(fù)輸入引腳施加適當(dāng)?shù)?偏置電壓（請(qǐng)參閱圖 9-6）。IN_SEL 引腳用于選擇要 發(fā)送到輸出的輸入。該器件支持失效防護(hù)輸入功能。該 器件還整合了輸入遲滯，可防止在沒有輸入信號(hào)的情況 下輸出隨機(jī)振蕩。 各個(gè) LVDS 差分輸出均可通過將對(duì)應(yīng)的 OEx 引腳設(shè)置 為邏輯高電平“1”來(lái)實(shí)現(xiàn)。如果此引腳設(shè)置為邏輯低 電平“0”，輸出將被禁用，呈現(xiàn)高阻態(tài)，從而降低功 耗。
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