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分析安全關(guān)鍵領(lǐng)域的時(shí)間觸發(fā)網(wǎng)絡(luò)協(xié)議 SAE AS6802與時(shí)間同步算法技術(shù)，分別對(duì)同步流程、時(shí)間同步角色、時(shí)序保持算法、集中控制算法、時(shí)鐘糾正算法、同/異步派系檢測(cè)算法以及通道擇優(yōu)方法等進(jìn)行研究，歸納時(shí)間同步精度的影響因素。在此基礎(chǔ)上，設(shè)計(jì)一種時(shí)間同步算法IP核，并構(gòu)建基于 System Verilog的模塊化仿真驗(yàn)證平臺(tái)。利用該平臺(tái)對(duì)時(shí)間同步算法進(jìn)行RTL級(jí)仿真，結(jié)果驗(yàn)證了該時(shí)間同步算法的正確性，其同步精度保持在亞微秒級(jí)，滿足下一代高安全關(guān)鍵領(lǐng)域的應(yīng)用要求。
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