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      電子發(fā)燒友網(wǎng)>電子資料下載>電子論文>嵌入式技術(shù)論文>大型并行嵌入系統(tǒng)應(yīng)用軟件工程師的硬件設(shè)計(jì)模型

      大型并行嵌入系統(tǒng)應(yīng)用軟件工程師的硬件設(shè)計(jì)模型

      2009-11-30 | rar | 223 | 次下載 | 3積分

      資料介紹

      Abstract Parallel servers are becoming an important sector in the embedded systems marketplace. If software engineers are to implement the multi-algorithm applications that these servers support, then educators should provide clear design routes which inculcate system-level thinking. Pipelined Processor Farms (PPF) is one such topdown design strategy. The contemporary hardware diversity within both processor- and instruction-level parallellism requires incorporation of a coprocessor model at the node or sub-system layer. Two suitable software-based approaches are reviewed: one which maintains the traditional aspects of hardware modeling, SystemC, and the other, Handel-C, which introduces silicon compilation to the CAD laboratory.
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