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作為Wiedemannn算法的核心部分，稀疏矩陣向量乘是求解二元域上大型稀疏線性方程組的主要步驟。提出了一種基于FPGA的二元域大型稀疏矩陣向量乘的環(huán)網(wǎng)硬件系統(tǒng)架構(gòu)，為解決Wiedemannn算法重復(fù)計(jì)算稀疏矩陣向量乘，提出了新的并行計(jì)算結(jié)構(gòu)。實(shí)驗(yàn)分析表明，提出的架構(gòu)提高了Wiedemannn算法中稀疏矩陣向量乘的并行性，同時(shí)充分利用了FPGA的片內(nèi)存儲(chǔ)器和吉比特收發(fā)器，與目前性能最好的部分可重構(gòu)計(jì)算PR模型相比，實(shí)現(xiàn)了2.65倍的加速性能。
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