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      電子發(fā)燒友網(wǎng)>電子資料下載>電子論文>模擬數(shù)字論文>基于4通道時間交織的FPGA高速模數(shù)轉(zhuǎn)換采樣系統(tǒng)

      基于4通道時間交織的FPGA高速模數(shù)轉(zhuǎn)換采樣系統(tǒng)

      2018-02-07 | rar | 0.55 MB | 次下載 | 3積分

      資料介紹

      　　高性能的模數(shù)轉(zhuǎn)換器（Analog Digilal Convertei．ADC）被廣泛應(yīng)用于通信、儀器儀表、計算機和醫(yī)療設(shè)備等領(lǐng)域，對國民經(jīng)濟、國防建設(shè)以及科學(xué)研究具有重要意義。單采樣單元的ADC芯片由于存在內(nèi)部熱噪聲、孔徑抖動和渡越時間不確定性等因素，面臨采樣速度和精度相互制約的影響，出現(xiàn)了瓶頸。而由多通道時間交織ADC（Time-lnterleaved ADC．TIADC）采用M個相同型號的ADC單元依次交替完成采樣。理論上，TIADC的采樣率可以到達單ADC的M倍，同時保持采樣精度基本不變。但是由于ADC采樣單元與外圍電路的個體差異，導(dǎo)致的采樣通道間不一致性會引起失配失真，如偏置誤差、增益誤差以及時間相位誤差將嚴(yán)重降低數(shù)據(jù)采集系統(tǒng)性能?；?a target='_blank' class='arckwlink_none'>數(shù)字信號處理方法的數(shù)字后端修正技術(shù)可有效抑制以上失配造成的失真。近年來，已有文獻應(yīng)用FPCJA實現(xiàn)數(shù)字后端修正技術(shù)。

      　　本文提出并設(shè)計了一套4通道時間交織FPCJA高速模擬信號采樣系統(tǒng)。系統(tǒng)的數(shù)據(jù)流挖制、失配誤差數(shù)字修正等功能均在l片F(xiàn)PCJA中實現(xiàn)，無需額外采用DSP處理器，降低了系統(tǒng)的結(jié)構(gòu)復(fù)雜度。

      基于4通道時間交織的FPGA高速模數(shù)轉(zhuǎn)換采樣系統(tǒng)

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