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Verilog HDL作為一種規(guī)范的硬件描述語言,被廣泛應(yīng)用于電路的設(shè)計中。 他的設(shè)計描述可被不同的工具所支持,可用不同器件來實現(xiàn)。利用 Verilog HDL語言自頂 向下的設(shè)計方法設(shè)計交通燈控制系統(tǒng)，使其實現(xiàn)道路交通的正常運轉(zhuǎn)，突出了其作為硬件 描述語言的良好的可讀性、可移植性和易理解等優(yōu)點，并通過 Quartus II完成綜合、仿 真、進行管腳分配、繪出仿真波形及 RTL原理圖。此程序通過下載到 FPGA芯片后,可應(yīng)用 于實際的交通燈控制系統(tǒng)中。
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