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集成電路測(cè)試技術(shù)基礎(chǔ)課件教程免費(fèi)下載

2019-01-04 | rar | 7.43 MB | 次下載 | 免費(fèi)

資料介紹

本文檔的主要內(nèi)容詳細(xì)介紹的是集成電路測(cè)試技術(shù)基礎(chǔ)課件教程免費(fèi)下載包括了:課程概述和1.測(cè)試意義,2.測(cè)試基本概念,3.測(cè)試方法,4.測(cè)試的分類,5.測(cè)試主要環(huán)節(jié),6.測(cè)試經(jīng)濟(jì)學(xué),7.測(cè)試發(fā)展趨勢(shì)

集成電路測(cè)試技術(shù)基礎(chǔ)課件教程免費(fèi)下載

  VLSI技術(shù)的發(fā)展對(duì)測(cè)試的影響

  芯片時(shí)鐘速度提升

  全速測(cè)試要求ATE工作頻率大于等于被測(cè)電路;

  ATE成本增加,增加一個(gè)測(cè)試引腳其價(jià)格將。上升3000美元;

  EMI(電磁干擾)測(cè)試。

  2.晶體管密度增加

  增加了測(cè)試復(fù)雜性;

  2001年,晶體管數(shù)目與芯片引腳數(shù)目的比例( Nt/Np)大約是11000: 1, 2003年2006年 預(yù)計(jì)為26000: 1, 2009年2012年 則預(yù)計(jì)達(dá)到67000: 1, 這種趨勢(shì)表明測(cè)試復(fù)雜度( Test Complexity) 每56年就要翻一番

  訪問(wèn)芯片內(nèi)部晶體管的能力大大降低

  OmV特征尺寸縮小增加了功耗;

  a、必須檢查由于過(guò)量電流引起電源總線超載

  b、測(cè)試矢量產(chǎn)生過(guò)量功耗燒毀芯片

  C、大的漏電流

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