電子發(fā)燒友App
可替代晶振的PLL時(shí)鐘產(chǎn)生電路
- 時(shí)鐘產(chǎn)生電路(6438)
相關(guān)推薦
求助，STM32G030F6P不能使用外部高速無(wú)源晶振嗎？
各位大神，我在給G030配置外部高速無(wú)源晶振之后，發(fā)現(xiàn)無(wú)法起振。電路圖就跟其他的項(xiàng)目一樣，很常規(guī)的一個(gè)配置。G030的datasheet里面也沒(méi)說(shuō)不能使用外部高速無(wú)源晶振啊，但是在使用Cube進(jìn)行
2024-03-21 08:15:29
STM32F407VGT6低速晶振采用外置的無(wú)源晶振32.768kHz,出現(xiàn)了大量的不起振怎么解決？
最近公司買進(jìn)了一批新的馬來(lái)西亞生產(chǎn)的STM32F407VGT6單片機(jī)，低速晶振采用外置的無(wú)源晶振32.768kHz,出現(xiàn)了大量的不起振問(wèn)題，在初始化配置階段一直在檢測(cè)標(biāo)志位的while循環(huán)里出不來(lái),之前PHL標(biāo)識(shí)的單片機(jī)沒(méi)這個(gè)問(wèn)題，請(qǐng)問(wèn)低速晶振電路需要注意哪些點(diǎn)呢？
2024-03-18 06:36:45
STM32H723 RTC時(shí)鐘無(wú)法使用外部晶振是什么問(wèn)題呢？
STM32H723 RTC 時(shí)鐘無(wú)法使用外部LSE晶振，使用LSE會(huì)初始化失敗，使用LSI則能正常工作，同樣的LSE配置在H743、H750上則是正常的，這是什么問(wèn)題呢？MX配置如下：
2024-03-12 07:16:28
怎么判斷晶振是否起振？晶振不起振該怎么辦？
如果懷疑晶振不起振造成電路板上電不良，該如何進(jìn)一步判定是晶振本身的不良呢?這一步的判定非常關(guān)鍵，因?yàn)槿魹?b class="flag-6" style="color: red">晶振不振，就可以排除晶振與電路板不匹配造成電路板上電不良發(fā)生的假定。晶發(fā)電子以下介紹針對(duì)晶振
2024-03-06 17:22:17
晶振頻差不一樣，可以替換嗎？
,而實(shí)際的產(chǎn)品誤差值會(huì)更小。晶發(fā)電子實(shí)際測(cè)試數(shù)據(jù)顯示，行業(yè)標(biāo)準(zhǔn)為±30ppm，我司產(chǎn)晶振可實(shí)現(xiàn)±5ppm。
·溫度頻差
在不同的溫度范圍(-2070℃普通級(jí)/民用級(jí)晶振；-4085℃工業(yè)級(jí)晶振；-55
2024-03-04 13:48:39
晶振的外接電容值選擇不當(dāng)，會(huì)對(duì)電路產(chǎn)生什么影響？
如果晶振的外接電容值選擇不當(dāng)，可能會(huì)對(duì)電路產(chǎn)生以下影響 ：
1.頻率穩(wěn)定性： 電容值過(guò)小可能導(dǎo)致頻率穩(wěn)定性下降，容易受到外界因素的干擾。電容值過(guò)大可能會(huì)使頻率偏離標(biāo)稱值。
2.起振問(wèn)題： 電容值
2024-03-04 11:33:16
從事硬件開(kāi)發(fā)，如何高效采購(gòu)晶振？答案一目了然 #電子愛(ài)好者 #電子元器件 #晶振 #有源晶振 #揚(yáng)興科技
晶振揚(yáng)興科技
揚(yáng)興科技發(fā)布于 2024-02-27 15:39:53
整個(gè)電子行業(yè)都在忙著備料，你的晶振備好了嗎？ #電子 #有源晶振 #YXC晶振 #揚(yáng)興科技
晶振揚(yáng)興科技
揚(yáng)興科技發(fā)布于 2024-01-25 19:15:14
什么是時(shí)鐘信號(hào)？數(shù)字電路的時(shí)鐘信號(hào)是怎么產(chǎn)生呢？
什么是時(shí)鐘信號(hào)？數(shù)字電路的時(shí)鐘信號(hào)是怎么產(chǎn)生呢？ 時(shí)鐘信號(hào)，也稱為時(shí)鐘脈沖，是用于同步數(shù)字電路中所有操作的基本信號(hào)。它提供了一個(gè)參考頻率，使得所有電路元件都能按照同樣的節(jié)奏進(jìn)行工作。時(shí)鐘信號(hào)
2024-01-25 15:40:52
894
894
請(qǐng)問(wèn)M480的TRNG功能如何使用外部晶振做時(shí)鐘源？
請(qǐng)問(wèn)M480的TRNG功能，如何使用外部晶振做時(shí)鐘源？我做了一個(gè)PCB，上面沒(méi)有32K晶振，貌似無(wú)法使用TRNG功能
2024-01-16 08:17:34
元器件經(jīng)驗(yàn)分享-晶體與晶振對(duì)比分析
依賴外部電路來(lái)產(chǎn)生時(shí)鐘信號(hào)。使用晶體的芯片內(nèi)部通常都集成了振蕩電路。
晶振只需通電即可振蕩并輸出時(shí)鐘信號(hào)，因?yàn)槠鋬?nèi)部已經(jīng)集成了振蕩電路。有時(shí)，晶體被稱作無(wú)源晶體，而晶振被稱作有源晶體，這種稱呼方式凸顯了
2024-01-04 11:54:47
ADE7878晶振不起振是為什么？
參考開(kāi)發(fā)板畫的電路，工作模式通過(guò)跳線設(shè)為模式0，但是上電之后示波器測(cè)量晶振不起振，AVDD，DVDD和REF測(cè)量電壓為0，電路圖見(jiàn)附件，請(qǐng)問(wèn)可能是什么原因？做了好幾塊板子都是這樣子（ADE7878的封裝是用ADI網(wǎng)站的軟件導(dǎo)出的，做了鋼網(wǎng)用機(jī)器焊接，顯微鏡下看的話焊點(diǎn)良好）
2023-12-27 07:13:36
可否直接使用LVPECL輸出的有源晶振交流耦合至AD的時(shí)鐘引腳？
：
由于不希望增加時(shí)鐘管理芯片增加成本，可否直接使用低抖動(dòng)的有源晶振 2v5/3v3的輸出如圖連接？
或者 ，可否直接使用LVPECL輸出的有源晶振交流耦合至AD的時(shí)鐘引腳？
2023-12-22 06:29:38
同步時(shí)兩片AD2S1210需采用同一個(gè)晶振，有源晶振與無(wú)源晶振會(huì)有影響嗎？
AD2S1210需采用同一個(gè)晶振，有源晶振與無(wú)源晶振會(huì)有影響嗎？
2、兩片ad2s1210（粗機(jī)與精機(jī)）數(shù)據(jù)讀取是先后對(duì)于數(shù)值的正確有影響嗎？
3、就是下面這個(gè)電路（附件中）通過(guò)SPI總線讀取數(shù)據(jù)的接法正確嗎？
謝謝！
2023-12-22 06:23:59
請(qǐng)問(wèn)FPGA PLL產(chǎn)生的時(shí)鐘信號(hào)和AD9779A的數(shù)據(jù)時(shí)鐘信號(hào)的相位關(guān)系？
你們好，
我們正在使用AD9779A進(jìn)行設(shè)計(jì)，有如下疑問(wèn)：
（1） 使用AD9779A的數(shù)據(jù)時(shí)鐘信號(hào)（DATACLK）作為FPGA內(nèi)部PLL的參考時(shí)鐘，再用FPGA PLL產(chǎn)生的時(shí)鐘信號(hào)把數(shù)據(jù)
2023-12-20 07:12:27
ADAS1000晶振不起振的原因?
現(xiàn)有一個(gè)問(wèn)題想請(qǐng)教一下，我使用ADAS1000-3搭配STM32進(jìn)行單導(dǎo)心電電路的搭建，對(duì)ADAS1000進(jìn)行初始化后用示波器測(cè)ADAS1000的外部晶振沒(méi)有信號(hào)，即沒(méi)有起振。請(qǐng)看一下ADAS1000外圍電路是否有問(wèn)題，如有問(wèn)題請(qǐng)指出，謝謝！
附件中是ADAS1000-3外圍電路部分。
2023-12-19 06:12:05
AD7760的主時(shí)鐘輸入是用晶振還是FPGA產(chǎn)生的脈沖？
以下問(wèn)題：（三個(gè)AD7760同步采集信號(hào)）
1、AD7760的主時(shí)鐘輸入是用晶振還是FPGA產(chǎn)生的脈沖，（目前，我們用FPGA產(chǎn)生的時(shí)鐘）
2、每個(gè)AD7760的主時(shí)鐘共用一個(gè)緩沖器
2023-12-15 07:37:21
關(guān)于有源晶振的相位抖動(dòng)和相位噪音
關(guān)于有源晶振的相位抖動(dòng)和相位噪音
在通信網(wǎng)絡(luò)、無(wú)線傳輸、ATM和SONET等高速系統(tǒng)中，時(shí)鐘或振蕩器波形的時(shí)序誤差會(huì)限制一個(gè)數(shù)字I/O接口的最大速率。不僅如此，它還會(huì)導(dǎo)致通信鏈路的誤碼率增大，甚至
2023-12-14 09:19:08
晶振電路的并聯(lián)電阻有什么用？
晶振電路的并聯(lián)電阻有什么用？
在晶振電路中，并聯(lián)電阻是一個(gè)重要的元件，它與石英晶體諧振器并聯(lián)連接。并聯(lián)電阻的作用主要有以下幾點(diǎn)：1.頻率調(diào)節(jié)
并聯(lián)電阻可以調(diào)節(jié)晶振電路的頻率。當(dāng)并聯(lián)電阻的值發(fā)生變化
2023-12-13 09:38:27
請(qǐng)問(wèn)AD9956如果選擇直接用外部晶振時(shí)鐘，對(duì)晶振的頻率有要求嗎？
請(qǐng)問(wèn)AD9956如果選擇直接用外部晶振時(shí)鐘，對(duì)晶振的頻率有要求嗎？一定要400M，還是只要不超過(guò)400M就可以，比如20M。謝謝！
2023-12-13 08:55:39
AD7768用無(wú)源晶振的時(shí)候晶振無(wú)法起振是為什么？
我在使用AD7768的過(guò)程中，clk_sel拉高，使用外部晶振或者LVDS，使用LVDS的時(shí)候采樣正常，但是用無(wú)源晶振的時(shí)候晶振無(wú)法起振，是不是除了clk_sel拉高之外還需要什么設(shè)置才會(huì)使用外部晶振
2023-12-11 08:22:54
使用AD7175-2芯片是外部晶振沒(méi)有起震，是不是軟件配置一下才行？
你好，請(qǐng)問(wèn)一下在使用AD7175-2芯片是外部晶振沒(méi)有起震，是不是軟件配置一下才行？
這個(gè)是我查到的芯片接口圖：
這個(gè)芯片有內(nèi)部時(shí)鐘源和外部時(shí)鐘源兩種配置。
這個(gè)是時(shí)鐘寄存器配置
2023-12-11 08:21:11
AD2S1210時(shí)鐘輸入采用8.192MHZ的有源晶振，選擇晶振時(shí)對(duì)有源晶振的功率有什么要求？
設(shè)計(jì)時(shí)，AD2S1210的時(shí)鐘輸入采用8.192MHZ的有源晶振，選擇晶振時(shí)對(duì)有源晶振的功率有什么要求？？？一個(gè)有源晶振能不能給兩個(gè)AD2S1210芯片提供時(shí)鐘輸入？？？感謝！
2023-12-07 07:07:43
AD9361使用無(wú)源和有源晶振的區(qū)別是什么？
我們?cè)谑褂肁D9361的過(guò)程中發(fā)現(xiàn)，使用無(wú)源晶振會(huì)比使用有源晶振具備更好的帶外抑制，請(qǐng)問(wèn)這是什么原因?qū)е碌?，要如何做調(diào)整，我們最終需要使用有源晶振。兩者輸出頻譜的效果如下：
有源晶振，偏離中心
2023-12-06 07:45:51
AD9913晶振無(wú)法起振是什么問(wèn)題？如何解決？
使用外部無(wú)源晶振作為時(shí)鐘信號(hào)輸入，在晶振引腳測(cè)量不到振蕩波型，ref_CLK 和*REF_CLK引腳電壓為1.1V，SYNC_CLK也無(wú)時(shí)鐘波形，這是電路設(shè)計(jì)圖，請(qǐng)看看有什么問(wèn)題？這個(gè)是各個(gè)引腳的電平高低（使用的是線性通信）
2023-12-01 06:29:57
求助，關(guān)于AD9910 PLL倍頻問(wèn)題求解
83M（想先實(shí)現(xiàn)PLL倍頻功能，按濾波電路弄的個(gè)頻率），12倍頻倍到996M，SFR3[29:28]設(shè)為11，但REFCLK_OUT沒(méi)輸出（PLL使能設(shè)為1
了的），不知道是不是只有用晶振時(shí)才有輸出
2023-11-27 08:04:33
AD9249-65怎么外接晶振？
AD9249-65怎么外接晶振？有一個(gè)65M的晶振，如何接？問(wèn)題二是差分信號(hào)線是否可以在VIVADO上面采集？問(wèn)題三采集的時(shí)候是否需要input clk+和clk-？接多大的時(shí)鐘信號(hào)？以及多大的電壓？
2023-11-15 06:20:09
DFT如何產(chǎn)生PLL 測(cè)試pattern
DFT PLL向量，ATE怎么用？ 自動(dòng)測(cè)試設(shè)備（ATE）對(duì)PLL（鎖相環(huán)）進(jìn)行測(cè)試時(shí)，我們首先要明白PLL在系統(tǒng)級(jí)芯片（SoC）中的重要性。它是SoC中關(guān)鍵的時(shí)鐘或信號(hào)同步部件，其性能直接影響
2023-10-30 11:44:17662
662
了解鎖相環(huán)（PLL）瞬態(tài)響應(yīng) 如何優(yōu)化鎖相環(huán)（PLL）的瞬態(tài)響應(yīng)？
了解鎖相環(huán)（PLL）瞬態(tài)響應(yīng) 如何優(yōu)化鎖相環(huán)（PLL）的瞬態(tài)響應(yīng)？ 鎖相環(huán)（PLL）是一種廣泛應(yīng)用于數(shù)字通信、計(jì)算機(jī)網(wǎng)絡(luò)、無(wú)線傳輸?shù)阮I(lǐng)域的重要電路。PLL主要用于時(shí)鐘恢復(fù)、頻率合成、時(shí)鐘同步等領(lǐng)域
2023-10-23 10:10:20869
869FAQ0135 AT32MCU時(shí)鐘配置錯(cuò)誤或晶振大小選擇錯(cuò)誤導(dǎo)致異常
AT32MCU時(shí)鐘配置錯(cuò)誤或晶振大小選擇錯(cuò)誤導(dǎo)致異常在時(shí)鐘配置錯(cuò)誤或晶振大小選擇錯(cuò)誤的情況下，下載代碼到開(kāi)發(fā)板導(dǎo)致無(wú)法繼續(xù)進(jìn)行debug或再次下載的一系列異常情況
2023-10-23 07:12:15
是什么工業(yè)PDA？為什么要用到溫補(bǔ)晶振？#電子 #晶振 #電子元件 #YXC晶振 #揚(yáng)興科技
電子晶振揚(yáng)興科技
揚(yáng)興科技發(fā)布于 2023-10-19 18:54:49
可編程晶振詳解「工作原理、結(jié)構(gòu)、特點(diǎn)、應(yīng)用」
主要部分組成。其工作原理為：當(dāng)加電壓時(shí)，石英晶體就會(huì)產(chǎn)生振動(dòng)，并產(chǎn)生電信號(hào)，此信號(hào)被檢測(cè)并數(shù)字化后，再通過(guò)處理器進(jìn)行解調(diào)，最后輸出所需的頻率信號(hào)。
二、可編程晶振的結(jié)構(gòu)主要有以下幾個(gè)部分：
晶體：晶體
2023-10-14 17:38:14
時(shí)鐘發(fā)生器由哪些部分組成？鎖相環(huán)pll的特點(diǎn)是什么？
時(shí)鐘發(fā)生器由哪些部分組成？鎖相環(huán)pll的特點(diǎn)是什么？如何用硬件配置pll? 時(shí)鐘發(fā)生器是指通過(guò)特定的電路設(shè)計(jì)產(chǎn)生適合各種電子設(shè)備使用的時(shí)鐘信號(hào)的器件。時(shí)鐘發(fā)生器由多個(gè)部分組成，其中最核心的是鎖相環(huán)
2023-10-13 17:39:50443
443電子類專業(yè)的童鞋集合！1分鐘帶你了解，什么是可編程晶振！#電子 #晶振 #可編程晶振 #揚(yáng)興科技
晶振揚(yáng)興科技
揚(yáng)興科技發(fā)布于 2023-09-28 18:22:18
晶振的CMOS輸出是什么？1分鐘帶你掌握！#電子 #電子元件 #晶振 #YXC晶振 #揚(yáng)興科技
晶振揚(yáng)興科技
揚(yáng)興科技發(fā)布于 2023-09-28 17:45:56
利用千兆位收發(fā)器和相關(guān)PLL中的功能來(lái)替代VCXO電路
電子發(fā)燒友網(wǎng)站提供《利用千兆位收發(fā)器和相關(guān)PLL中的功能來(lái)替代VCXO電路.pdf》資料免費(fèi)下載
2023-09-15 10:08:09
0
0如何抑制時(shí)鐘電路產(chǎn)生的電磁輻射？
如何抑制時(shí)鐘電路產(chǎn)生的電磁輻射？ 在現(xiàn)代電子工業(yè)中，時(shí)鐘電路是不可或缺的，尤其是在數(shù)字電路中，時(shí)鐘電路起著控制數(shù)據(jù)流動(dòng)的作用。然而，在時(shí)鐘電路運(yùn)行時(shí)，它會(huì)產(chǎn)生電磁輻射，這會(huì)對(duì)周圍的設(shè)備和人體健康造成
2023-09-12 17:06:49554
554用FPGA的鎖相環(huán)PLL給外圍芯片提供時(shí)鐘
用FPGA的鎖相環(huán)PLL給外圍芯片提供時(shí)鐘 FPGA鎖相環(huán)PLL（Phase-Locked Loop）是一種廣泛使用的時(shí)鐘管理電路，可以對(duì)輸入時(shí)鐘信號(hào)進(jìn)行精確控制和提高穩(wěn)定性，以滿足各種應(yīng)用場(chǎng)
2023-09-02 15:12:341319
1319新唐無(wú)晶振USB解決方案應(yīng)用實(shí)例
振產(chǎn)生的問(wèn)題，且為了因應(yīng)現(xiàn)代電子產(chǎn)品輕、薄、短、小的外型，推出了無(wú)晶振USB解決方案－內(nèi)建精準(zhǔn)48 MHz高精度高速 RC 震蕩器，可抗電源干擾且可即時(shí)進(jìn)行同步校正，此方案讓客戶在電路設(shè)計(jì)過(guò)程中
2023-08-28 06:56:34
什么是時(shí)鐘電路 時(shí)鐘電路的原理和作用
時(shí)鐘電路的原理基于振蕩器和時(shí)序控制邏輯。振蕩器負(fù)責(zé)產(chǎn)生穩(wěn)定的周期性信號(hào)，而時(shí)序控制邏輯用于控制和同步各個(gè)電子組件的操作和通信。
常用的振蕩器包括晶體振蕩器、RC振蕩器和串?dāng)_鎖相環(huán)（PLL
2023-08-24 15:40:108076
8076
STM32F407VGT6低速晶振不起振的問(wèn)題，請(qǐng)問(wèn)低速晶振電路需要注意哪些點(diǎn)呢？
最近公司買進(jìn)了一批新的馬來(lái)西亞生產(chǎn)的STM32F407VGT6單片機(jī)，低速晶振采用外置的無(wú)源晶振32.768kHz,出現(xiàn)了大量的不起振問(wèn)題，在初始化配置階段一直在檢測(cè)標(biāo)志位的while循環(huán)里出不來(lái),之前PHL標(biāo)識(shí)的單片機(jī)沒(méi)這個(gè)問(wèn)題，請(qǐng)問(wèn)低速晶振電路需要注意哪些點(diǎn)呢？
2023-08-07 08:52:11
常見(jiàn)的時(shí)鐘產(chǎn)生電路有哪些 PLL/DLL電路的優(yōu)缺點(diǎn)
雙沿時(shí)鐘使得原本一個(gè)周期輸出/輸入一個(gè)數(shù)據(jù)的架構(gòu)，改變?yōu)橐粋€(gè)周期輸出/輸入兩個(gè)數(shù)據(jù)，這樣在不升高時(shí)鐘頻率的前提下，提升了信號(hào)的吞吐率，從而帶來(lái)「性能的提升」。
2023-08-05 09:50:512625
2625
如何建立一個(gè)簡(jiǎn)單的PLL電路
本實(shí)驗(yàn)活動(dòng)介紹鎖相環(huán)(PLL)。PLL電路有一些重要的應(yīng)用，例如信號(hào)調(diào)制/解調(diào)（主要是頻率和相位調(diào)制）、同步、時(shí)鐘和數(shù)據(jù)恢復(fù)，以及倍頻和頻率合成。在這項(xiàng)實(shí)驗(yàn)中，您將建立一個(gè)簡(jiǎn)單的PLL電路，讓您對(duì)PLL操作有基本的了解。
2023-07-10 10:22:24789
789
NUC029使用外部晶振無(wú)法起振是為什么？
使用內(nèi)部晶振程序是可以跑起來(lái)的，但是使用外部晶振，程序一直在等待，請(qǐng)問(wèn)這是什么原因？（晶振使用的是12M無(wú)源晶振，不知道是不是有源無(wú)源的問(wèn)題）
void SYS_Init(void
2023-06-15 08:55:30
關(guān)于內(nèi)核時(shí)鐘配置函數(shù)的相關(guān)疑問(wèn)求解
外部晶振是否正常運(yùn)行，如果正常運(yùn)行設(shè)置到外部晶振，然后設(shè)置PLL為50MHz,
如果晶振沒(méi)有正常運(yùn)行設(shè)置PLL時(shí)鐘源為HIRC，同樣設(shè)置PLL到50MHz
然后再將HCLK設(shè)置到PLL上去。
2023-06-15 06:17:09
晶振匹配電容的問(wèn)題
我有一塊STM32U575的板子，沒(méi)焊外部高速晶振，本來(lái)上面標(biāo)著16兆晶振，四個(gè)腳的，我在淘寶上買了一些32M的晶振。
淘寶上寫著匹配晶振8pF,我忘買了，搞了兩個(gè)4.7pF的晶振，用STM32CubeMX生成代碼，就是讓一個(gè)燈閃。
可是燈一直不閃。我想會(huì)不會(huì)是匹配晶振的原因。請(qǐng)高手指教，謝謝！
2023-06-02 16:42:20
S32K3在ESD測(cè)試時(shí)保持運(yùn)行，PLL_LOL時(shí)cpu時(shí)鐘可以切換到FIRC嗎？
。
我們?cè)噲D通過(guò)改變GM_SET寄存器來(lái)提高晶振強(qiáng)度，但沒(méi)有任何改善。而我們嘗試設(shè)置DCMRWP3[9]為1，當(dāng)PLL_LOL時(shí)S32K不會(huì)復(fù)位，但mcu會(huì)停止，只有復(fù)位才能恢復(fù)。
我們需要 S32K3 在 ESD 測(cè)試時(shí)保持運(yùn)行。PLL_LOL 時(shí) cpu 時(shí)鐘可以切換到 FIRC 嗎？
2023-05-30 06:49:01
能否使用10M有源時(shí)鐘替換24M外部晶振？
我這邊的應(yīng)用對(duì)MCU的時(shí)鐘有要求，無(wú)法使用24M的晶振，只能提供一個(gè)10M的有源時(shí)鐘。芯片手冊(cè)中沒(méi)有規(guī)定外部時(shí)鐘的最大值和最小值，只是寫了一個(gè)典型值24M。用戶手冊(cè)中提到了有幾個(gè)模塊是直接使用的外部時(shí)鐘，像vad、ptmr、usb等。請(qǐng)問(wèn)能否用10M有源時(shí)鐘替換24M晶振？
2023-05-26 06:26:07
【CW32飯盒派開(kāi)發(fā)板試用體驗(yàn)】- 外部時(shí)鐘配置
學(xué)習(xí)下配置開(kāi)發(fā)板的外部時(shí)鐘。
一、時(shí)鐘配置
開(kāi)發(fā)板上使用的外部晶振是8M，配置PLL到64MHz系統(tǒng)時(shí)鐘。
1.1、開(kāi)發(fā)板上的外部晶振
1.2、系統(tǒng)內(nèi)部時(shí)鐘圖
二、代碼
配置外部時(shí)鐘程序代碼
2023-05-11 11:35:34
在Proteus仿真中，單片機(jī)不接晶振和復(fù)位電路，是默認(rèn)為最小系統(tǒng)電路嗎？
在Proteus仿真中，單片機(jī)不接晶振和復(fù)位電路，是默認(rèn)為最小系統(tǒng)電路嗎？
2023-04-24 17:38:27
IP CORE 之 PLL- ISE 操作工具
開(kāi)發(fā)板外部擴(kuò)展針，輸出頻率為100MHz和頻率為10Mhz的方波，并利用示波器進(jìn)行測(cè)量。設(shè)計(jì)分析開(kāi)發(fā)板的晶振為50MHz，F(xiàn)PGA內(nèi)部嵌入有PLL模塊。使用PLL模塊可以方便快速的產(chǎn)生100MHz
2023-04-06 16:04:21
用單片機(jī)的晶振電路產(chǎn)生信號(hào)和555計(jì)時(shí)器產(chǎn)生信號(hào)哪個(gè)更好呢？
用單片機(jī)的晶振電路產(chǎn)生信號(hào)和555計(jì)時(shí)器產(chǎn)生信號(hào)哪個(gè)更好呢？請(qǐng)說(shuō)明理由
2023-04-04 16:29:43
工商網(wǎng)監(jiān)
評(píng)論