用于PCB品質(zhì)驗(yàn)證的時(shí)域串?dāng)_測(cè)量法分析

用于PCB品質(zhì)驗(yàn)證的時(shí)域串?dāng)_測(cè)量法分析

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本節(jié)給出的模型為不同形式串?dāng)_的研究提供了一個(gè)平臺(tái)，并闡明了兩條微帶線之間的互阻抗是如何在PCB上造成串?dāng)_的。圖1是一個(gè)概念性的互阻抗模型。

　　圖1：PCB上兩根走線之間的互阻抗。

　　互阻抗沿著兩條走線呈均勻分布。串?dāng)_在數(shù)字門(mén)電路向串?dāng)_線打出上升沿時(shí)產(chǎn)生，并沿著走線進(jìn)行傳播：

　　1．互電容Cm和互電感Lm都會(huì)向相鄰的被干擾線上耦合或“串?dāng)_”一個(gè)電壓。

　　2．串?dāng)_電壓以寬度等于干擾線上脈沖上升時(shí)間的窄脈沖形式出現(xiàn)在被干擾線上。

　　3．在被干擾線上，串?dāng)_脈沖一分為二，然后開(kāi)始向兩個(gè)相反的方向傳播。這就將串?dāng)_分成了兩部分：沿原干擾脈沖傳播方向傳播的前向串?dāng)_和沿相反方向向信號(hào)源傳播的反向串?dāng)_。

　　串?dāng)_類(lèi)型與耦合機(jī)制

　　根據(jù)前面討論的模型，下面將介紹串?dāng)_的耦合機(jī)制，并討論前向和反向這兩種串?dāng)_類(lèi)型。

　　電容耦合機(jī)制

　　電路中的互電容引起的干擾機(jī)制：

　　>干擾線上的脈沖到達(dá)電容時(shí)，會(huì)通過(guò)電容向被干擾線上耦合一個(gè)窄脈沖。

　　>該耦合脈沖的幅度由互電容的大小決定。

　　>然后，耦合脈沖一分為二，并開(kāi)始沿被干擾線向兩個(gè)相反的方向傳播。

　　電感或變壓器耦合機(jī)制

　　電路中的互電感會(huì)引起如下的干擾：

　　>在干擾線上傳播的脈沖將對(duì)呈現(xiàn)電流尖峰的下個(gè)位置進(jìn)行充電。

　　>這種電流尖峰會(huì)產(chǎn)生磁場(chǎng)，然后在被干擾線上感應(yīng)出電流尖峰來(lái)。

　　>變壓器會(huì)在被干擾線上產(chǎn)生兩個(gè)極性相反的電壓尖峰：負(fù)尖峰按前向傳播，正尖峰按反向傳播。

　　圖2：電容耦合式串?dāng)_。

　　圖3：電感耦合式串?dāng)_。

　　圖4：反向串?dāng)_。

　　圖5：前向串?dāng)_。

　　反向串?dāng)_

　　上述模型導(dǎo)致的電容和電感耦合串?dāng)_電壓會(huì)在被干擾線的串?dāng)_位置產(chǎn)生累加效應(yīng)。所導(dǎo)致的反向串?dāng)_包含以下特性：

　　>反向串?dāng)_是兩個(gè)相同極性脈沖之和。

　　>由于串?dāng)_位置隨干擾脈沖邊沿傳播，反向干擾在被干擾線源端呈現(xiàn)為低電平、寬脈沖信號(hào)，并且其寬度與走線長(zhǎng)度存在對(duì)應(yīng)關(guān)系。

　　>反射串?dāng)_幅度獨(dú)立于干擾線脈沖上升時(shí)間，但取決于互阻抗值。

　　前向串?dāng)_

　　需要重申的是，電容和電感耦合式串?dāng)_電壓會(huì)在被干擾線的串?dāng)_位置累加。前向串?dāng)_包括以下一些特性：

　　>前向串?dāng)_是兩個(gè)反極脈沖之和。因?yàn)闃O性相反，因此結(jié)果取決于電容和電感的相對(duì)值。

　　>前向串?dāng)_在被干擾線的末端呈現(xiàn)為寬度等于干擾脈沖上升時(shí)間的窄尖峰。

　　>前向串?dāng)_取決于干擾脈沖的上升時(shí)間。上升沿越快，幅度越高，寬度就越窄。

　　>前向串?dāng)_幅度還取決于線對(duì)長(zhǎng)度：隨著串?dāng)_位置隨干擾脈沖邊沿的傳播，被干擾線上的前向串?dāng)_脈沖將獲得更多的能量。

　　串?dāng)_的表征

　　本節(jié)將通過(guò)幾個(gè)單層PCB上的測(cè)量實(shí)例來(lái)研究串?dāng)_的產(chǎn)生機(jī)制和前面介紹的幾種串?dāng)_類(lèi)型。

　　注意：欲熟悉多層PCB及其接地層上的串?dāng)_問(wèn)題及其后果，請(qǐng)閱讀本文結(jié)尾處的參考資料或其它資源。

　　儀器和設(shè)置

　　為了在實(shí)驗(yàn)室中有效地測(cè)量串?dāng)_，應(yīng)該使用測(cè)量帶寬為20 GHz的寬帶示波器，并通過(guò)一個(gè)高品質(zhì)脈沖發(fā)生器輸出一個(gè)上升時(shí)間等于示波器上升時(shí)間的脈沖驅(qū)動(dòng)被測(cè)電路。同時(shí)采用高品質(zhì)電纜、端接電阻和適配器連接被測(cè)PCB。

　　泰克8000B系列儀器中安裝有80E04電子采樣模塊，是成功測(cè)量串?dāng)_的理想儀器組合。80E04是一款雙通道采樣模塊，包含有一個(gè)TDR階躍電壓產(chǎn)生器，能產(chǎn)生上升時(shí)間為17ps的250mv窄脈沖，并以50歐姆的源阻抗輸出。測(cè)試人員只需連接待測(cè)PCB即可。

　　前向串?dāng)_測(cè)量

　　如果只是測(cè)量前向串?dāng)_，需將所有走線進(jìn)行端接以消除反射。前向串?dāng)_應(yīng)在良好端接的被干擾線的末端測(cè)量。儀器設(shè)置見(jiàn)圖6。

　　圖6：前向串?dāng)_的測(cè)量。

　　如果互電感比互電容耦合的串?dāng)_大，那么在干擾脈沖的上升沿處串?dāng)_脈沖應(yīng)為負(fù)，寬度等于干擾脈沖的上升時(shí)間。圖中儀器顯示的就是一個(gè)幅度為48.45 mV的負(fù)脈沖(C4)。干擾脈沖幅度為250 mV，而串?dāng)_幅度將近50 mV，因此該干擾脈沖的快速邊沿在被干擾線上產(chǎn)生了20%的串?dāng)_。見(jiàn)圖7。

　　圖7：測(cè)量得到的前向串?dāng)_。

　　由于測(cè)量時(shí)來(lái)自80E04的輸入階躍電壓具有非?？斓倪呇?，因而得到的串?dāng)_過(guò)大，并不能代表實(shí)際邏輯電路中的驅(qū)動(dòng)信號(hào)。例如，如果驅(qū)動(dòng)信號(hào)來(lái)自一個(gè)1.5 ns的CMOS門(mén)，產(chǎn)生的串?dāng)_脈沖就更寬，幅度也更小。要使測(cè)量能夠體現(xiàn)出這種情況，可利用儀器的定義算法(Define Math)功能在信號(hào)捕獲之后增加一個(gè)低通濾波器。圖7中的M1波形(白色)給出的就是經(jīng)濾波后的測(cè)量結(jié)果。需要注意的是M1在垂直方向比未經(jīng)濾波的波形敏感10倍。

　　盡管數(shù)學(xué)分析已經(jīng)證明，信號(hào)捕獲后進(jìn)行低通濾波這種技術(shù)的效果與對(duì)連接到線上的干擾脈沖進(jìn)行物理濾波的效果是相同的，但以下幾步測(cè)量卻更有說(shuō)服力：

　　>測(cè)量由兩個(gè)上升沿一快一慢而幅度相同的干擾脈沖導(dǎo)致的串?dāng)_，

　　>然后將上升沿快的干擾脈沖導(dǎo)致的串?dāng)_通過(guò)低通濾波變至慢上升沿干擾脈沖的串?dāng)_，最后檢查結(jié)果。

　　圖8給出了儀器上顯示的測(cè)量結(jié)果：

　　圖8：前向串?dāng)_的后濾。

　　>$波形(R2)是慢沿干擾脈沖，紅色波形(R3)是由它導(dǎo)致的串?dāng)_。

　　>綠色波形是快沿TDR脈沖(R1)，白色波形(R4)是由它導(dǎo)致的串?dāng)_。

　　>藍(lán)色波形是由白色波形濾波后減緩了脈沖上升沿得到的波形，它代表的就是對(duì)串?dāng)_進(jìn)行后濾波的結(jié)果。圖中顯示的紅色和藍(lán)色兩個(gè)串?dāng)_波形是以相同的電壓刻度顯示的。

　　反向串?dāng)_測(cè)量

　　圖9：反向串?dāng)_的測(cè)量。

　　單測(cè)反向串?dāng)_時(shí)，需將干擾線與被干擾線均端接一個(gè)50 歐姆的電阻以消除反射。測(cè)量應(yīng)在被干擾線的左端進(jìn)行，如圖9所示。反射脈沖的幅度很低，寬度是線長(zhǎng)的兩倍，因?yàn)樵谧呔€末端的串?dāng)_必定要傳回走線源端。圖??顯示的是反向串?dāng)_的測(cè)量情況，圖中快沿干擾脈沖產(chǎn)生的串?dāng)_約為?? mV，相當(dāng)于干擾脈沖幅度的4%。反向串?dāng)_的幅度與干擾脈沖的上升時(shí)間無(wú)關(guān)。圖10中，下面兩個(gè)波形為慢沿脈沖產(chǎn)生的串?dāng)_和快沿脈沖產(chǎn)生的串?dāng)_經(jīng)后濾波得到的波形，它們的幅度都是6.5 mV。走線線長(zhǎng)與干擾脈沖上升時(shí)間的差距使得慢沿脈沖產(chǎn)生的反向串?dāng)_幅度較小。

　　圖10：測(cè)量得到的反向串?dāng)_。

　　因?yàn)榇藭r(shí)干擾脈沖的上升時(shí)間要大于走線的線長(zhǎng)，故脈沖邊沿沿走線方向回傳到走線源端時(shí)還未到達(dá)幅度頂點(diǎn)。圖11所示為利用一臺(tái)200 ps上升時(shí)間發(fā)生器(DG2040)和80E04采樣模塊的17 ps發(fā)生器的輸出作為干擾脈沖時(shí)得到的串?dāng)_測(cè)量結(jié)果。圖中顯示的3個(gè)串?dāng)_波形均采用5 mV/div的電壓刻度。

　　圖11：反向串?dāng)_與信號(hào)上升時(shí)間是相互獨(dú)立的。

　　其中，白色波形是上升時(shí)間為17 ps的干擾脈沖產(chǎn)生的串?dāng)_經(jīng)波形運(yùn)算功能后濾波(post filtering)到200ps上升時(shí)間的結(jié)果。這些測(cè)量都證實(shí)，除非干擾脈沖的上升時(shí)間超過(guò)走線長(zhǎng)度，否則該上升時(shí)間并不能影響反向串?dāng)_。而如果干擾脈沖的上升時(shí)間超過(guò)走線長(zhǎng)度，那么產(chǎn)生的反向串?dāng)_幅度較小，因?yàn)樵诖饲闆r下脈沖邊沿走過(guò)整條走線都還不能達(dá)到幅度頂點(diǎn)。

　　電路設(shè)計(jì)對(duì)串?dāng)_的影響

　　雖然通過(guò)仔細(xì)的PCB設(shè)計(jì)可以減少串?dāng)_并削弱或消除其影響，但電路板上仍可能有一些串?dāng)_殘留。因此，在進(jìn)行電路設(shè)計(jì)時(shí)，還應(yīng)采用合適的線端負(fù)載，因?yàn)榫€端負(fù)載會(huì)影響串?dāng)_的大小和串?dāng)_隨時(shí)間的弱化程度。下面是一個(gè)測(cè)量實(shí)例，它揭示了走線末端與邏輯門(mén)電路輸出處的線端負(fù)載會(huì)怎樣衰減串?dāng)_并減弱形成串?dāng)_的成因。