正點(diǎn)原子開拓者FPGA：Verilog程序框架
Verilog HDL 語言具有下述描述能力：設(shè)計(jì)的行為特性、設(shè)計(jì)的數(shù)據(jù)流特性、設(shè)計(jì)的結(jié)構(gòu)組成以及包含響應(yīng)監(jiān)控和設(shè)計(jì)驗(yàn)證方面的時(shí)延和波形產(chǎn)生機(jī)制。所有這些都使用同一種建模語言。此外，Verilog HDL語言提供了編程語言接口，通過該接口可以在模擬、驗(yàn)證期間從設(shè)計(jì)外部訪問設(shè)計(jì)，包括模擬的具體控制和運(yùn)行。
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發(fā)表于 06-15 22:54
分享正點(diǎn)原子FPGA開發(fā)板全套資料
本帖最后由 100dongdong 于 2020-5-16 23:48 編輯
正點(diǎn)原子FPGA開拓者開發(fā)板，Intel（Altera） FPG
發(fā)表于 05-16 23:35
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發(fā)表于 08-05 11:12
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發(fā)表于 08-08 11:03
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發(fā)表于 08-24 16:41
正點(diǎn)開拓者FPGA開發(fā)板使用問題
求問各位大佬，剛剛?cè)腴T正點(diǎn)開拓者FPGA開發(fā)板，用板載pcf8591采集信號發(fā)生器單一頻率正弦波，再用ip核做fft，結(jié)果和matlab上fft不一樣，請問是怎么回事呢？
發(fā)表于 01-04 09:34
正點(diǎn)原子開拓者FPGA Qsys視頻：uC/GUI圖片/數(shù)字顯示實(shí)驗(yàn)
該課程是正點(diǎn)原子團(tuán)隊(duì)編寫，詳細(xì)講解了quartus中的qsys。也可以從我頭像點(diǎn)進(jìn)去看FPGA verilog相關(guān)的視頻。
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