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電子發(fā)燒友網(wǎng)>處理器/DSP>基于DSP與CPLD的多通道數(shù)據(jù)采集系統(tǒng)的設(shè)計

基于DSP與CPLD的多通道數(shù)據(jù)采集系統(tǒng)的設(shè)計

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2010-07-21 17:11:4918

基于FPGA的多通道同步數(shù)據(jù)采集存儲系統(tǒng)

設(shè)計一種基于FPGA的多通道同步數(shù)據(jù)采集存儲系統(tǒng),分為多通道同步數(shù)據(jù)采集模塊和數(shù)據(jù)存儲模塊。系統(tǒng)設(shè)計采用多通道數(shù)據(jù)的同步實時采集以及壞塊檢測技術(shù)。多通道同步數(shù)據(jù)采集
2010-12-27 15:31:3370

換體DMA高速數(shù)據(jù)采集電路的CPLD實現(xiàn)

換體DMA高速數(shù)據(jù)采集電路的CPLD實現(xiàn) 介紹了換體DMA高速數(shù)據(jù)采集電路原理及其CPLD實現(xiàn)。用CPLD設(shè)計雙端口RAM緩存、控制譯碼、時序邏輯電路,很好地解決了電路元件所占體積
2009-03-28 15:09:18666

基于ARM和CPLD的高速數(shù)據(jù)采集系統(tǒng)設(shè)計

數(shù)據(jù)采集系統(tǒng)是通過采樣電路將輸入的模擬信號轉(zhuǎn)換成離散信號,并送入CPU、MCU或DSP進(jìn)行處理?,F(xiàn)在流行的基于PCI總線設(shè)計的采集卡是數(shù)據(jù)采集系統(tǒng)的主流,其優(yōu)點(diǎn)是可以利用PCI
2009-04-19 10:52:31817

利用CPLD實現(xiàn)多路數(shù)據(jù)采集

設(shè)計了以CPLD為核心處理芯片的多路數(shù)據(jù)采集系統(tǒng),整個數(shù)據(jù)采集系統(tǒng)可實現(xiàn)最大采集頻率為800kHz,通道數(shù)為48路的模擬信號的采集系統(tǒng)中采用了TI公司最新推出的高速低功耗A/D
2009-05-05 20:04:021666

基于CPLD和FIFO的多通道高速數(shù)據(jù)采集系統(tǒng)的研究

介紹了一種基于CPLD(復(fù)雜可編程邏輯器件)和FIFO(先入先出存儲器)的多通道高速A/D數(shù)據(jù)采集系統(tǒng)的設(shè)計方法,并給出了這種數(shù)據(jù)采集方法的硬件原理電路和主要的軟件設(shè)計思路
2009-05-05 20:50:091651

高速數(shù)據(jù)采集系統(tǒng)中精確時標(biāo)的CPLD實現(xiàn)方法

高速數(shù)據(jù)采集系統(tǒng)中精確時標(biāo)的CPLD實現(xiàn)方法 本文介紹一種利用復(fù)雜可編程邏輯器件給高速數(shù)據(jù)采集系統(tǒng)中的采集數(shù)據(jù)貼上精確時間標(biāo)簽的方法,并
2009-07-20 12:42:23609

基于ADS8364的數(shù)據(jù)采集系統(tǒng)設(shè)計

基于ADS8364的數(shù)據(jù)采集系統(tǒng)設(shè)計 開發(fā)了基于DSP和ADS8364的數(shù)據(jù)采集處理系統(tǒng)。該系統(tǒng)主要由信號調(diào)理模塊、A/D轉(zhuǎn)換模塊、DSP處理器模塊、CPLD邏輯控制模塊、Flash存儲器模
2009-09-19 09:30:201487

基于CPLD和嵌入式系統(tǒng)的高速數(shù)據(jù)采集系統(tǒng)的設(shè)計與實現(xiàn)

基于CPLD和嵌入式系統(tǒng)的高速數(shù)據(jù)采集系統(tǒng)的設(shè)計與實現(xiàn) 介紹一種基于CPLD和嵌入式系統(tǒng)的高速數(shù)據(jù)采集系統(tǒng),并詳細(xì)闡述了系統(tǒng)的結(jié)構(gòu)和軟硬件的實
2009-10-15 23:46:59616

基于A/D和DSP的高速數(shù)據(jù)采集技術(shù)

基于A/D和DSP的高速數(shù)據(jù)采集技術(shù) 中頻信號分為和差兩路,高速A/D與DSP組成的數(shù)據(jù)采集系統(tǒng)要分別對這兩路信號進(jìn)行采集。對于兩路數(shù)據(jù)采集電路,A/
2009-10-17 10:17:411201

基于PCI總線多通道數(shù)據(jù)采集系統(tǒng)的設(shè)計

基于PCI總線多通道數(shù)據(jù)采集系統(tǒng)的設(shè)計 摘 要:基于PCI總線的高速數(shù)據(jù)采集系統(tǒng)是近年來數(shù)據(jù)采集及其傳輸技術(shù)的一個發(fā)展方向。文中
2009-10-22 17:52:101312

基于單片機(jī)和CPLD實時數(shù)據(jù)采集顯示系統(tǒng)設(shè)計

基于單片機(jī)和CPLD實時數(shù)據(jù)采集顯示系統(tǒng)設(shè)計 1 引言    數(shù)據(jù)采集是分析模擬信號量數(shù)據(jù)的有效方法。而實時顯示數(shù)據(jù)是自動化檢測系統(tǒng)的現(xiàn)實需求。在測
2009-12-22 17:31:021739

基于CPLD/FPGA高速數(shù)據(jù)采集系統(tǒng)的設(shè)計

基于CPLD/FPGA高速數(shù)據(jù)采集系統(tǒng)的設(shè)計 0 引 言    傳統(tǒng)的數(shù)據(jù)采集系統(tǒng)一般采用單片機(jī),系統(tǒng)大多通過PCI總線完成數(shù)據(jù)的傳輸。其缺點(diǎn)是數(shù)學(xué)運(yùn)算能力差;
2010-01-27 09:35:01508

利用DSP和USB的三維感應(yīng)測井數(shù)據(jù)采集系統(tǒng)

利用DSP和USB的三維感應(yīng)測井數(shù)據(jù)采集系統(tǒng) 數(shù)據(jù)采集DSP最基本的應(yīng)用領(lǐng)域,本文設(shè)計的數(shù)據(jù)采集系統(tǒng)利用TI公司的TMS320F2812 DSP芯片。該芯片的主要特點(diǎn)有:150 MI/s(百萬
2010-03-04 10:10:44626

一種基于DSP和FPGA的多通道數(shù)據(jù)采集系統(tǒng)的設(shè)計

摘要:為準(zhǔn)確地分析工業(yè)生產(chǎn)中的各種數(shù)據(jù)參數(shù),結(jié)合高速DSP和FPGA的特點(diǎn),設(shè)計一套數(shù)據(jù)采集系統(tǒng),應(yīng)用FPGA的內(nèi)部邏輯實現(xiàn)時序控制,以DSP作為采集系統(tǒng)的核心,對采集到的數(shù)據(jù)進(jìn)行濾波等處理,并將處理后的結(jié)果通過USB口傳輸?shù)接嬎銠C(jī)。設(shè)計中還采用ADC0809模數(shù)轉(zhuǎn)換
2011-02-27 23:04:0096

VTN通道綜合型混合數(shù)據(jù)采集儀使用介紹# #數(shù)據(jù)采集

采集通道數(shù)據(jù)采集
穩(wěn)控自動化發(fā)布于 2022-11-17 13:04:44

基于DSPCPLD的多通道數(shù)據(jù)采集系統(tǒng)設(shè)計

設(shè)計了利用TMS320LF2407A與EPM3032A控制的ADS7805多通道采集系統(tǒng)的邏輯結(jié)構(gòu),介紹了系統(tǒng)的工作原理,詳細(xì)描述了ADS7805、DSPCPLD之間接口的硬件與軟件設(shè)計。
2011-09-27 14:33:511810

利用DSPCPLD增強(qiáng)數(shù)據(jù)采集的可擴(kuò)展性

通過一個具體的例子闡明了利用CPLD實現(xiàn)接口,使得DSP可以通過這個接口將多個外妝模擬通道映射到其I/O設(shè)備空間進(jìn)行訪問,大大增強(qiáng)了DSP訪問外設(shè)的能力,提高了整個系統(tǒng)數(shù)據(jù)采集的速率
2011-09-28 18:36:111045

高速數(shù)據(jù)采集系統(tǒng)CPLD的應(yīng)用

CPLD在高速數(shù)據(jù)采集系統(tǒng)中的應(yīng)用! 介紹了高速數(shù)據(jù)采集系統(tǒng)的整體框架分析了其中的通用部分CPLD系列產(chǎn)品的特點(diǎn)及其開發(fā)軟件.CPLD根據(jù)高速數(shù)據(jù)采集系統(tǒng)的需要VHDL語言的形式,介紹了由
2011-12-17 00:12:0026

基于CPLD的線陣CCD數(shù)據(jù)采集系統(tǒng)的開發(fā)

本文結(jié)合實際應(yīng)用需要,設(shè)計了基于復(fù)雜可編程邏輯器件(CPLD)的線陣CCD數(shù)據(jù)采集系統(tǒng)。著重介紹了數(shù)據(jù)采集的特點(diǎn)及該系統(tǒng)軟、硬件設(shè)計和最后的性能評價。
2012-05-14 09:53:411133

基于CPLD通道編碼器數(shù)據(jù)采集系統(tǒng)設(shè)計

  本文提出了采用Xilinx公司生產(chǎn)的CPLD來對多通道旋轉(zhuǎn)編碼器進(jìn)行數(shù)據(jù)采集的方法,著重介紹了系統(tǒng)的軟硬件設(shè)計和驅(qū)動程序開發(fā),以及實際應(yīng)用情況,得出了用CPLD技術(shù)為多通道編碼器
2012-07-11 10:36:311224

基于LABVIEW與DSP串口的數(shù)據(jù)采集系統(tǒng)

基于LABVIEW與DSP串口的數(shù)據(jù)采集系統(tǒng)。
2016-01-20 16:26:5341

基于FPGA的多通道數(shù)據(jù)采集系統(tǒng)設(shè)計

基于FPGA的多通道數(shù)據(jù)采集系統(tǒng)設(shè)計,下來看看。
2016-05-10 13:45:2859

通道高速數(shù)據(jù)采集系統(tǒng)的設(shè)計

通道高速數(shù)據(jù)采集系統(tǒng)的設(shè)計
2017-01-17 19:54:2411

基于CPLD高速數(shù)據(jù)采集系統(tǒng)設(shè)計_鮮果

基于CPLD高速數(shù)據(jù)采集系統(tǒng)設(shè)計_鮮果
2017-03-19 11:45:233

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