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數(shù)據(jù): SN65LVDS95-EP LVDS SERDES Transmitter 數(shù)據(jù)表
SN65LVDS95 LVDS serdes(串行器/解串器)發(fā)送器包含三個(gè)7位并行負(fù)載串行移位寄存器,一個(gè)7×?xí)r鐘合成器和四個(gè)單個(gè)集成電路中的低壓差分信號(hào)(LVDS)線路驅(qū)動(dòng)器。這些功能允許21位單端LVTTL數(shù)據(jù)通過(guò)4對(duì)平衡線導(dǎo)體同步傳輸,以便由兼容接收器(如SN65LVDS96)接收。
發(fā)送時(shí),數(shù)據(jù)位D0至D20各自在輸入時(shí)鐘信號(hào)(CLKIN)的上升沿加載到SN65LVDS95的寄存器中。 CLKIN的頻率乘以七次,然后用于在7位片中串行卸載數(shù)據(jù)寄存器。然后將三個(gè)串行流和鎖相時(shí)鐘(CLKOUT)輸出到LVDS輸出驅(qū)動(dòng)器。 CLKOUT的頻率與輸入時(shí)鐘CLKIN相同。
SN65LVDS95無(wú)需外部元件,幾乎不需要控制。數(shù)據(jù)總線在發(fā)送器的輸入端和接收器的輸出端看起來(lái)相同,數(shù)據(jù)傳輸對(duì)用戶是透明的。唯一的用戶干預(yù)是可以使用關(guān)閉/清除( SHTDN )低電平有效輸入來(lái)禁止時(shí)鐘并關(guān)閉LVDS輸出驅(qū)動(dòng)器以降低功耗消費(fèi)。該信號(hào)的低電平將所有內(nèi)部寄存器清除為低電平。
< small> 符合JEDEC和行業(yè)標(biāo)準(zhǔn)的元件認(rèn)證,確保在擴(kuò)展溫度范圍內(nèi)可靠運(yùn)行。這包括但不限于高加速應(yīng)力測(cè)試(HAST)或偏壓85/85,溫度循環(huán),高壓釜或無(wú)偏HAST,電遷移,鍵合金屬間壽命和模塑化合物壽命。此類鑒定測(cè)試不應(yīng)被視為超出規(guī)定的性能和環(huán)境限制使用該組件的合理性。
? |
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VIH (Min) (V) |
VCC (Min) (V) |
Rating |
Package Group |
Package Size: mm2:W x L (PKG) |
Gbps per Serial Channel (Max) |
ICC (Max) (mA) |
Data Throughput (Mb/s) |
Driver (RL) (Ohms) |
Number of Parallel Inputs |
Number of Parallel Outputs |
Operating Temperature Range (C) |
Output Compatibility |
PLL Frequency (MHz) |
Power Consumption (Nom) (mW) |
Receiver (Vth) (mV) |
Serial Data Receiver Channels |
Serial Data Transmitter Channels |
Signal Conditioning |
Supply Voltage(s) (V) |
Type of Line Circuit |
VCC (Max) (V) |
VCC (Nom) (V) |
VIL (Max) (V) |
? |
SN65LVDS95-EP |
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2 ? ? |
3 ? ? |
HiRel Enhanced Product ? ? |
TSSOP ? ? |
48TSSOP: 101 mm2: 8.1 x 12.5(TSSOP) ? ? |
1.36 ? ? |
110 ? ? |
170.625 ? ? |
100 ? ? |
21 ? ? |
0 ? ? |
-40 to 85 ? ? |
LVDS ? ? |
20 - 68 ? ? |
1 ? ? |
+/-100 ? ? |
0 ? ? |
3 ? ? |
No ? ? |
3.3 ? ? |
LVDS ? ? |
3.6 ? ? |
3.3 ? ? |
0.8 ? ? |