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數(shù)據(jù): 支持 HDCP 的 DS90UH926Q-Q1 720p 24 位彩色 FPD-Link III 解串器 數(shù)據(jù)表 (Rev. M)
DS90UH926Q-Q1解串器與DS90UH925Q-Q1串行器配套使用,可針對汽車娛樂系統(tǒng)內(nèi)的內(nèi)容受保護數(shù)字視頻的安全分發(fā)提供一套解決方案。該芯片組可并行RGB視頻接口轉(zhuǎn)換為單對高速串行化接口。數(shù)字視頻數(shù)據(jù)采用業(yè)界標準的HDCP復制保護方案加以保護.FPD-Link III串行總線方案支持通過單條差分鏈路實現(xiàn)高速正向數(shù)據(jù)傳輸和低速反向通道通信的全雙工控制。通過單個差分對整合視頻數(shù)據(jù)和控制可減小互連線尺寸和重量,同時還消除了偏差問題并簡化了系統(tǒng)設計。
DS90UH926Q-Q1解串器具有一個31位并行LVCMOS輸出接口,可針對RGB,視頻控制和音頻數(shù)據(jù)進行調(diào)整。器件會從高速串行數(shù)據(jù)流中提取出時鐘.LOCK輸出引腳會在傳入數(shù)據(jù)流被鎖定時提供鏈路狀態(tài),而無需使用訓練序列或特殊的同步(同步)模式,也不需要基準時鐘。
自適應用衡器優(yōu)化了最大電纜長度。輸出擴頻時鐘發(fā)生器(SSCG)和增強型漸進接通(EPTO)功能大大降低了電磁干擾(EMI)特性的反饋。
串化器和解串器上都執(zhí)行HDCP密鑰引用.HDCP密鑰被存儲在片載存儲器中。
所有商標均為其各自所有者的財產(chǎn)。
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Function |
Color Depth (bpp) |
Pixel Clock Min (MHz) |
Pixel Clock (Max) (MHz) |
Input Compatibility |
Output Compatibility |
Features |
Signal Conditioning |
EMI Reduction |
Diagnostics |
Total Throughput (Mbps) |
Rating |
Operating Temperature Range (C) |
Package Group |
Package Size: mm2:W x L (PKG) |
Pin/Package |
? |
DS90UH926Q-Q1 |
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Deserializer ? ? |
24 ? ? |
5 ? ? |
85 ? ? |
FPD-Link III LVDS ? ? |
LVCMOS ? ? |
HDCP I2C Config I2S Audio ? ? |
Adaptive Equalizer ? ? |
SSCG Staggered Outputs ? ? |
BIST ? ? |
2550 ? ? |
Automotive ? ? |
-40 to 105 ? ? |
WQFN ? ? |
60WQFN: 81 mm2: 9 x 9(WQFN) ? ? |
60WQFN ? ? |