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某魚雷聲自導(dǎo)的硬件系統(tǒng)使用了百兆網(wǎng)絡(luò)交換機(jī)實(shí)現(xiàn)DSP之間的互聯(lián)。交換機(jī)在MAC和PHY之間的接I=I是RMII，但DSP沒有相應(yīng)的外圍設(shè)備與它匹配。因此必須在FPGA中設(shè)計(jì)RMII的通訊模塊，完成DSP數(shù)據(jù)格式向RMII數(shù)據(jù)格式的轉(zhuǎn)化。在設(shè)計(jì)中將該通訊模塊分為發(fā)送狀態(tài)機(jī)和接收狀態(tài)機(jī)兩部分。每個狀態(tài)機(jī)均包含2個2 kbyte的雙口RAM作為乒乓緩沖。雙121 RAM的一端位寬2 bit作為RMII的數(shù)據(jù)端口，另一端位寬32 bit作為DSP數(shù)據(jù)端口。向該端口的指定地址寫命令字能夠啟動數(shù)據(jù)發(fā)送，向指定地址讀狀態(tài)字能夠判斷是否有數(shù)據(jù)接收。該通訊模塊工作在全雙工模式，文中給出了它的一個應(yīng)用實(shí)例。經(jīng)測試它能夠達(dá)到收發(fā)11 M byte／s以上的速度，并且占用的F王）GA硬件資源較少，滿足了系統(tǒng)網(wǎng)絡(luò)通訊的要求。
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