資料介紹
The ’HC4059 are high-speed silicon-gate devices that are pin-compatible with the CD4059A devices of the CD4000B series. These devices are divide-by-N down-counters that can be programmed to divide an input frequency by any number "N" from 3 to 15,999. The output signal is a pulse one clock cycle wide occurring at a rate equal to the input frequency divide by N. The down-counter is preset by means of 16 jam inputs.
The three Mode-Select Inputs Ka,Kb and Kc determine the modulus ("divide-by" number) of the first and last counting sections in accordance with the truth table. Every time the first (fastest) counting section goes through one cycle, it reduces by 1 the number that has been preset (jammed) into the three decades of the intermediate counting section an the last counting section, which consists of flip-flops that are not needed for opening the first counting section.
- CD54HC280 CD74HC280 CD54HCT280 CD74HCT280數(shù)據(jù)表
- 具有向下/向上模式控制的同步向上/向下計數(shù)器CD54HC190 CD74HC190 CD54HC191 CD74HC191 CD54HCT191 CD74HCT191數(shù)據(jù)表
- 高速CMOS邏輯預置計數(shù)器CD54/74HC161 CD54/74HCT161 CD54/74HC163 CD54/74HCT163數(shù)據(jù)表
- 高速CMOS LogicDual同步計數(shù)器CD74HC4518 CD54HC4520 CD74HC4520 CD74HCT4520數(shù)據(jù)表
- 高速CMOS邏輯八進制反相透明鎖存器CD54/74HC533 CD54/74HCT533 CD54/74HC563 CD74HCT563數(shù)據(jù)表
- 高速CMOS LogicHex緩沖器CD54HC4049 CD74HC4049 CD54HC4050 CD74HC4050數(shù)據(jù)表
- 高速CMOS邏輯CMOS可編程N分頻計數(shù)器CD54HC4059 CD74HC4059 數(shù)據(jù)表
- CD54HC4514, CD74HC4514, CD74HC
- CD54HC4511,CD74HC4511,CD74HCT4
- CD54HC354,CD74HC354,CD74HCT354
- CD54HC190,CD74HC190,CD54HC191,
- CD54HC00,CD74HC00,CD54HCT00,CD
- CD54HC08,CD74HC08,CD54HCT08,CD
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