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      電子發(fā)燒友網>電子資料下載>可編程邏輯>FPGA/ASIC>3DES數(shù)據(jù)加密算法的原理和使用FPGA設計的詳細說明

      3DES數(shù)據(jù)加密算法的原理和使用FPGA設計的詳細說明

      2020-01-16 | rar | 0.12 MB | 次下載 | 免費

      資料介紹

      　　介紹了3DES 數(shù)據(jù)加密算法（DDA）的原理，針對利用FPGA 硬件實現(xiàn)3DES 算法，給出了一種可進化IP 核的具體設計思想，采用可重構電路節(jié)省器件內部資源，并采用有限狀態(tài)機設計技術從而實現(xiàn)數(shù)據(jù)高速安全傳輸。本設計是在ALTERA 公司的Quartus II 環(huán)境下實現(xiàn)的，并成功下載到支持電路部分重構的Xilinx Virtex II 系列器件中的XC2V1500 芯片中。

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