資料介紹
因?yàn)閿z像頭輸出的LVDS信號(hào)速率會(huì)達(dá)到600Mbps,我們將不能夠通過(guò)FPGA的I/O接口直接去讀取這么高速率的信號(hào)。因此,需要使用Xilinx FPGA內(nèi)的SerDes去實(shí)現(xiàn)高速數(shù)據(jù)的串并轉(zhuǎn)換。
熊貓君的文章“Zynq高速串行CMOS接口的設(shè)計(jì)與實(shí)現(xiàn)”,都已經(jīng)說(shuō)清楚了,大神~~
參考文檔ug953,ug471,我們?yōu)榱瞬东@OV7251攝像頭LVDS的數(shù)據(jù)信號(hào),將會(huì)使用的以下資源:
IDELAYCTRL
IDELAYE2
ISERDESE2
ODELAYE2 (用于模擬LVDS輸出信號(hào))
OSERDESE2 (用于模擬LVDS輸出信號(hào))
MMCME2_ADV
BUFG, BUFR, BUFIO, IBUFG, IBUFDS, OBUFDS
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