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介紹了一種基于圖像的雙三次線性插值縮放算法的設計方法，并通過FPGA驗證了設計的可行性。重點討論了視頻縮放的插值算法，對兩種實現(xiàn)方法在硬件資源利用率及實施效率方面進行了比較并論證了塊狀插值實現(xiàn)方法的優(yōu)越性。最終設計實現(xiàn)了高分辨率實時視頻圖像的縮放。
實時視頻圖像的監(jiān)控現(xiàn)在已在很多領域得到應用。近年來，現(xiàn)場可編程門陣列（Field Pro—grammable Gate Array，F(xiàn)PGA）在實時圖像處理中的應用越來越多。一些FPGA器件不僅提供了豐富的邏輯資源，還提供了硬件乘法器和大量的片上存儲器，為實現(xiàn)高性能的高效率數(shù)字信號處理功能提供了方便，而在FPGA設計過程中需要對FPGA的優(yōu)化設計加以考慮。
圖像插值是圖像處理的一個基本問題計算機圖像處理、圖像渲染、醫(yī)用圖像的重構都需要使用到圖像插值。常用的圖像插值方法包括最近臨插值、雙線性插值、雙三次插值以及B樣條插值等。
本文介紹了一種基于圖像的雙三次線性插值縮放算法的設計方法，并通過FPGA驗證了設計的可行性，實現(xiàn)了高分辨率實時視頻圖像的縮放。
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