HyperLink編程的額外信息補(bǔ)充

　摘要
　　HyperLink為兩個(gè)KeyStone架構(gòu)DSP之間提供了一種高速，低延遲，引腳數(shù)量少的通信接口。HyperLink的用戶手冊(cè)已經(jīng)詳細(xì)的對(duì)其進(jìn)行了描述。本文主要是為HyperLink的編程提供了一些額外的補(bǔ)充信息。
　　同時(shí)本文還討論了HyperLink的性能，提供了在各種操作條件下的性能測(cè)試數(shù)據(jù)。對(duì)影響HyperLink性能的一些參數(shù)進(jìn)行了討論。
　　文章的最后附上對(duì)應(yīng)本文的應(yīng)用代碼。
　　1、HyperLink介紹
　　HyperLink為兩片DSP之間提供一種高速、低延遲，引腳數(shù)少的通信連接接口。
　　HyperLink的設(shè)計(jì)速度最高速率支持12.5Gbps，目前在大部分的KeyStone DSPs上，由于受限于SerDes和板級(jí)布線，速度接近為10Gbps.HyperLink是TI專有的外設(shè)接口。相對(duì)于用于高速Serdes接口的傳統(tǒng)的8b10b編碼方式，HyperLink減少了編碼冗余，編碼方式等效于8b9b.單片DSP為HyperLink提供4個(gè)SerDes通道，所以10Gbps的HyperLink理論吞吐率為10*4*（8/9）= 35.5Gbps= 4.44GB/s.
　　HyperLink使用了PCIE類似的內(nèi)存映射機(jī)制，但它為多核DSP提供了一些更靈活的特性。本文將會(huì)使用幾個(gè)范例來詳細(xì)解釋這一點(diǎn)。
　　本文還討論了HyperLink的性能，提供了在各種操作條件下的性能測(cè)試數(shù)據(jù)。對(duì)影響HyperLink性能的一些因素進(jìn)行了討論。
　　2、HyperLink配置
　　本節(jié)提供了一些配置HyperLink模塊的補(bǔ)充信息。
　　2.1 Serdes配置
　　Serdes必須配置成期望的鏈接速度。圖1表示了輸入?yún)⒖?a href='http://ttokpm.com/tags/時(shí)鐘/' target='_blank' class='arckwlink_none'>時(shí)鐘和輸出時(shí)鐘之間的關(guān)系。
　　
　　輸入?yún)⒖紩r(shí)鐘建議限制在156.25MHz ~312.5MHz范圍內(nèi)。Serdes PLL的倍頻系數(shù)必須合理配置生成的內(nèi)部時(shí)鐘（internal clock）限制在1.5625GHz ~ 3.125GHz范圍內(nèi)。
　　最后的鏈接速度由內(nèi)部時(shí)鐘（internal clock）驅(qū)動(dòng)，通過link rate配置來得到。
　　2.2 HyperLink存儲(chǔ)映射配置
　　HyperLink的存儲(chǔ)映射非常的靈活。HyperLink的用戶手冊(cè)對(duì)此作了詳細(xì)的描述。本節(jié)將用兩個(gè)例子來詳細(xì)的解釋它。圖2是第一個(gè)例子。
　　
　　圖2通過HyperLink窗口映射到遠(yuǎn)端不同類型的存儲(chǔ)空間
　　在這個(gè)例子里面，DSP1的存儲(chǔ)空間映射到了DSP0的存儲(chǔ)空間窗口0x40000000~0x50000000DSP0可以訪問DSP1的所有內(nèi)存空間，包括LL2，SL2，DDR，就像訪問自己的本地的存儲(chǔ)空間一樣。在DSP0上，所有的Master都可以通過以0x40000000起始的Outbound窗口地址來訪問DSP1的存儲(chǔ)空間，但是不同master事實(shí)上可能訪問到DSP1上不同的存儲(chǔ)空間。原因是HyperLink發(fā)送側(cè)傳輸數(shù)據(jù)時(shí)，會(huì)將PrivID一起傳輸。接受側(cè)通過PrivID值，可以建立不同的地址映射表