資料介紹
摘要:為了解決傳統(tǒng)轉(zhuǎn)換器傳輸接口傳輸速率低、抗干擾差、布局布線面積大等問題,設(shè)計了一種基于JESD204B的射頻信號高速采集系統(tǒng)。系統(tǒng)對接收到的射頻信號進(jìn)行下變頻處理,通過高速ADC對解調(diào)基帶信號直接采樣,采樣后的數(shù)字基帶信號通過自主設(shè)計的JESD204B接口邏輯傳輸至FPGA并緩存。測試結(jié)果表明,系統(tǒng)可實現(xiàn)1.0Gsample/s采樣率的直接采樣,數(shù)據(jù)傳輸速率可達(dá)10Gbit/s,且數(shù)據(jù)鏈路穩(wěn)定可靠。
隨著數(shù)據(jù)采集系統(tǒng)的廣泛應(yīng)用,轉(zhuǎn)換器采樣率與采樣精度等性能開始不斷提升,數(shù)據(jù)傳輸速率也隨之不斷提高[1。傳統(tǒng)的并行傳輸接口隨著傳輸速率的提高,逐漸暴露出信號同步難、抗干擾能力差、布局布線面積大等問題。文獻(xiàn)[2]提出的高速數(shù)據(jù)采集系統(tǒng),采用分時交替采樣技術(shù),在實現(xiàn)1GHz的采樣率的同時,也帶來了不一致性誤差。而由電子器件工程聯(lián)合委員會(JEDEC)提出的JESD204B串行接口有效解決了這些問題,并逐漸成為高性能轉(zhuǎn)換器的主流接口。
隨著數(shù)據(jù)采集系統(tǒng)的廣泛應(yīng)用,轉(zhuǎn)換器采樣率與采樣精度等性能開始不斷提升,數(shù)據(jù)傳輸速率也隨之不斷提高[1。傳統(tǒng)的并行傳輸接口隨著傳輸速率的提高,逐漸暴露出信號同步難、抗干擾能力差、布局布線面積大等問題。文獻(xiàn)[2]提出的高速數(shù)據(jù)采集系統(tǒng),采用分時交替采樣技術(shù),在實現(xiàn)1GHz的采樣率的同時,也帶來了不一致性誤差。而由電子器件工程聯(lián)合委員會(JEDEC)提出的JESD204B串行接口有效解決了這些問題,并逐漸成為高性能轉(zhuǎn)換器的主流接口。
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