資料介紹
在現(xiàn)代數(shù)字通信中, 數(shù)據(jù)傳輸中一個(gè)很重要的問題就是同步問題。而同步系統(tǒng)中的核心技 術(shù)就是鎖相環(huán)。鎖相環(huán)有模擬鎖相環(huán)、模擬?數(shù)字混合環(huán)、全數(shù)字鎖相環(huán)等。前二種環(huán)路都要采 用壓控振蕩器V CO , 利用V CO 輸出本地參考頻率。由于V CO 采用模擬電路, 這將帶來元件 飽和、直流漂移、非線性等問題。因此, 全數(shù)字鎖相環(huán)得到了越來越廣泛的應(yīng)用。
本文介紹一種 DD S(D irect D igital Syn thesizer) 與 PLL (Phase L ocked L oop ) 技術(shù)相結(jié)合, 采用大規(guī)模集成電 路 EPLD 芯片實(shí)現(xiàn)的全數(shù)字鎖相環(huán), 用這種全數(shù)字鎖相環(huán)實(shí)現(xiàn)的 PSK 解調(diào)器?碼同步器已應(yīng) 用于航天遙測(cè)技術(shù)中, 它具有數(shù)字化、高精度、高分辨率、高可靠性、小型化等優(yōu)點(diǎn)。
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