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      電子發(fā)燒友網(wǎng)>電子資料下載>電子資料>CDCL1810 1.8V 10路輸出高性能時(shí)鐘分配器數(shù)據(jù)表

      CDCL1810 1.8V 10路輸出高性能時(shí)鐘分配器數(shù)據(jù)表

      2024-08-22 | pdf | 1.42MB | 次下載 | 免費(fèi)

      資料介紹

      CDCL1810是一款高性能時(shí)鐘分配器?？?a target='_blank' class='arckwlink_none'>編程分頻器PO和P1為輸出頻率與輸入頻率之比提供了高度的靈活性:Four = FiN/P，其中:P (P0，P1) = 1，2，4，5，8，10，16，20，32，40，80。cdcl 1810支持一個(gè)差分LVDS時(shí)鐘輸入和總共10個(gè)差分CML輸出。如果交流耦合，CML輸出與LVDS接收機(jī)兼容。所有器件設(shè)置均可通過(guò)ada/SCL串行雙線接口進(jìn)行編程。串行接口只能承受1.8V電壓。一個(gè)輸出組相對(duì)于另一個(gè)輸出組的相位可以通過(guò)SDA/SCL接口進(jìn)行調(diào)整。對(duì)于5的倍數(shù)的后分頻比(P0，P1)，相位調(diào)整步長(zhǎng)總數(shù)(n)等于分頻比除以5。對(duì)于不是5的倍數(shù)的后分頻比(P0，P1)，總級(jí)數(shù)(n)與后分頻比相同。以時(shí)間單位表示的相位調(diào)整步長(zhǎng)(Ao)為:Ap = 1/(n×4)，其中4為相應(yīng)的輸出頻率。
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