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      電子發(fā)燒友網(wǎng)>電子資料下載>電子論文>嵌入式技術論文>利用Allegro實現(xiàn)嵌入式系統(tǒng)高速電路設計

      利用Allegro實現(xiàn)嵌入式系統(tǒng)高速電路設計

      2009-08-26 | rar | 198 | 次下載 | 10積分

      資料介紹

      本文首先簡述了高性能ARM9微處理器EP9315集成的外設接口及硬件結構框架，提出了當前高速電路設計中的問題；然后，詳細介紹了利用Allegro實現(xiàn)嵌入式系統(tǒng)中SDRAM和IDE總線接口的電路設計；最后以Cirrus Logic公司的CS8952為例，闡述了物理層接口芯片的布線準則及其在Allegro中的實現(xiàn)。
      關鍵詞：嵌入式系統(tǒng)； Allegro；等長；差分對；阻抗控制
      隨著嵌入式微處理器主頻的不斷提高，信號的傳輸處理速度越來越快，當系統(tǒng)時鐘頻率
      達到100 MHZ 以上,傳統(tǒng)的電路設計方法和軟件已無法滿足高速電路設計的要求。在高速電路設計中，走線的等長、關鍵信號的阻抗控制、差分走線的設置等越來越重要。筆者所在的武漢華中科技大學與武漢中科院巖土力學所智能儀器室合作，以ARM9 微處理器EP9315 為核心的嵌入式系統(tǒng)完成工程檢測儀的開發(fā)。其中在該嵌入式系統(tǒng)硬件電路設計中的SDRAM 和IDE 等長走線、關鍵信號的阻抗控制和差分走線是本文的重點,同時以cirrus logic 公司的網(wǎng)絡物理層接口芯片cs8952 為例詳細介紹了網(wǎng)絡部分的硬件電路設計，為同類高速硬件電路設計提供了一種可借鑒的方法。
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