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標(biāo)簽 > 74HC595

74HC595

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74HC595是硅結(jié)構(gòu)的CMOS器件, 兼容低電壓TTL電路,遵守JEDEC NO.7A標(biāo)準(zhǔn)。

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74HC595簡介

  74HC595是硅結(jié)構(gòu)的CMOS器件, 兼容低電壓TTL電路,遵守JEDEC NO.7A標(biāo)準(zhǔn)。

  74HC595具有8位移位寄存器和一個存儲器,三態(tài)輸出功能。 移位寄存器和存儲器有相互獨立的時鐘。

  數(shù)據(jù)在SH_cp(移位寄存器時鐘輸入)的上升沿輸入到移位寄存器中,在ST_cp(存儲器時鐘輸入)的上升沿輸入到存儲寄存器中去。如果兩個時鐘連在一起,則移位寄存器總是比存儲寄存器早一個脈沖。

  移位寄存器有一個串行移位輸入(Ds),和一個串行輸出(Q7’),和一個異步的低電平復(fù)位,存儲寄存器有一個并行8位的,具備三態(tài)的總線輸出,當(dāng)使能OE時(為低電平),存儲寄存器的數(shù)據(jù)輸出到總線。

74HC595百科

  是硅結(jié)構(gòu)的CMOS器件, 兼容低電壓TTL電路,遵守JEDEC NO.7A標(biāo)準(zhǔn)。

  74HC595具有8位移位寄存器和一個存儲器,三態(tài)輸出功能。 移位寄存器和存儲器有相互獨立的時鐘。

  數(shù)據(jù)在SH_cp(移位寄存器時鐘輸入)的上升沿輸入到移位寄存器中,在ST_cp(存儲器時鐘輸入)的上升沿輸入到存儲寄存器中去。如果兩個時鐘連在一起,則移位寄存器總是比存儲寄存器早一個脈沖。

  移位寄存器有一個串行移位輸入(Ds),和一個串行輸出(Q7’),和一個異步的低電平復(fù)位,存儲寄存器有一個并行8位的,具備三態(tài)的總線輸出,當(dāng)使能OE時(為低電平),存儲寄存器的數(shù)據(jù)輸出到總線。

  8位串行輸入/輸出或者并行輸出移位寄存器,具有高阻關(guān)斷狀態(tài)。三態(tài)。

  將串行輸入的8位數(shù)字,轉(zhuǎn)變?yōu)椴⑿休敵龅?位數(shù)字,例如控制一個8位數(shù)碼管,將不會有閃爍。

     輸出能力

  并行輸出,總線驅(qū)動; 串行輸入;標(biāo)準(zhǔn)中等規(guī)模集成電路

  595移位寄存器有一個串行移位輸入(Ds),和一個串行輸出(Q7’),和一個異步的低電平復(fù)位,存儲寄存器有一個并行8位的,具備三態(tài)的總線輸出,當(dāng)使能OE時(為低電平),存儲寄存器的數(shù)據(jù)輸出到總線。

  參考數(shù)據(jù)

  Cpd決定動態(tài)的能耗,

  Pd=Cpd×VCC×f1+∑(CL×VCC^2×f0)

  F1=輸入頻率,CL=輸出電容 f0=輸出頻率(MHz) Vcc=電源電壓

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74hc595知識

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