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      標簽　>　ADP5043

      ADP5043

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      　　ADP5043在一個20引腳小型LFCSP封裝中集成了一個高性能降壓調(diào)節(jié)器和一個低壓差調(diào)節(jié)器（LDO），可滿足嚴苛的性能和電路板空間要求。

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      ADP5043簡介

      　　ADP5043集成0.8 A降壓調(diào)節(jié)器、300 mA LDO、電源監(jiān)控器、看門狗和手動復(fù)位功能的微型電源管理單元

      　　ADP5043在一個20引腳小型LFCSP封裝中集成了一個高性能降壓調(diào)節(jié)器和一個低壓差調(diào)節(jié)器（LDO），可滿足嚴苛的性能和電路板空間要求。

      　　降壓調(diào)節(jié)器的高開關(guān)頻率支持使用小型多層外部器件，并使所需的電路板空間降至較小。

      　　MODE引腳用于選擇降壓調(diào)節(jié)器的工作模式。設(shè)為邏輯高電平時，降壓調(diào)節(jié)器以強制PWM模式工作。設(shè)為邏輯低電平時，如果負載在標稱值左右，則降壓調(diào)節(jié)器以PWM模式工作；當負載電流降至預(yù)定義閾值以下時，調(diào)節(jié)器以省電模式（PSM）工作，以便改善輕負載效率。

      　　ADP5043 LDO的低靜態(tài)電流、低壓差和寬輸入電壓范圍可延長便攜式設(shè)備的電池使用時間。在頻率高達10 kHz時，該LDO能保持60 dB以上的電源抑制性能，而所需的電壓裕量則很低。

      　　各調(diào)節(jié)器通過對相應(yīng)的使能引腳施加高電平來激活。ADP5043提供在工廠編程的默認輸出電壓設(shè)置，選擇范圍廣泛。

      　　ADP5043內(nèi)置電源監(jiān)控電路，可以監(jiān)控微處理器系統(tǒng)的電源電壓和代碼執(zhí)行完整性。此外還提供上電復(fù)位信號。如果微處理器未能在預(yù)設(shè)超時周期內(nèi)發(fā)出選通脈沖，片內(nèi)雙看門狗定時器能夠復(fù)位微處理器或者使系統(tǒng)周期供電（看門狗2）。

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