波峰系數(shù)削減 - 軟件無線電設(shè)計(jì)中的FPGA應(yīng)用要點(diǎn)

　　--- 3G 基于CDMA的系統(tǒng)和多載波系統(tǒng)如正交頻分復(fù)用(OFDM)的信號(hào)具有很高的峰平比(波峰系數(shù))。這樣的信號(hào)會(huì)極大地降低基站中功放的效率。對(duì)多波形標(biāo)準(zhǔn)，在FPGA中實(shí)現(xiàn)的波峰系數(shù)削減技術(shù)是一種降低功放成本和復(fù)雜度的合算的方式。

　　數(shù)字預(yù)畸變

　　--- 高速移動(dòng)數(shù)據(jù)傳輸采用非恒包絡(luò)調(diào)制技術(shù)如QPSK和正交幅度調(diào)制(QAM)。這對(duì)PA的線性度有嚴(yán)格的要求。DPD線性化技術(shù)，包括查找表和多項(xiàng)式方式都可以有效地在包含DSP塊的FPGA中實(shí)現(xiàn)。這些DSP塊中的乘法器可以在很高的時(shí)鐘速率下運(yùn)行，可以有效地分時(shí)實(shí)現(xiàn)復(fù)數(shù)乘法。當(dāng)SDR基站中使用FPGA時(shí)，F(xiàn)PGA可以為特定的標(biāo)準(zhǔn)重配置來實(shí)現(xiàn)合適的DPD算法，有效地線性化PA。 數(shù)字下變頻器

　　--- 在接收器側(cè)，數(shù)字IF技術(shù)可以對(duì)IF信號(hào)進(jìn)行采樣，在數(shù)字域執(zhí)行信道化和采樣率轉(zhuǎn)換。使用降采樣技術(shù)，高頻IF信號(hào)(同時(shí)100MHz以上)可以被量化。因?yàn)椴煌臉?biāo)準(zhǔn)有不同的碼片/比特速率，對(duì)SDR應(yīng)用需要非整數(shù)采樣率，把采樣數(shù)轉(zhuǎn)換為任何標(biāo)準(zhǔn)基本碼片/比特速率的整數(shù)倍。

　　結(jié)論

　　--- FPGA提供了通用的計(jì)算結(jié)構(gòu)，非常適合于軟件無線電中基帶和IF數(shù)字處理的需要。另外，F(xiàn)PGA作為通用處理器或DSP軟件處理的硬件協(xié)處理器，能夠增強(qiáng)功能，改善吞吐量，減小系統(tǒng)成本和降低系統(tǒng)功率。