AXI_GP接口和AXI_HP接口的相關(guān)內(nèi)容

學(xué)習(xí)內(nèi)容

學(xué)習(xí)關(guān)于ZYNQ IP核中的GP接口和HP接口的異同，介紹關(guān)于AXI_GP接口和AXI_HP接口的相關(guān)內(nèi)容。

AXI_HP和AXI_GP異同

首先給出ZYNQ SoC的系統(tǒng)框圖，如下圖所示。在圖中，箭頭方向代表主機(jī)到從機(jī)的方向。

對(duì)于GP接口（general purpose）通用目的接口，有四個(gè)接口（兩個(gè)從端口，兩個(gè)主端口）；HP接口（high-performance purpose）高性能接口，有四個(gè)接口（四個(gè)都是從端口）。GP接口直接連接到的是中央互聯(lián)區(qū)（central interconnect），然后由中央互聯(lián)區(qū)再連接到OCM interconnect和存儲(chǔ)器接口上；而HP接口直接連接到的是OCM interconnect和存儲(chǔ)器接口。所以對(duì)于GP接口，通常使用他進(jìn)行控制配置；而對(duì)于HP接口，通常使用它進(jìn)行數(shù)據(jù)傳輸交互。下圖是HP和GP對(duì)應(yīng)主從機(jī)具體信息：

AXI_HP接口

4個(gè)AXI HP接口為PL的主機(jī)提供了DDR和OCM存儲(chǔ)器的高帶寬的數(shù)據(jù)路徑。 每個(gè)HP接口包括兩個(gè)的FIFO緩存，用于讀寫(xiě)傳輸。PL到內(nèi)存互連高速AXI HP端口路由連接到兩個(gè)DDR內(nèi)存端口和一個(gè)OCM存儲(chǔ)器端口。AXI HP接口也被稱(chēng)為AFI （AXI FIFO接口），以強(qiáng)調(diào)它們的緩沖功能。 PL電平移位器必須通過(guò)LVL SHFTR EN啟用后，才能進(jìn)行PL邏輯通信。

特點(diǎn)

這些接口被設(shè)計(jì)為在PL主存儲(chǔ)器和PS存儲(chǔ)器（包括DDR和片上RAM）之間提供一個(gè)高吞吐量的數(shù)據(jù)路徑。主要功能包括：

可以實(shí)現(xiàn)32或64位數(shù)據(jù)位寬的主接口（每個(gè)端口獨(dú)立編程）。

在32位接口模式下，可以進(jìn)行動(dòng)態(tài)配置位為64位，以實(shí)現(xiàn)對(duì)齊傳輸，通過(guò)AxCACHE ［1］可以進(jìn)行控制。

在32位接口模式下，為未對(duì)齊的32位傳輸自動(dòng)擴(kuò)展到64位。

可編程的寫(xiě)命令釋放閾值。

PL和PS之間的所有AXI接口的異步時(shí)鐘域交叉。

使用1kb （128 × 64位）數(shù)據(jù)緩存FIFO來(lái)平滑“長(zhǎng)延遲”傳輸，用于讀寫(xiě)。

從PL端口提供QoS信令。

命令和數(shù)據(jù)FIFO填充級(jí)計(jì)數(shù)可用于PL端。

支持標(biāo)準(zhǔn)AXI 3.0接口。

可編程命令下發(fā)到互連，分別用于讀和寫(xiě)命令。

14到70個(gè)指令范圍的高性能從接口讀接受能力。（取決于突發(fā)長(zhǎng)度）

8到32個(gè)指令范圍的高性能從接口寫(xiě)接受能力。（取決于突發(fā)長(zhǎng)度）

AXI_HP接口的框圖

為了提高讀寫(xiě)的性能，在讀寫(xiě)數(shù)據(jù)通道添加了FIFO用于讀寫(xiě)數(shù)據(jù)的傳輸。

有兩組AXI端口，一組直接連接到PL，另一組連接到AXI互連矩陣，允許訪(fǎng)問(wèn)DDR和OCM內(nèi)存：

AXI_GP接口

AXI_GP接口直接連接到主互連和從互連的端口，沒(méi)有任何額外的FIFO緩沖，不像AXI_HP接口使用FIFO緩沖以提高性能和吞吐量。因此，性能受到主互連端口和從互連端口的限制。這些接口僅用于通用用途，并不是為了實(shí)現(xiàn)高性能。

特點(diǎn)

AXI GP的特性包括：

支持標(biāo)準(zhǔn)AXI協(xié)議

數(shù)據(jù)總線(xiàn)寬度只有32位

主端口ID位寬為12位

主端口發(fā)送能力：8位讀，8位寫(xiě)

從端口ID位寬為6位

從端口接受能力：8位讀，8位寫(xiě)

Reference

Xilinx UG585

正點(diǎn)原子ZYNQ開(kāi)發(fā)視頻教程

原文標(biāo)題：Reference

文章出處：【微信公眾號(hào)：FPGA之家】歡迎添加關(guān)注！文章轉(zhuǎn)載請(qǐng)注明出處。