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適配MOSFET柵極驅(qū)動(dòng)器以驅(qū)動(dòng)GaN FETs

深圳市浮思特科技有限公司 ? 2024-02-29 17:54 ? 次閱讀

GaN FETs以其體積小、切換速度快、效率高及成本低等優(yōu)勢(shì),為電力電子產(chǎn)業(yè)帶來了革命性的變化。然而,GaN技術(shù)的快速發(fā)展有時(shí)超出了專門為GaN設(shè)計(jì)的柵極驅(qū)動(dòng)器和控制器的發(fā)展。因此,電路設(shè)計(jì)師經(jīng)常轉(zhuǎn)向?yàn)楣?a target="_blank">MOSFETs設(shè)計(jì)的通用柵極驅(qū)動(dòng)器,這就需要仔細(xì)考慮多個(gè)因素以實(shí)現(xiàn)最佳性能。

GaN晶體管與Si MOSFETs的對(duì)比

與硅MOSFETs相比,eGaN FETs展現(xiàn)出不同的特性,這影響了它們與為后者設(shè)計(jì)的柵極驅(qū)動(dòng)器的配合。

主要區(qū)別包括

柵極電壓等級(jí)較低:eGaN FETs需要5V的柵極電壓以開啟,0V以關(guān)閉,最大柵極電壓等級(jí)為6V。這要求柵極驅(qū)動(dòng)器的電源設(shè)計(jì)相應(yīng)地進(jìn)行調(diào)整,以及驅(qū)動(dòng)器或控制器的欠壓鎖定(UVLO)也應(yīng)與5V柵極驅(qū)動(dòng)相匹配。

更快的切換速度:與GaN相比,Si MOSFETs的RDS(on)·QG可能高出3倍以上,RDS(on)·QGD高出10倍。因此,開關(guān)節(jié)點(diǎn)可能出現(xiàn)75V/ns或更高的dv/dt,所以柵極驅(qū)動(dòng)器需要對(duì)此類斜率免疫。更快的切換速度也使寄生電感更為顯著,因此設(shè)計(jì)中需要采用低電感布局技術(shù)。

更高的反向?qū)щ妷航担?/strong>與硅MOSFETs不同,eGaN FETs缺乏寄生體二極管,但它們能在反向時(shí)導(dǎo)電,且電壓降更大,約2.5V,相較于MOSFETs的1V。這意味著在死區(qū)時(shí)間內(nèi),柵極驅(qū)動(dòng)器可能會(huì)看到更高的負(fù)開關(guān)節(jié)點(diǎn)電壓。因此,柵極驅(qū)動(dòng)器應(yīng)包含引導(dǎo)過壓管理功能,并能夠在-5V的負(fù)開關(guān)節(jié)點(diǎn)電壓下工作。

圖片

MOSFET柵極驅(qū)動(dòng)器的兼容性

在MOSFET柵極驅(qū)動(dòng)器被設(shè)計(jì)來驅(qū)動(dòng)GaN FETs之前,它必須滿足特定要求。

兼容5V供電門驅(qū)動(dòng)器必須兼容5V供電,不論是來自外部調(diào)節(jié)電源還是內(nèi)部低壓差線性穩(wěn)壓器LDO)。

欠壓鎖定兼容性:UVLO需要與5V驅(qū)動(dòng)階段兼容,典型的UVLO值應(yīng)在低側(cè)驅(qū)動(dòng)階段為3.75-4V,高側(cè)為3.25-3.75V。

抗dv/dt能力:門驅(qū)動(dòng)器應(yīng)具備超過最大預(yù)期dv/dt的抗干擾能力,優(yōu)選超過50kV/μs。如果無法滿足此要求,可能需要降低切換速度,以犧牲轉(zhuǎn)換效率為代價(jià)。

自舉電源供應(yīng):許多MOSFET驅(qū)動(dòng)器使用自舉電路為上部設(shè)備驅(qū)動(dòng)器供電,多數(shù)情況下使用自舉二極管。適用于GaN FETs的只有那些使用外部自舉二極管的門驅(qū)動(dòng)器,尤其是在建議中明確指出的。選擇包含自舉二極管后LDO的驅(qū)動(dòng)器為佳。

死區(qū)時(shí)間能力:eGaN FETs卓越的切換特性允許在MHz范圍內(nèi)操作同時(shí)保持高轉(zhuǎn)換效率。因此,即使低于10ns的最小死區(qū)時(shí)間也顯得非常有益。某些為MOSFET設(shè)計(jì)的控制器可能不支持如此低的死區(qū)時(shí)間,這將削弱GaN器件的優(yōu)勢(shì)。在考慮用于GaN FETs的控制器時(shí),應(yīng)優(yōu)先選擇那些具有低死區(qū)時(shí)間能力的。

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GaN FET驅(qū)動(dòng)器改造指南

為了確保與GaN FET的最高兼容性,一旦確定了合適的MOSFET驅(qū)動(dòng)器,就可以實(shí)施以下步驟。以下是一些針對(duì)GaN FET驅(qū)動(dòng)的一般建議。

自舉二極管(Bootstrap Diode):選擇盡可能小尺寸、電容電流等級(jí)的肖特基二極管(例如BAT54KFILM),并將其與限流電阻串聯(lián),以保持驅(qū)動(dòng)器電壓盡可能接近5V,同時(shí)在保護(hù)電路啟動(dòng)時(shí)限制引導(dǎo)二極管的電流。如果驅(qū)動(dòng)器在引導(dǎo)二極管后集成了5V的LDO,則不需要串聯(lián)電阻和后續(xù)的額外電路保護(hù)措施。

自舉鉗位(Bootstrap Clamp):在引導(dǎo)電容器上并聯(lián)一個(gè)齊納二極管,可以在低側(cè)器件反向?qū)ㄆ陂g將電壓夾緊在6V以下,以防止過壓。齊納二極管和引導(dǎo)電容器應(yīng)盡可能靠近彼此以及門驅(qū)動(dòng)器。

柵極返回電阻(Gate Return Resistor):為高側(cè)FET添加門返回電阻可以在低側(cè)GaN FET反向?qū)〞r(shí),保護(hù)IC不受開關(guān)節(jié)點(diǎn)上的大負(fù)電壓影響。這個(gè)電阻的值還取決于上層器件門電路的關(guān)斷阻尼和定時(shí)需求。

反向?qū)ㄣQ位(Reverse Conduction Clamp):在半橋拓?fù)涞牡蛡?cè)并聯(lián)一個(gè)反向肖特基二極管,可以限制驅(qū)動(dòng)器暴露于的負(fù)開關(guān)節(jié)點(diǎn)電壓的幅度。這種二極管的電壓等級(jí)應(yīng)與低側(cè)GaN FET匹配,而電流等級(jí)可以遠(yuǎn)低于低側(cè)FET,因?yàn)樗辉谒绤^(qū)時(shí)間內(nèi)導(dǎo)通。

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控制器集成電路和集成門極驅(qū)動(dòng)器

控制器集成電路將許多功能集成到單一的IC中,包括門極驅(qū)動(dòng)器。其中一些IC可能不允許為GaN設(shè)備提供最佳布局,因此理解設(shè)計(jì)折衷以實(shí)現(xiàn)最佳性能非常重要。

在設(shè)計(jì)使用GaN FETs的功率級(jí)時(shí),始終遵循通用布局建議非常重要。考慮的順序仍然是共源電感(CSI),其次是功率和門環(huán)電感。這意味著功率級(jí)本質(zhì)上被設(shè)計(jì)為一個(gè)塊,門信號(hào)連接到控制器IC。針對(duì)功率級(jí)塊的推薦布局的變化使得選擇一個(gè)可以適配控制器IC的最佳塊變得更加容易。在2相控制器的情況下,可能需要在兩種替代設(shè)計(jì)之間進(jìn)行選擇。設(shè)計(jì)準(zhǔn)則是優(yōu)先考慮控制FET(開關(guān)),通常是硬開關(guān),而不是同步整流器。例如,在降壓轉(zhuǎn)換器中,布局應(yīng)優(yōu)化以最小化高側(cè)FET的門環(huán)電感。對(duì)于升壓轉(zhuǎn)換器中的低側(cè)FET也是如此。

為了適配用于GaN FETs的MOSFET門極驅(qū)動(dòng)器,設(shè)計(jì)師必須確保兼容性,實(shí)施推薦的修改,并優(yōu)化布局以利用GaN技術(shù)的全部潛力。通過仔細(xì)注意這些產(chǎn)品參數(shù)和設(shè)計(jì)指南,設(shè)計(jì)師可以使用通用門極驅(qū)動(dòng)器和控制器,為GaN基電源轉(zhuǎn)換器的成功大規(guī)模生產(chǎn)鋪平道路。

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