本文設(shè)計了一種基于FPGA動態(tài)可重構(gòu)技術(shù)的二模冗余MIPS處理器。系統(tǒng)可以對系統(tǒng)錯誤進行自行檢測和錯誤自行定位，經(jīng)測試系統(tǒng)可以正常運行。本系統(tǒng)下一步的工作是進一步完善故障自檢測系統(tǒng)和設(shè)計故障的自修復(fù)系統(tǒng)。
2013-11-28 18:58:36
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現(xiàn)場可編程門陣列（FPGA）作為專用集成電路（ASIC）領(lǐng)域的一種半定制電路，可以根據(jù)設(shè)計的需要靈活實現(xiàn)各種接口或者總線的輸出，在設(shè)備端的通信產(chǎn)品中已得到越來越廣泛的使用。##在設(shè)備端通信產(chǎn)品中，基于CPLD 的FPGA 從并加載框如圖2 所示。
2015-01-30 16:54:392847 在實驗室中設(shè)計出專用IC，實現(xiàn)系統(tǒng)的集成，從而大大縮短了產(chǎn)品開發(fā)、上市的時間，降低了開發(fā)成本。此外，CPLD/FPGA還具有靜態(tài)可重復(fù)編程或在線動態(tài)重構(gòu)特性，使硬件的功能可象軟件一樣通過編程來修改
2011-12-25 23:49:01
FPGA與CPLD的辨別和分類主要是根據(jù)其結(jié)構(gòu)特點和工作原理。通常的分類方法是：將以乘積項結(jié)構(gòu)方式構(gòu)成邏輯行為的器件稱為CPLD，如Lattice的ispLSI系列、Xilinx的XC9500系列
2019-07-01 07:36:55
FPGA與CPLD的區(qū)別
盡管很多人聽說過CPLD，但是關(guān)于CPLD與FPGA之間的區(qū)別，了解的人可能不是很多。雖然FPGA與CPLD都是“可反復(fù)編程的邏輯器件”，但是在技術(shù)上卻有一些差異。簡單
2011-09-27 09:49:48
FPGA與CPLD（特權(quán)同學(xué)版權(quán)所有）本文節(jié)選自特權(quán)同學(xué)的圖書《FPGA設(shè)計實戰(zhàn)演練（邏輯篇）》（特權(quán)同學(xué)版權(quán)所有）配套例程下載鏈接：http://pan.baidu.com/s/1pJ5bCtt
2019-02-21 06:19:27
編程兩類。ＦＰＧＡ大部分是基于ＳＲＡＭ編程,編程信息在系統(tǒng)斷電時丟失,每次上電時,需從器件外部將編程數(shù)據(jù)重新寫入ＳＲＡＭ中。其優(yōu)點是可以編程任意次,可在工作中快速編程,從而實現(xiàn)板級和系統(tǒng)級的動態(tài)配置
2012-10-26 08:10:36
用CPLD實現(xiàn)。 （2）數(shù)據(jù)密集型，需要大量的數(shù)據(jù)處理能力，但邏輯相對簡單，對輸入要求少，適合FPGA實現(xiàn)。7、配置不同 CPLD：采用EPROM，E2PROM工藝，直接寫入，保密性好。 FPGA：采用SRAM工藝，故需外加ROM芯片，用于存儲配置信息。其保密性較差?？蓪崿F(xiàn)動態(tài)重構(gòu)。高端FPGA具備加密功能
2020-08-28 15:41:47
可重構(gòu)設(shè)計是指利用可重用的軟、硬件資源，根據(jù)不同的應(yīng)用需求，靈活地改變自身體系結(jié)構(gòu)的設(shè)計方法。FPGA器件可多次重復(fù)配置邏輯的特性使可重構(gòu)系統(tǒng)成為可能，使系統(tǒng)兼具靈活、便捷、硬件資源可復(fù)用等性能
2011-05-27 10:22:36
FPGA與CPLD（特權(quán)同學(xué)版權(quán)所有）本文節(jié)選自特權(quán)同學(xué)的圖書《FPGA設(shè)計實戰(zhàn)演練（邏輯篇）》（特權(quán)同學(xué)版權(quán)所有）配套例程下載鏈接：http://pan.baidu.com/s/1pJ5bCtt
2015-03-12 13:54:42
根據(jù)重構(gòu)的方法不同，FPGA的重構(gòu)可分為靜態(tài)重構(gòu)和動態(tài)重構(gòu)兩種，前者是指在系統(tǒng)空閑期間進行在線編程，即斷開先前的電路功能后，重新下載存貯器中不同的目標數(shù)據(jù)來改變目標系統(tǒng)邏輯功能。常規(guī)SRAM
2011-05-27 10:22:59
用vhdl實現(xiàn)cpld配置fpga，配置成功后在usermode下設(shè)置一個重新配置信號，當信號有效時對fpga進行重新配置；fpga配置程序放在flash內(nèi)；現(xiàn)在遇到的問題是，上電cpld能夠正常配置fpga并且進入usermode ，但是加上重新配置語句過后就不能成功配置fpga，求高人指點~
2013-01-17 22:35:39
：TMS(模式選擇)、TCK(時鐘)、TDI(數(shù)據(jù)輸入)、TDO(數(shù)據(jù)輸出線)。本文利用JTAG標準協(xié)議設(shè)計一種針對同類FPGA進行動態(tài)重構(gòu)配置的重構(gòu)控制器。
2019-10-17 07:50:32
Altera FPGA/CPLD設(shè)計與Verilog數(shù)字系統(tǒng)設(shè)計教程從網(wǎng)上找到了一些Altera FPGA/CPLD經(jīng)典教材，包含夏宇聞老師的Verilog數(shù)字系統(tǒng)設(shè)計教程(第2版)Altera FPGA/CPLD設(shè)計與Verilog數(shù)字系統(tǒng)設(shè)計教程
2014-02-17 09:22:18
本帖最后由 mr.pengyongche 于 2013-4-30 03:24 編輯
通用微處理器具有良好的接口功能，便于構(gòu)建可重構(gòu)系統(tǒng)。按照MPU與FPGA之間的相互關(guān)系以及在系統(tǒng)中所起的作用，主要可以分為兩類：MPU控制FPGA工作的可重構(gòu)系統(tǒng)和MPU協(xié)同FPGA工作的可重構(gòu)系統(tǒng)
2011-05-27 10:29:16
本帖最后由 nilwade 于 2014-5-11 20:47 編輯
之前剛學(xué)FPGA時在網(wǎng)上下載的一個教程，該教程定位于FPGA/CPLD的快速入門，適合初學(xué)者：“以ALTERA公司的芯片
2014-05-11 20:44:00
`內(nèi)容簡介· · · · · ·CPLD/FPGA是目前應(yīng)用最為廣泛的兩種可編程專用集成電路（ASIC），特別適合于產(chǎn)品的樣品開發(fā)與小批量生產(chǎn)。本書從現(xiàn)代電子系統(tǒng)設(shè)計的角度出發(fā)，以全球著名
2018-03-29 17:11:59
FPGA可重構(gòu)設(shè)計的基礎(chǔ)是什么？基于FPGA的可重構(gòu)系統(tǒng)結(jié)構(gòu)是怎樣構(gòu)成的？基于FPGA的可重構(gòu)系統(tǒng)的應(yīng)用有哪些？
2021-04-30 07:16:04
CPLD的核心可編程結(jié)構(gòu)介紹基于SRAM編程技術(shù)的PLD電路結(jié)構(gòu)設(shè)計
2021-04-08 06:51:29
可重構(gòu)體系結(jié)構(gòu)分為哪幾種？典型動態(tài)可重構(gòu)系統(tǒng)結(jié)構(gòu)有哪幾種？動態(tài)可重構(gòu)系統(tǒng)有哪些應(yīng)用實例？
2021-04-28 06:13:00
系統(tǒng)運行過程中動態(tài)產(chǎn)生。重構(gòu)時系統(tǒng)可以邊重構(gòu)邊工作。這種重構(gòu)系統(tǒng)設(shè)計復(fù)雜，但靈活性大，能充分發(fā)揮出硬件運算的效率，較適合高速數(shù)字濾波器、演化計算、定制計算等方面的應(yīng)用?！ 默F(xiàn)有的可重構(gòu)系統(tǒng)組織結(jié)構(gòu)看
2011-05-27 10:24:20
結(jié)構(gòu)，上層為配置存儲器，下層是硬件邏輯層。通過上層配置信息控制硬件層門電路的通斷，改變芯片內(nèi)基本邏輯塊的布線，從而形成特定的功能。這種架構(gòu)為動態(tài)重構(gòu)技術(shù)實現(xiàn)提供了可能。一個FPGA大型數(shù)字系統(tǒng)總是由很多
2015-02-05 15:31:50
可重構(gòu)結(jié)構(gòu)是一種可以根據(jù)具體運算情況重組自身資源，實現(xiàn)硬件結(jié)構(gòu)自身優(yōu)化、自我生成的計算技術(shù)。動態(tài)可重構(gòu)技術(shù)可快速實現(xiàn)器件的邏輯重建，它的出現(xiàn)為處理大規(guī)模計算問題提供了一種兼具通用處理器靈活性
2019-07-10 07:56:06
大家好有誰對FPGA的動態(tài)可重構(gòu)有研究嗎？本人現(xiàn)在在搞這塊尋人共同探討。。。謝謝
2014-03-10 16:03:58
FPGA強大的資源和實時處理能力來快速的實現(xiàn)信號的跟蹤、鎖定和解調(diào)但是，基于硬件的實現(xiàn)方案和基于軟件的方案相比，往往存在不能迅速適應(yīng)調(diào)制樣式改變的問題。為了有效斛決這個問題，筆者通過基下FPGA部分動態(tài)町重構(gòu)技術(shù)，提出了相應(yīng)的解決方案。
2019-09-19 07:29:47
可重構(gòu)技術(shù)是指利用可重用的軟硬件資源，根據(jù)不同的應(yīng)用需求，靈活地改變自身體系結(jié)構(gòu)的設(shè)計方法。常規(guī)SRAM工藝的FPGA都可以實現(xiàn)重構(gòu)，那我們具體該怎么做呢？
2019-08-09 07:35:02
FPGA配置原理簡介基于模塊化動態(tài)部分重構(gòu)FPGA的設(shè)計方法如何去實現(xiàn)FPGA動態(tài)部分的重構(gòu)？
2021-04-29 06:33:12
的發(fā)生，不是通過調(diào)用芯片內(nèi)不同區(qū)域不同邏輯資源的組合來實現(xiàn)，而是通過對具有專門緩存邏輯資源的FPGA，進行局部和全局芯片邏輯的動態(tài)重構(gòu)而快速實現(xiàn)。
2019-09-20 07:15:52
您好，我是新手用FPGA設(shè)計可重構(gòu)硬件。我只是想了解它。誰能給我一些建議？哪些書籍文件適合我參考？網(wǎng)站或論壇也不錯。謝謝?
2020-06-11 10:05:15
FPGA強大的資源和實時處理能力來快速的實現(xiàn)信號的跟蹤、鎖定和解調(diào)但是，基于硬件的實現(xiàn)方案和基于軟件的方案相比，往往存在不能迅速適應(yīng)調(diào)制樣式改變的問題。為了有效斛決這個問題，筆者通過基下FPGA部分動態(tài)町重構(gòu)技術(shù)，提出了相應(yīng)的解決方案。
2019-09-05 07:08:02
本文討論的四種常用FPGA/CPLD設(shè)計思想與技巧：乒乓操作、串并轉(zhuǎn)換、流水線操作、數(shù)據(jù)接口同步化，都是FPGA/CPLD 邏輯設(shè)計的內(nèi)在規(guī)律的體現(xiàn)，合理地采用這些設(shè)計思想能在FPGA/CPLD設(shè)計工作種取得事半功倍的效果。
2021-04-29 06:04:14
可重構(gòu)技術(shù)具有什么優(yōu)點？怎么實現(xiàn)基于FPGA可重構(gòu)智能儀器的設(shè)計
2021-05-06 06:44:38
本文提出的通過微處理器加FPGA結(jié)合串行菊花鏈實現(xiàn)可重構(gòu)的方式，實現(xiàn)了動態(tài)可重構(gòu)FPGA結(jié)構(gòu)設(shè)計的一種應(yīng)用。
2021-05-10 06:22:19
可重構(gòu)結(jié)構(gòu)是一種可以根據(jù)具體運算情況重組自身資源，實現(xiàn)硬件結(jié)構(gòu)自身優(yōu)化、自我生成的計算技術(shù)。動態(tài)可重構(gòu)技術(shù)可快速實現(xiàn)器件的邏輯重建，它的出現(xiàn)為處理大規(guī)模計算問題提供了一種兼具通用處理器靈活性和ASIC電路高速性的解決方案。
2019-08-13 07:56:00
近年來，隨著FPGA技術(shù)的發(fā)展，支持重構(gòu)的FPGA器件新品迭現(xiàn)。Xilinx、Altera、Lattice的FPGA器件都是SRAM查找表結(jié)構(gòu)。Xilinx支持模塊化動態(tài)部分重構(gòu)的器件族有
2011-05-27 10:23:28
。在當今快速發(fā)展的市場環(huán)境條件下，產(chǎn)品是否便于現(xiàn)場升級，是否便于靈活使用無疑是產(chǎn)品能否進入市場的關(guān)鍵因素，FPGA的可重構(gòu)設(shè)計顯得尤為重要。目前，很多可重構(gòu)的設(shè)計方式都采用單片機、CPLD等器件直接
2019-07-31 07:15:40
可重構(gòu)計算技術(shù)概述隨著20世紀80年代中期Xilinx公司推出其第一款現(xiàn)場可編程門陣列(FPGA)以來,另一種實現(xiàn)手段——可重構(gòu)計算技術(shù)逐漸受到人們的重視,因為它能夠提供硬件功能的效率和軟件的可編程性,隨著可編程器件容量根據(jù)摩爾定律的不斷增大和自動設(shè)計技術(shù)的發(fā)展,可重構(gòu)技術(shù)正迅速地成熟起來。
2019-07-29 06:26:03
《Altera FPGA/CPLD設(shè)計(高級篇)》結(jié)合作者多年工作經(jīng)驗，深入地討論了Altera FPGA/CPLD的設(shè)計、優(yōu)化技巧。在討論FPGA/CPLD設(shè)計指導(dǎo)原則的基礎(chǔ)上，介紹了Altera器件的高級應(yīng)用；引領(lǐng)讀者
2009-02-12 09:19:12
4799 針對柔性化制造的要求，構(gòu)建了以DSP＋CPLD為基礎(chǔ)的數(shù)控系統(tǒng)平臺。該平臺集成度高、穩(wěn)定性強，能實現(xiàn)生產(chǎn)過程的高速度、高精度要求，實現(xiàn)了基于CPLD的可重構(gòu)設(shè)計，提高了系
2009-06-18 09:58:2523 altera fpga/cpld設(shè)計 基礎(chǔ)篇結(jié)合作者多年工作經(jīng)驗，系統(tǒng)地介紹了FPGA/CPLD的基本設(shè)計方法。在介紹FPGA/CPLD概念的基礎(chǔ)上，介紹了Altera主流FPGA/CPLD的結(jié)構(gòu)與特點，并通過豐富的實例講解
2009-07-10 17:35:4557 UART 是廣泛使用的串行數(shù)據(jù)通訊電路。本設(shè)計包含UART 發(fā)送器、接收器和波特率發(fā)生器。設(shè)計應(yīng)用EDA 技術(shù)，基于FPGA/CPLD 器件設(shè)計與實現(xiàn)UART。關(guān)鍵詞 ：FPGA/CPLD；UART；VHDLUART（即U
2009-09-29 08:01:2023 CPLD 相對于FPGA 更適合實現(xiàn)時序邏輯較少而組合邏輯相對復(fù)雜的功能，比如復(fù)雜的狀態(tài)機和譯碼電路等。CPLD 的EEPROM 編程技術(shù)不適合動態(tài)可重構(gòu)的應(yīng)用。本文針對 CPLD 的核心可編程結(jié)
2009-11-30 14:44:324 :提 出 了一種基于FPGA的動態(tài)可重構(gòu)系統(tǒng)的設(shè)計方案。該系統(tǒng)以協(xié)處理器的形式與LE ON2通用處理器構(gòu)成主/協(xié)處理器結(jié)構(gòu)，并通過寄存器與網(wǎng)絡(luò)來保存和傳遞數(shù)據(jù)流和配笠流，實
2009-11-30 15:14:328 可編程邏輯芯片特別是FPGA的快速發(fā)展，使得新的芯片能夠根據(jù)具體應(yīng)用動態(tài)地調(diào)整結(jié)構(gòu)以獲得更好的性能，這類芯片稱為動態(tài)可重構(gòu)FPGA芯片（DRFPGA）。然而，使用這類芯片構(gòu)建的
2010-01-18 08:40:3510 針對柔性化制造的要求，構(gòu)建了以DSP＋CPLD為基礎(chǔ)的數(shù)控系統(tǒng)平臺。該平臺集成度高、穩(wěn)定性強，能實現(xiàn)生產(chǎn)過程的高速度、高精度要求，實現(xiàn)了基于CPLD的可重構(gòu)設(shè)計，提高了系統(tǒng)的
2010-07-13 15:44:0213 動態(tài)可重構(gòu)系統(tǒng)的通信結(jié)構(gòu)分析
動態(tài)可重構(gòu)技術(shù)能在一定控制邏輯的驅(qū)動下，對全部或部分邏輯資源實現(xiàn)在系統(tǒng)的動態(tài)功能變換和硬
2009-03-29 15:12:52910 
CPLD，實現(xiàn)器件的動態(tài)配置；通過更換存儲器中配置文件，達到同一器件實現(xiàn)不同功能的目的。這種方法為嵌入式系統(tǒng)升通讀重構(gòu)提供了一種新的思路，將來一定會得到廣泛應(yīng)用。 關(guān)鍵詞： ISP 在系統(tǒng)可編程技術(shù) 動態(tài)配置 CPLD 引言 隨著應(yīng)用的不斷深入，嵌
2009-06-20 10:44:213034 
基于對EPCS在線編程的FPGA可重構(gòu)方法
0 引言 可重構(gòu)體系結(jié)構(gòu)已經(jīng)成為FPGA系統(tǒng)開發(fā)的研究熱點，并已有許多令人矚目的研究成果及產(chǎn)品應(yīng)用。FPGA可重構(gòu)
2009-12-08 17:22:171310 PAD在接收機動態(tài)可重構(gòu)結(jié)構(gòu)中的應(yīng)用設(shè)計
可重構(gòu)結(jié)構(gòu)是一種可以根據(jù)具體運算情況重組自身資源，實現(xiàn)硬件結(jié)構(gòu)自身優(yōu)化、自我生成的計算技術(shù)。動態(tài)可重構(gòu)技術(shù)可快
2009-12-28 09:15:32717 
基于DSP和CPLD 可重構(gòu)數(shù)控系統(tǒng)的設(shè)計與仿真
1、前言
隨著計算機技術(shù)的高速發(fā)展，各工業(yè)發(fā)達國家投入巨資，對現(xiàn)代
2010-02-09 10:52:11576 
常用FPGA/CPLD四種設(shè)計技巧
FPGA/CPLD的設(shè)計思想與技巧是一個非常大的話題，本文僅介紹一些常用的設(shè)計思想與技巧，包括乒乓球操作、串并轉(zhuǎn)換、流水線操作和數(shù)據(jù)接口
2010-05-12 11:10:43766 
本文討論的四種常用FPGA/CPLD設(shè)計思想與技巧：乒乓操作、串并轉(zhuǎn)換、流水線操作、數(shù)據(jù)接口同步化，都是FPGA/CPLD邏輯設(shè)計的內(nèi)在規(guī)律的
2010-11-04 10:11:28625 
針對重構(gòu)文件的大小、動態(tài)容錯時隙的長短、實現(xiàn)的復(fù)雜性、模塊間通信方式、冗余資源的比例與布局等關(guān)鍵問題進行了分析。并對一些突出問題,提出了基于算法和資源多級分塊的解決
2012-03-09 14:58:2528 針對調(diào)制樣式在不同環(huán)境下的變化，采用了FPGA部分動態(tài)可重構(gòu)的新方法，通過對不同調(diào)制樣式信號的解調(diào)模塊的動態(tài)加載，來實現(xiàn)了不同環(huán)境下針對不同調(diào)制樣式的解調(diào)。這種方式比傳
2012-06-18 13:42:1333 星載控制計算機的動態(tài)可重構(gòu)設(shè)計是未來天基信息系統(tǒng)衛(wèi)星載荷滿足軟件無線電設(shè)計概念的重要組成部分。本文在VxWorks操作系統(tǒng)平臺基礎(chǔ)上實現(xiàn)了星載控制計算機的動態(tài)可重構(gòu)設(shè)計。本
2013-04-16 11:03:180 FPGA和CPLD的區(qū)別，以及設(shè)計思路思想
2016-02-17 11:20:5638 基于FPGA／CPLD的UART功能設(shè)計
2017-01-23 20:45:3730 CPLD和FPGA都是我們經(jīng)常會用到的器件。有的說有配置芯片的是FPGA，沒有的是CPLD;有的說邏輯資源多的是FPGA，少的是CPLD;有的直接就不做區(qū)分，把他們都叫做FPGA。那么兩者到底有什么區(qū)別呢？下面我們就以Altera公司的CPLD和FPGA為例來說說兩者的區(qū)別。
2017-09-18 16:35:325 提出了一種FPGA 遠程動態(tài)重構(gòu)的方法，結(jié)合FPGA動態(tài)重構(gòu)技術(shù)和GSM通信技術(shù)來實現(xiàn)。利用GSM技術(shù)實現(xiàn)配置數(shù)據(jù)的無線傳輸，在單片機控制下將數(shù)據(jù)存儲于CF卡中。在內(nèi)嵌硬核微處理器
2017-11-18 13:04:261179 FPGA的不同配置電路功能，在不同時段執(zhí)行不同的算法，實現(xiàn)了虛擬硬件可重構(gòu)計算技術(shù)。這里提出的通過微處理器加FPGA結(jié)合串行菊花鏈實現(xiàn)可重構(gòu)的方式，實現(xiàn)了動態(tài)可重構(gòu)FPGA結(jié)構(gòu)設(shè)計的一種應(yīng)用。
2017-11-25 10:20:0112296 
給出了一個基于CPLD/FPGA設(shè)計的軟件模塊化LED顯示電路 ， 通過串行掃描方式驅(qū)動LED數(shù)碼管，可較少地占用可編程器件資源；并利用MAXPLUS II對動態(tài)掃描LED顯示電路進行仿真。最后
2017-11-30 14:41:3016 FPGA LAB和CPLD的LAB設(shè)計不同。CPLD LAB由宏單元構(gòu)成，包括自己的本地可編程陣列，而FPGA LAB由大量的邏輯模塊構(gòu)成，這些模塊被稱為邏輯單元，即LE，而且本地互連和邏輯分開。LE看起來可能和CPLD宏單元相似，但更容易配置，有更豐富的特性來提高性能，減少邏輯資源的浪費。
2018-04-17 17:02:001979 
CPLD和FPGA都是我們經(jīng)常會用到的器件。有的說有配置芯片的是FPGA，沒有的是CPLD;有的說邏輯資源多的是FPGA，少的是CPLD;有的直接就不做區(qū)分，把他們都叫做FPGA。那么兩者到底有什么區(qū)別呢？下面我們就以Altera公司的CPLD和FPGA為例來說說兩者的區(qū)別。
2018-05-24 02:03:0049472 
現(xiàn)代高速度FPGA運行時需將其配置數(shù)據(jù)加載到內(nèi)部SDRAM中，改變SDRAM里面的數(shù)據(jù)，可使FPGA實現(xiàn)不同的功能，即所謂的可重構(gòu)技術(shù)?？?b class="flag-6" style="color: red">重構(gòu)技術(shù)包括靜態(tài)系統(tǒng)重構(gòu)和動態(tài)系統(tǒng)重構(gòu)。在FPGA處于工作
2019-06-10 08:17:002799 
檢測系統(tǒng)的可重構(gòu)設(shè)計是檢測技術(shù)的發(fā)展方向?？?b class="flag-6" style="color: red">重構(gòu)設(shè)計是指利用可重用的軟硬件資源，根據(jù)不同的應(yīng)用需求，靈活地改變自身體系結(jié)構(gòu)的設(shè)計方法。對于檢測系統(tǒng)而言，可重構(gòu)可以分為軟件可重構(gòu)和硬件可重構(gòu)。
2018-10-20 10:40:052020 
介紹了采用CPLD和Flash器件對FPGA 實現(xiàn)快速并行配置，并給出了具體的硬件電路設(shè)計和關(guān)鍵模塊的內(nèi)部編程思路。
2018-10-24 15:15:497 在芯片架構(gòu)設(shè)計領(lǐng)域中，可重構(gòu)計算技術(shù)并非一項新的存在。20世紀60年代末，加利福尼亞大學(xué)的Geraid Estrin首次提出重構(gòu)計算，后過去二十余年，Xilinx才基于這一原型系統(tǒng)推出該技術(shù)的重要分支——FPGA架構(gòu)，正式開啟現(xiàn)代重構(gòu)計算技術(shù)。
2018-12-03 10:09:201492 FPGA 動態(tài)局部可重構(gòu)技術(shù)通常將系統(tǒng)劃分為固定模塊和可重構(gòu)模塊，可重構(gòu)模塊與其他模塊之間的通信都是通過使用特殊的總線宏實現(xiàn)的?？偩€宏的正確設(shè)計是實現(xiàn)FPGA 動態(tài)局部可重構(gòu)技術(shù)的關(guān)鍵。在研究
2018-12-14 14:27:353 本文檔詳細介紹的是FPGA教程之CPLD與FPGA的基礎(chǔ)知識說明主要內(nèi)容包括了：一、復(fù)雜可編程邏輯器件簡介二、CPLD的組成與特點三、FPGA的組成與特點四、CPLD與FPGA的異同五、主要的PLD廠商
2019-02-27 17:09:3232 應(yīng)用FPGA動態(tài)部分重構(gòu)功能使硬件設(shè)計更加靈活，可用于硬件的遠程升級、系統(tǒng)容錯和演化硬件以及通信平臺設(shè)計等。動態(tài)部分重構(gòu)可以通過兩種方法實現(xiàn)：基于模塊化設(shè)計方法（Module-Based
2020-07-29 17:10:331887 
本文主要介紹CPLD和FPGA的基本結(jié)構(gòu)。 CPLD是復(fù)雜可編程邏輯器件（Complex Programable Logic Device）的簡稱，FPGA是現(xiàn)場可編程門陣列（Field
2020-09-25 14:56:3312233 
一種基于FPGA動態(tài)可重構(gòu)的圖像融合算法。該方法對小波分解后的圖像低頻子帶采用平均融合算子處理，在高頻子帶的融合中依據(jù)小波系數(shù)樹狀結(jié)構(gòu)特點，提出了一種新的自適應(yīng)融合方法，最后經(jīng)過小波逆變換得到融合
2021-02-02 17:12:598 CPLD/FPGA的基本知識講解。
2021-03-30 09:55:1827 術(shù)語“重構(gòu)”是指FPGA已經(jīng)配置后的重新編程。FPGA的重構(gòu)有兩種類型：完全的和部分的。完全重構(gòu)將整個FPGA重新編程，而部分重構(gòu)只取代設(shè)計的一部分，設(shè)計的剩下部分仍正常工作。部分重構(gòu)不被視為完全
2021-07-02 17:39:582256 所謂FPGA動態(tài)可重構(gòu)技術(shù)，就是要對基于SRAM編程技術(shù)的FPGA實現(xiàn)全部或部分邏輯資源的動態(tài)功能變換。根據(jù)實現(xiàn)重構(gòu)的面積不同，動態(tài)可重構(gòu)技術(shù)又可分為全局重構(gòu)和局部重構(gòu)。
2021-07-05 15:41:292600 
Altera FPGA CPLD學(xué)習(xí)筆記(肇慶理士電源技術(shù)有限)-Altera FPGA CPLD學(xué)習(xí)筆記? ? ? ? ? ? ? ? ?
2021-09-18 10:54:4179 FPGA CPLD數(shù)字電路設(shè)計經(jīng)驗分享.(電源技術(shù)發(fā)展怎么樣)-FPGA CPLD數(shù)字電路設(shè)計經(jīng)驗分享? ? ? ? ? ? ? ? ? ??
2021-09-18 10:58:0351 FPGA CPLD中的Verilog設(shè)計小技巧(肇慶理士電源技術(shù)有限)-FPGA CPLD中的Verilog設(shè)計小技巧? ? ? ? ? ? ? ? ?
2021-09-18 16:49:1835 術(shù)語“重構(gòu)”是指FPGA已經(jīng)配置后的重新編程。FPGA的重構(gòu)有兩種類型：完全的和部分的。完全重構(gòu)將整個FPGA重新編程，而部分重構(gòu)只取代設(shè)計的一部分，設(shè)計的剩下部分仍正常工作。
2022-03-15 17:06:251925 FPGA芯片本身就具有可以反復(fù)擦寫的特性，允許FPGA開發(fā)者編寫不同的代碼進行重復(fù)編程，而FPGA可重構(gòu)技術(shù)正是在這個特性之上，采用分時復(fù)用的模式讓不同任務(wù)功能的Bitstream文件使用FPGA芯片內(nèi)部的各種邏輯資源
2022-04-26 10:38:542872 FPGA上的可重構(gòu)技術(shù)根據(jù)FPGA芯片內(nèi)部的不同結(jié)構(gòu)可以分為兩種，分別是動態(tài)可重構(gòu)和靜態(tài)可重構(gòu)。
2022-11-03 20:09:39757 都是FPGA/CPLD邏輯設(shè)計的內(nèi)在規(guī)律的體現(xiàn)，合理地采用這些設(shè)計思想能在FPGA/CPLD設(shè)計工作種取得事半功倍的效果。
2023-05-18 08:56:57350 
CPLD和FPGA都是由邏輯陣列模塊構(gòu)成的，但是CPLD的LAB基于乘積和宏單元，而FPGA的LAB使用基于LUT的邏輯單元。
2023-06-28 11:28:04862 
可編程邏輯包括 PAL、GAL、PLD 等。通過不斷發(fā)展，它已經(jīng)發(fā)展成為現(xiàn)在的CPLD/FPGA。CPLD（復(fù)雜可編程邏輯器件）和FPGA（現(xiàn)場可編程門陣列）的功能基本相同，只是實現(xiàn)原理略有不同
2023-07-03 14:33:386041 
FPGA可重構(gòu)技術(shù)就是通過上位機控制在FPGA運行過程中加載不同的Bitstream文件，FPGA芯片根據(jù)文件內(nèi)的不同邏輯將內(nèi)部的資源全部或部分進行重新配置以達到多種功能任務(wù)動態(tài)切換的目標，從而提高了使用FPGA進行開發(fā)的靈活度。
2023-08-04 10:08:05381
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