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電子發(fā)燒友網(wǎng)>電子資料下載>通信網(wǎng)絡>基于Interlaken協(xié)議的高速數(shù)據(jù)流接口設計

基于Interlaken協(xié)議的高速數(shù)據(jù)流接口設計

2011-07-13 | pdf | 817 KB | 次下載 | 免費

資料介紹

目前,高速網(wǎng)絡處理系統(tǒng)的板級互連帶寬達到了40 G比特速率級,這對網(wǎng)絡處理系統(tǒng)的處理速度和吞吐量提出了極大的挑戰(zhàn)。為解決核心路由器40 Gb/s POS線路接口板中器件間的高速數(shù)據(jù)交互難題,采用Interlaken協(xié)議對高速數(shù)據(jù)流接口設計方法進行了研究,利用高端FPGA的高速通道和IP核設計技術,完成了鏈路層處理芯片與轉發(fā)、處理FPGA之間數(shù)據(jù)包的高速互聯(lián),系統(tǒng)設計8個高速通道,每通道速率達到6.25 Gb/s。測試結果表明,在相應的Interlaken IP突發(fā)配置參數(shù)下性能可以滿足系統(tǒng)40 Gb/s吞吐率的要求,并就不同應用場景中IP核關鍵參數(shù)與控制寄存器的自適應、動態(tài)可重構配置進行了展望。

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