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發(fā)視頻基于MCU+FPGA雙系統(tǒng)架構(gòu)下的直接數(shù)字頻率合成技術(shù)設(shè)計(jì)
2010-11-06 |
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資料介紹
介紹了DDS 技術(shù)在MCU+FPGA 雙系統(tǒng)的一種實(shí)現(xiàn)方法, 重點(diǎn)介紹了MCU 的控制系統(tǒng)設(shè)計(jì)與現(xiàn)場(chǎng)可編程邏輯門(mén)陣列FPGA 實(shí)現(xiàn)直接數(shù)字頻率合成的原理及其電路結(jié)構(gòu), 并給出了利用ALTERA 公司的Flex10K 系列EPF10K10LC84- 4 設(shè)計(jì)實(shí)現(xiàn)方案。
DDS 技術(shù)在相對(duì)帶寬、頻率轉(zhuǎn)換時(shí)間、相位連續(xù)性、高分辨率以及集成化等一系列性能指標(biāo)方面已遠(yuǎn)遠(yuǎn)超過(guò)了傳統(tǒng)頻率合成技術(shù)。當(dāng)DDS 中的累加器的位數(shù)N 很大時(shí)，最低輸出頻率可達(dá)Hz、mHz 乃至μHz。如果fc 為100MHz，那么當(dāng)N 為40 位時(shí)，其分辨率可達(dá)90μHz。轉(zhuǎn)換時(shí)間最快可達(dá)10ns 的量級(jí)，這都是傳統(tǒng)頻率合成所不能比擬的。
DDS 技術(shù)在相對(duì)帶寬、頻率轉(zhuǎn)換時(shí)間、相位連續(xù)性、高分辨率以及集成化等一系列性能指標(biāo)方面已遠(yuǎn)遠(yuǎn)超過(guò)了傳統(tǒng)頻率合成技術(shù)。當(dāng)DDS 中的累加器的位數(shù)N 很大時(shí)，最低輸出頻率可達(dá)Hz、mHz 乃至μHz。如果fc 為100MHz，那么當(dāng)N 為40 位時(shí)，其分辨率可達(dá)90μHz。轉(zhuǎn)換時(shí)間最快可達(dá)10ns 的量級(jí)，這都是傳統(tǒng)頻率合成所不能比擬的。
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