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      電子發(fā)燒友網(wǎng)>電子資料下載>電子資料>HDLC協(xié)議IP核的設(shè)計(jì)與實(shí)現(xiàn)

      HDLC協(xié)議IP核的設(shè)計(jì)與實(shí)現(xiàn)

      2023-11-08 | pdf | 未知 | 次下載 | 免費(fèi)

      資料介紹

      簡(jiǎn)介：文中針對(duì)專用ASIC 芯片實(shí)現(xiàn)HDLC 協(xié)議針對(duì)性強(qiáng)，使用不靈活等特點(diǎn)，提出了使用FPGA IP 核來(lái)實(shí)現(xiàn)HDLC 接口的設(shè)計(jì)方案。HDLC IP 核包括3 個(gè)模塊：對(duì)外接口模塊、接收模塊和發(fā)送模塊。IP 核接收到新數(shù)據(jù)后存入接收FIFO，對(duì)外接口模塊將接收到的數(shù)據(jù)通過(guò)總線將數(shù)據(jù)送入數(shù)據(jù)處理單元；當(dāng)需要發(fā)送數(shù)據(jù)時(shí)數(shù)據(jù)處理單元通過(guò)總線將數(shù)據(jù)存入發(fā)送FIFO，啟動(dòng)發(fā)送模塊將數(shù)據(jù)送出。接收和發(fā)送模塊自動(dòng)完成數(shù)據(jù)的" 插零" 及" 刪零"操作。仿真結(jié)果表明該IP 核能夠正確的接收和發(fā)送數(shù)據(jù)。該方法已在某雷達(dá)天線的同步引導(dǎo)數(shù)據(jù)的收發(fā)通信鏈路中，成功實(shí)現(xiàn)了雙向數(shù)據(jù)通信。
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