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      電子發(fā)燒友網(wǎng)>電子資料下載>電子資料>基于CPLD的片內(nèi)振蕩器嵌入式設(shè)計方案

      基于CPLD的片內(nèi)振蕩器嵌入式設(shè)計方案

      2023-11-09 | pdf | 未知 | 次下載 | 免費(fèi)

      資料介紹

      　　在絕大部分?jǐn)?shù)字系統(tǒng)設(shè)計中，時鐘是不可或缺的部分，通常采用外接有源或者無源振蕩器來提供時鐘信號。外接時鐘的優(yōu)點(diǎn)是性能穩(wěn)定，設(shè)計簡便；缺點(diǎn)是會增加電路板面積，而且高頻設(shè)計時對電路板布線和加工的要求比較嚴(yán)格，可能增加系統(tǒng)成本和設(shè)計難度。基于可編程邏輯器件FPGA／CPLD的設(shè)計提供了另外一種選擇，即采用片內(nèi)的可編程資源實(shí)現(xiàn)振蕩器功能。這種設(shè)計可以將振蕩部分同時集成到FPGA／CPLD中，減少了外部資源的使用。

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