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      標(biāo)簽　>　ise

      ise

      +關(guān)注1人關(guān)注

      ISE是成都工投電子設(shè)備有限公司的簡(jiǎn)稱(chēng)，由成都工投電子新材料有限公司和韓國(guó)GAT株式會(huì)社共同投資設(shè)立的高科技公司，位于成都市新都區(qū)泰興鎮(zhèn)白云路789號(hào)。

      文章：49個(gè) 瀏覽：36432次 帖子：720個(gè)

      ise技術(shù)

      Vivado與ISE同時(shí)運(yùn)行出現(xiàn)的奇怪現(xiàn)象

      近幾天調(diào)試開(kāi)發(fā)板，主芯片是XC7A100T，用Vivado給開(kāi)發(fā)板下載bit文件，正常工作。

      2023-12-04 標(biāo)簽：FlaShISEVivado 912 0

      ISE和Modelsim安裝破解教程

      ISE和Modelsim安裝破解教程

      工欲善其事必先利其器，本期我們講解工具軟件的安裝和破解（提示：本教程方法僅限于學(xué)習(xí)交流，請(qǐng)勿他用）

      2023-07-27 標(biāo)簽：fpgaXilinxModelSim 2.6萬(wàn) 0

      ISE工程升級(jí)到Vivado及板級(jí)信號(hào)調(diào)試

      版本遷移的操作想必大家已經(jīng)做過(guò)不少了，其中包括從ISE轉(zhuǎn)換到vivado與vivado老版本遷移到新版本。鄭智海同學(xué)給大家介紹了一下如何把工程從ISE遷...

      2023-01-30 標(biāo)簽：信號(hào)調(diào)試ISE 4151 0

      介紹一種ISE聯(lián)合仿真轉(zhuǎn)換為Moldelsim單獨(dú)仿真的方法

      找到仿真頂層的tb文件，cut_through_top_tb。

      2023-01-29 標(biāo)簽：FPGA設(shè)計(jì)asicModelSim 1480 0

      常用時(shí)序約束介紹之基于ISE的UCF文件語(yǔ)法

      時(shí)序約束是我們對(duì)FPGA設(shè)計(jì)的要求和期望，例如，我們希望FPGA設(shè)計(jì)可以工作在多快的時(shí)鐘頻率下等等。因此，在時(shí)序分析工具開(kāi)始對(duì)我們的FPGA設(shè)計(jì)進(jìn)行時(shí)序...

      2022-12-28 標(biāo)簽：fpga時(shí)序分析ISE 2891 0

      Vivado下載程序步驟和ISE差異問(wèn)題

      Vivado下載程序步驟和ISE差異問(wèn)題

      由于Vivado下載程序步驟和ISE有較大差異，特此寫(xiě)此文章，希望對(duì)大家有所幫助。 1，下載文件生成 在.bit文件生成后，在TCL中輸入 write_...

      2021-01-02 標(biāo)簽：fpgaISEVivado 7128 0

      Vivado/ISE中不同類(lèi)型的許可證時(shí)常放的錯(cuò)誤解析

      BY Anatoli Curran 在 Vivado/ISE 中遇到許可問(wèn)題時(shí)，該怎么辦呢？ 本文介紹了使用不同類(lèi)型的許可證時(shí)可能遇到的不同問(wèn)題。您可單...

      2020-11-18 標(biāo)簽：Linux服務(wù)器ISE 3063 0

      ISE設(shè)計(jì)流程簡(jiǎn)介--華清遠(yuǎn)見(jiàn)fpga培訓(xùn)視頻教程

      本視頻教程主要主要介紹Xilinx公司開(kāi)發(fā)設(shè)計(jì)流程中的各個(gè)功能模塊，包括ISE中的設(shè)計(jì)輸入，綜合，設(shè)計(jì)實(shí)現(xiàn)及驗(yàn)證等內(nèi)容，此專(zhuān)題將為廣大FPGA工程師深入...

      2018-06-08 標(biāo)簽：fpgaXilinxeda 5087 0

      利用 ISE Design Suite 11 內(nèi)的 Base System Builder

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      本視頻介紹了 Base System Builder（BSB）如何能夠創(chuàng)建用于 Xilinx FPGA 設(shè)計(jì)的嵌入式處理器子系統(tǒng)。

      2018-06-04 標(biāo)簽：處理器fpga嵌入式 3692 0

      xilinx sp605 PCIe EDK使用方法（之一：EDK設(shè)置部分）視頻教程

      在EDK環(huán)境中針對(duì)在xilinx sp605 PCIe開(kāi)發(fā)板，舉一個(gè)簡(jiǎn)單的例子，介紹如何使用PCIE核與PC進(jìn)行數(shù)據(jù)通訊。

      2018-06-07 標(biāo)簽：fpgaXilinxPCIe 5660 0

      ise設(shè)計(jì)流程視頻教程

      xilinx的ise的使用流程，簡(jiǎn)單介紹

      2018-06-06 標(biāo)簽：fpgaXilinxPCIe 3631 0

      利用 ISE 和 System Generator for DSP 10.1 提高 DSP 設(shè)計(jì)生產(chǎn)率

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      本視頻產(chǎn)品演示介紹了 Xilinx 系統(tǒng)生成器（System Generator）和 Xilinx ISE? 項(xiàng)目瀏覽器（Project Navigat...

      2018-06-06 標(biāo)簽：dspXilinxISE 3247 0

      演示如何使用ISE開(kāi)發(fā)FPGA項(xiàng)目（1）視頻教程

      作為一個(gè)初學(xué)者，有的時(shí)候很難弄清楚ISE如何使用，本視頻教程以一種最簡(jiǎn)單的方式展示如何使用ISE來(lái)開(kāi)發(fā)一個(gè)XILINX FPGA工程。由于錄屏的原因，本...

      2018-06-06 標(biāo)簽：fpgaXilinxPCIe 6355 0

      ISE設(shè)計(jì)流程簡(jiǎn)介--華清遠(yuǎn)見(jiàn)fpga培訓(xùn)視頻教程

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      2018-06-06 標(biāo)簽：fpgaXilinxeda 4193 0

      Xilinx DSP解決方案- SysGen 8.1視頻教程

      我們將一起從頭至尾復(fù)習(xí)一遍Xilinx DSP的整個(gè)設(shè)計(jì)流程。其中將討論各種設(shè)計(jì)技巧，包括黑盒子，HDL協(xié)同仿真，硬件協(xié)同仿真。看過(guò)下面的演示，您在半個(gè)...

      2018-06-06 標(biāo)簽：dspfpgaXilinx 3925 0

      ISE約束導(dǎo)入vivado總共分幾步

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      最近有些朋友在ISE中做的V7項(xiàng)目需要切換到vivado來(lái)，但導(dǎo)入代碼后，導(dǎo)入約束時(shí)，發(fā)現(xiàn)vivado不再支持UCF文件，如果手抄UCF約束到 VIVA...

      2017-03-24 標(biāo)簽：ISEvivado 8824 0

      FPGA實(shí)戰(zhàn)開(kāi)發(fā)技巧（4）

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      在代碼編寫(xiě)完畢后，需要借助于測(cè)試平臺(tái)來(lái)驗(yàn)證所設(shè)計(jì)的模塊是否滿(mǎn)足要求。ISE 提供了兩種測(cè)試平臺(tái)的建立方法，一種是使用HDL Bencher 的圖形化波形...

      2017-02-11 標(biāo)簽：FPGAISE 917 0

      在ISE啟動(dòng)modelsim時(shí)遇到問(wèn)題與解決

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      1。我在ISE中啟動(dòng)modelsim時(shí)出現(xiàn)了下面的錯(cuò)誤 Loading work.tb_ic1_func # ** Error: (vsim-19) F...

      2017-02-11 標(biāo)簽：modelsimISE 9911 0

      ISE中下載Xilinx的bit文件失敗時(shí)的處理方案

      在使用ISE進(jìn)行FPGA的bit文件下載時(shí)，經(jīng)常會(huì)遇到下載失敗的問(wèn)題，提示："DONE did not go high".

      2017-02-11 標(biāo)簽：FPGAXilinxISE 6361 0

      ISE設(shè)計(jì)有關(guān)疑難問(wèn)題與解決連載之綜合warning解決辦法

      狀態(tài)機(jī)中沒(méi)有將所有條件都寫(xiě)齊，或狀態(tài)機(jī)中的輸出沒(méi)初始化。

      2017-02-11 標(biāo)簽：賽靈思狀態(tài)機(jī)ISE 3370 0

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      • Protues
        Protues
        +關(guān)注
        Proteus軟件是英國(guó)Lab Center Electronics公司出版的EDA工具軟件（該軟件中國(guó)總代理為廣州風(fēng)標(biāo)電子技術(shù)有限公司）。它不僅具有其它EDA工具軟件的仿真功能，還能仿真單片機(jī)及外圍器件。
      • 靜電防護(hù)
        靜電防護(hù)
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        為防止靜電積累所引起的人身電擊、火災(zāi)和爆炸、電子器件失效和損壞，以及對(duì)生產(chǎn)的不良影響而采取的防范措施。其防范原則主要是抑制靜電的產(chǎn)生，加速靜電泄漏，進(jìn)行靜電中和等。
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        Altium Designer
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      • FPGA芯片
        FPGA芯片
        +關(guān)注
        FPGA（Field－Programmable Gate Array），即現(xiàn)場(chǎng)可編程門(mén)陣列，它是在PAL、GAL、CPLD等可編程器件的基礎(chǔ)上進(jìn)一步發(fā)展的產(chǎn)物。
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        ArduBlock
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        ArduBlock軟件是Arduino官方編程環(huán)境的第三方軟件，目前必須依附于Arduino軟件下運(yùn)行，區(qū)別于Arduino文本式編程環(huán)境，ArduBlock是以圖形化積木搭建的方式編程的，這樣的方式會(huì)使編程的可視化和交互性加強(qiáng)，編程門(mén)檻降低，即使沒(méi)有編程經(jīng)驗(yàn)的人也可以嘗試給Arduino控制器編寫(xiě)程序。
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      • 識(shí)別
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        +關(guān)注
      • FPGA開(kāi)發(fā)板
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        +關(guān)注
        FPGA開(kāi)發(fā)板在基于MCU、定制ASIC和體積龐大的電線(xiàn)束來(lái)實(shí)現(xiàn)引擎及控制電子的系統(tǒng)方案已發(fā)展至接近其技術(shù)和應(yīng)用極限，汽車(chē)工業(yè)正面臨新的設(shè)計(jì)挑戰(zhàn)。過(guò)去汽車(chē)電子產(chǎn)品的開(kāi)發(fā)周期是漫長(zhǎng)的，而許多汽車(chē)制造商現(xiàn)正致力于在更短的時(shí)間內(nèi)，裝備消費(fèi)者所需的新一代汽車(chē)。
      • PCB封裝
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        pcb封裝就是把 實(shí)際的電子元器件，芯片等的各種參數(shù)（比如元器件的大小，長(zhǎng)寬，直插，貼片，焊盤(pán)的大小，管腳的長(zhǎng)寬，管腳的間距等）用圖形方式表現(xiàn)出來(lái)，以便可以在畫(huà)pcb圖時(shí)進(jìn)行調(diào)用。
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        Quartus II 是Altera公司推出的綜合性CPLD/FPGA開(kāi)發(fā)軟件，軟件支持原理圖、VHDL、VerilogHDL以及AHDL（Altera Hardware 支持Description Language）等多種設(shè)計(jì)輸入形式，內(nèi)嵌自有的綜合器以及仿真器，可以完成從設(shè)計(jì)輸入到硬件配置的完整PLD設(shè)計(jì)流程。
      • PCB封裝庫(kù)
        PCB封裝庫(kù)
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        語(yǔ)音交互
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        AD09
        +關(guān)注
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        PDN
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        QuickPcb
        +關(guān)注
      • Artix-7
        Artix-7
        +關(guān)注
        　　Artix-7 系列：相對(duì)于 Spartan-6 系列而言，Artix-7 系列功耗降低了一半， 成本降低了 35%，采用小型化封裝、統(tǒng)一的 Virtex 系列架構(gòu)，能滿(mǎn)足低成本大批量市場(chǎng)的性能要求，這也正是此前 ASSP、ASIC 和低成本 FPGA 所針對(duì)的市場(chǎng)領(lǐng)域。
      • VHDL代碼
        VHDL代碼
        +關(guān)注
      • Protel 99 se
        Protel 99 se
        +關(guān)注
      • powerlink
        powerlink
        +關(guān)注
      • candence
        candence
        +關(guān)注
      • 面包板
        面包板
        +關(guān)注
        面包板是由于板子上有很多小插孔，專(zhuān)為電子電路的無(wú)焊接實(shí)驗(yàn)設(shè)計(jì)制造的。由于各種電子元器件可根據(jù)需要隨意插入或拔出，免去了焊接，節(jié)省了電路的組裝時(shí)間，而且元件可以重復(fù)使用，所以非常適合電子電路的組裝、調(diào)試和訓(xùn)練。
      • 特性阻抗
        特性阻抗
        +關(guān)注
        特性阻抗又稱(chēng)特征阻抗，它不是直流電阻，屬于長(zhǎng)線(xiàn)傳輸中的概念。特性阻抗是射頻傳輸線(xiàn)影響無(wú)線(xiàn)電波電壓、電流的幅值和相位變化的固有特性，等于各處的電壓與電流的比值，用V/I表示。在射頻電路中，電阻、電容、電感都會(huì)阻礙交變電流的流動(dòng)，合稱(chēng)阻抗。電阻是吸收電磁能量的，理想電容和電感不消耗電磁能量。
      • AXI
        AXI
        +關(guān)注
        AXI是一種總線(xiàn)協(xié)議，該協(xié)議是ARM公司提出的AMBA3.0協(xié)議中最重要的部分，是一種面向高性能、高帶寬、低延遲的片內(nèi)總線(xiàn)。它的地址/控制和數(shù)據(jù)相位是分離的，支持不對(duì)齊的數(shù)據(jù)傳輸，同時(shí)在突發(fā)傳輸中，只需要首地址，同時(shí)分離的讀寫(xiě)數(shù)據(jù)通道、并支持Outstanding傳輸訪問(wèn)和亂序訪問(wèn)，并更加容易進(jìn)行時(shí)序收斂。AXI是AMBA中一個(gè)新的高性能協(xié)議。
      • 驅(qū)動(dòng)電流
        驅(qū)動(dòng)電流
        +關(guān)注
      • 時(shí)鐘源
        時(shí)鐘源
        +關(guān)注
        時(shí)鐘源用來(lái)為環(huán)形脈沖發(fā)生器提供頻率穩(wěn)定且電平匹配的方波時(shí)鐘脈沖信號(hào)。它通常由石英 晶體振蕩器和與非門(mén)組成的正反饋振蕩電路組成，其輸出送至環(huán)形脈沖發(fā)生器。
      • FPGA教程
        FPGA教程
        +關(guān)注
      • Kintex-7
        Kintex-7
        +關(guān)注
        　　Kintex-7系列：Kintex-7 系列是一種新型 FPGA，能以不到 Virtex-6 系列一半的價(jià)格實(shí)現(xiàn)與其相當(dāng)性能，性?xún)r(jià)比提高了一倍，功耗降低了一半。
      • AD采樣
        AD采樣
        +關(guān)注
        　　AD轉(zhuǎn)換采樣頻率指完成一次從模擬轉(zhuǎn)換到數(shù)字的AD轉(zhuǎn)換所需時(shí)間的倒數(shù)，模擬量可以是電壓、電流等電信號(hào)，也可以是壓力、溫度、濕度、位移、聲音等非電信號(hào)；而AD分辨率指數(shù)字量變化一個(gè)最小量時(shí)模擬信號(hào)的變化量。
      • 紅外觸摸屏
        紅外觸摸屏
        +關(guān)注
      • Protel DXP
        Protel DXP
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      七只翅膀

      編輯推薦廠商產(chǎn)品技術(shù)軟件/工具OS/語(yǔ)言教程專(zhuān)題

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      振蕩器 諧振器 濾波器 電容器 電感器 電阻器 二極管 晶體管
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      5G m2m DSP MCU ASIC CPU ROM DRAM
      NB-IoT LoRa Zigbee NFC 藍(lán)牙 RFID Wi-Fi SIGFOX
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