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AXI是一種總線協(xié)議，該協(xié)議是ARM公司提出的AMBA3.0協(xié)議中最重要的部分，是一種面向高性能、高帶寬、低延遲的片內(nèi)總線。它的地址/控制和數(shù)據(jù)相位是分離的，支持不對(duì)齊的數(shù)據(jù)傳輸，同時(shí)在突發(fā)傳輸中，只需要首地址，同時(shí)分離的讀寫數(shù)據(jù)通道、并支持Outstanding傳輸訪問(wèn)和亂序訪問(wèn)，并更加容易進(jìn)行時(shí)序收斂。AXI是AMBA中一個(gè)新的高性能協(xié)議。

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AXI VIP設(shè)計(jì)示例 AXI接口傳輸分析

賽靈思 AXI Verification IP (AXI VIP) 是支持用戶對(duì) AXI4 和 AXI4-Lite 進(jìn)行仿真的 IP。它還可作為 AXI...

2022-07-08 標(biāo)簽：接口賽靈思仿真 1720 0

PS和PL之間連接的技術(shù)

上面兩種均采用內(nèi)存映射控制方式，即 ARM 將用戶自定義 IP 編入某一地址進(jìn)行訪問(wèn)，讀寫時(shí)就像在讀寫自己的片內(nèi) RAM，編程也很方便，開發(fā)難度較低。代...

2022-07-07 標(biāo)簽：處理器數(shù)據(jù)傳輸 AXI 3602 0

ZYNQ數(shù)據(jù)交互通路PS和PL的連接技術(shù)

ZYNQ作為首款將高性能ARMCortex-A系列處理器與高性能FPGA在單芯片內(nèi)緊密結(jié)合的產(chǎn)品，為了實(shí)現(xiàn)ARM處理器和FPGA之間的高速通信和數(shù)據(jù)交互...

2022-07-07 標(biāo)簽：fpga 接口 AXI 3990 0

一般涉及DDR讀寫仲裁的控制邏輯需要注意哪些方面

基于vivado2020.1和zcu102開發(fā)板(rev1.1)開發(fā)項(xiàng)目，工程涉及DDR4(MIG)和PL端多個(gè)讀寫接口交互的問(wèn)題，通過(guò)AXI inte...

2022-06-15 標(biāo)簽：DDR 阻塞 AXI 1934 0

一文詳解高級(jí)可擴(kuò)展接口

AXI協(xié)議最初是為高頻系統(tǒng)設(shè)計(jì)的，旨在滿足各種組件的接口要求，同時(shí)允許這些組件的互連方式具有靈活性。適用于高頻、低延遲設(shè)計(jì)，AXI 保持與之前 AMBA...

2022-04-28 標(biāo)簽：接口 AXI 2708 0

AXI總線知識(shí)點(diǎn)快速學(xué)習(xí)

AXI——Advanced eXtensible Interface，直譯過(guò)來(lái)就是先進(jìn)的可擴(kuò)展接口，是由ARM公司提出的，是一種高性能、高帶寬、低延遲的...

2022-03-14 標(biāo)簽：總線 AXI 5947 0

ZYNQ SOC案例開發(fā)：AXI DMA使用解析及環(huán)路測(cè)試

一、AXI DMA介紹本篇博文講述AXI DMA的一些使用總結(jié)，硬件IP子系統(tǒng)搭建與SDK C代碼封裝參考米聯(lián)客ZYNQ教程。若想讓ZYNQ的PS與P...

2020-12-31 標(biāo)簽：寄存器 cpu 數(shù)據(jù)傳輸 8400 0

ZYNQ跑系統(tǒng)系列開發(fā)：AXI-DMA的linux驅(qū)動(dòng)案例

一、搭建硬件環(huán)境 vivado版本2017.4，芯片為7010，不過(guò)不管什么版本和芯片大致步驟是一樣的本文工程文件： https://gitee.co...

2021-01-02 標(biāo)簽：Linux Zynq AXI 9207 0

PCIE通信技術(shù)：通過(guò)AXI-Lite ip配置的VDMA使用

XDMA是Xilinx封裝好的PCIE DMA傳輸IP，可以很方便的把PCIE總線上的數(shù)據(jù)傳輸事務(wù)映射到AXI總線上面，實(shí)現(xiàn)上位機(jī)直接對(duì)AXI總線進(jìn)行讀...

2020-12-28 標(biāo)簽：Xilinx PCIe AXI 3131 0

ARM+FPGA開發(fā)：基于AXI總線的GPIO IP創(chuàng)建

FPGA+ARM是ZYNQ的特點(diǎn)，那么PL部分怎么和ARM通信呢，依靠的就是AXI總線。這個(gè)實(shí)驗(yàn)是創(chuàng)建一個(gè)基于AXI總線的GPIO IP，利用PL的資源...

2020-12-25 標(biāo)簽：Xilinx AXI 5554 0

基于AXI總線的加法器模塊解決方案

前面一節(jié)我們學(xué)會(huì)了創(chuàng)建基于AXI總線的IP，但是對(duì)于AXI協(xié)議各信號(hào)的時(shí)序還不太了解。這個(gè)實(shí)驗(yàn)就是通過(guò)SDK和Vivado聯(lián)合調(diào)試觀察AXI總線的信號(hào)。...

2020-12-23 標(biāo)簽：加法器 AXI Vivado 2506 0

VCU視頻編解碼設(shè)計(jì)案例介紹

VCU 模塊在PL側(cè)，一共有五個(gè)AXI接口，它們分別是兩個(gè) Encoder AXI，兩個(gè) Decoder AXI，和一個(gè) MCU AXI。

2020-11-30 標(biāo)簽：mcu 視頻編解碼 AXI 4247 0

zynq中AXI4的五種互聯(lián)結(jié)構(gòu)介紹

互聯(lián)結(jié)構(gòu)包括直通模式、只轉(zhuǎn)換模式、N-1互聯(lián)模式、N-M互聯(lián)模式。 1. 直通模式當(dāng)只有一個(gè)主設(shè)備和一個(gè)從設(shè)備使用AXI互聯(lián)時(shí)，AXI互聯(lián)不執(zhí)行任何轉(zhuǎn)...

2020-11-16 標(biāo)簽：Zynq AXI 存儲(chǔ)器控制器 3480 0

Zynq中AXI4-Lite和AXI-Stream功能介紹

Zynq中AXI4-Lite功能 AXI4-Lite接口是AXI4的子集，專用于和元器件內(nèi)的控制寄存器進(jìn)行通信。AXI-Lite允許構(gòu)建簡(jiǎn)單的元件接口。...

2020-09-27 標(biāo)簽：Zynq AXI AXI4 8772 0

如何設(shè)計(jì)高效PL和PS數(shù)據(jù)交互通路的AXI接口

AXI 協(xié)議主要描述了主設(shè)備和從設(shè)備之間的數(shù)據(jù)傳輸方式，主設(shè)備和從設(shè)備之間通過(guò)握手信號(hào)建立連接。當(dāng)從設(shè)備準(zhǔn)備好接收數(shù)據(jù)時(shí)，會(huì)發(fā)出 READY 信號(hào)。

2020-11-13 標(biāo)簽：arm Zynq AXI 5625 0

何謂 AXI？關(guān)于AXI3/AXI4的相關(guān)基礎(chǔ)知識(shí)

引言近來(lái)，幾乎每個(gè)賽靈思 IP 都使用 AXI 接口。Zynq、Zynq MP、MicroBlaze 和全新的 Versal 處理器都無(wú)一例外使用 A...

2020-09-27 標(biāo)簽：賽靈思 AXI AXI4 6521 0

自制RISC-V源碼與設(shè)計(jì)流程案例分析

Overlay 簡(jiǎn)介 RISC-V-On-PYNQ Overlay實(shí)現(xiàn)了在PYNQ-Z2板上的RISC-V處理器及工具鏈集成，并提供了完整的RISC-V...

2020-11-08 標(biāo)簽：Xilinx AXI 內(nèi)存控制器 6456 0

如何創(chuàng)建AXI CDMA Linux用戶空間示例應(yīng)用

本篇博文將為您演示如何創(chuàng)建 AXI CDMA Linux 用戶空間示例應(yīng)用。示例設(shè)計(jì)將在 Zynq UltraScale+ RFSoC ZCU111 ...

2020-09-28 標(biāo)簽：Linux Xilinx AXI 2491 0

FPGA程序設(shè)計(jì)：如何封裝AXI_SLAVE接口IP

在FPGA程序設(shè)計(jì)的很多情形都會(huì)使用到AXI接口總線，以PCIe的XDMA應(yīng)用為例，XDMA有兩個(gè)AXI接口，分別是AXI4 Master類型接口和AX...

2020-10-30 標(biāo)簽：fpga AXI 4336 0

AXI接口協(xié)議的類型和特征

AXI全稱Advanced eXtensibleInterface，是Xilinx從6系列的FPGA開始引入的一種接口協(xié)議，主要描述了主設(shè)備和從設(shè)備之間...

2020-09-23 標(biāo)簽：接口協(xié)議 AXI 4765 0

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Protues

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Proteus軟件是英國(guó)Lab Center Electronics公司出版的EDA工具軟件（該軟件中國(guó)總代理為廣州風(fēng)標(biāo)電子技術(shù)有限公司）。它不僅具有其它EDA工具軟件的仿真功能，還能仿真單片機(jī)及外圍器件。
靜電防護(hù)

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+關(guān)注

為防止靜電積累所引起的人身電擊、火災(zāi)和爆炸、電子器件失效和損壞，以及對(duì)生產(chǎn)的不良影響而采取的防范措施。其防范原則主要是抑制靜電的產(chǎn)生，加速靜電泄漏，進(jìn)行靜電中和等。
Altium Designer

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FPGA芯片

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FPGA（Field－Programmable Gate Array），即現(xiàn)場(chǎng)可編程門陣列，它是在PAL、GAL、CPLD等可編程器件的基礎(chǔ)上進(jìn)一步發(fā)展的產(chǎn)物。
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ArduBlock軟件是Arduino官方編程環(huán)境的第三方軟件，目前必須依附于Arduino軟件下運(yùn)行，區(qū)別于Arduino文本式編程環(huán)境，ArduBlock是以圖形化積木搭建的方式編程的，這樣的方式會(huì)使編程的可視化和交互性加強(qiáng)，編程門檻降低，即使沒(méi)有編程經(jīng)驗(yàn)的人也可以嘗試給Arduino控制器編寫程序。
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FPGA開發(fā)板在基于MCU、定制ASIC和體積龐大的電線束來(lái)實(shí)現(xiàn)引擎及控制電子的系統(tǒng)方案已發(fā)展至接近其技術(shù)和應(yīng)用極限，汽車工業(yè)正面臨新的設(shè)計(jì)挑戰(zhàn)。過(guò)去汽車電子產(chǎn)品的開發(fā)周期是漫長(zhǎng)的，而許多汽車制造商現(xiàn)正致力于在更短的時(shí)間內(nèi)，裝備消費(fèi)者所需的新一代汽車。
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pcb封裝就是把實(shí)際的電子元器件，芯片等的各種參數(shù)（比如元器件的大小，長(zhǎng)寬，直插，貼片，焊盤的大小，管腳的長(zhǎng)寬，管腳的間距等）用圖形方式表現(xiàn)出來(lái)，以便可以在畫pcb圖時(shí)進(jìn)行調(diào)用。
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Quartus II 是Altera公司推出的綜合性CPLD/FPGA開發(fā)軟件，軟件支持原理圖、VHDL、VerilogHDL以及AHDL（Altera Hardware 支持Description Language）等多種設(shè)計(jì)輸入形式，內(nèi)嵌自有的綜合器以及仿真器，可以完成從設(shè)計(jì)輸入到硬件配置的完整PLD設(shè)計(jì)流程。
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　　Artix-7 系列：相對(duì)于 Spartan-6 系列而言，Artix-7 系列功耗降低了一半，成本降低了 35%，采用小型化封裝、統(tǒng)一的 Virtex 系列架構(gòu)，能滿足低成本大批量市場(chǎng)的性能要求，這也正是此前 ASSP、ASIC 和低成本 FPGA 所針對(duì)的市場(chǎng)領(lǐng)域。
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面包板是由于板子上有很多小插孔，專為電子電路的無(wú)焊接實(shí)驗(yàn)設(shè)計(jì)制造的。由于各種電子元器件可根據(jù)需要隨意插入或拔出，免去了焊接，節(jié)省了電路的組裝時(shí)間，而且元件可以重復(fù)使用，所以非常適合電子電路的組裝、調(diào)試和訓(xùn)練。
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特性阻抗又稱特征阻抗，它不是直流電阻，屬于長(zhǎng)線傳輸中的概念。特性阻抗是射頻傳輸線影響無(wú)線電波電壓、電流的幅值和相位變化的固有特性，等于各處的電壓與電流的比值，用V/I表示。在射頻電路中，電阻、電容、電感都會(huì)阻礙交變電流的流動(dòng)，合稱阻抗。電阻是吸收電磁能量的，理想電容和電感不消耗電磁能量。
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時(shí)鐘源用來(lái)為環(huán)形脈沖發(fā)生器提供頻率穩(wěn)定且電平匹配的方波時(shí)鐘脈沖信號(hào)。它通常由石英晶體振蕩器和與非門組成的正反饋振蕩電路組成，其輸出送至環(huán)形脈沖發(fā)生器。
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　　Kintex-7系列：Kintex-7 系列是一種新型 FPGA，能以不到 Virtex-6 系列一半的價(jià)格實(shí)現(xiàn)與其相當(dāng)性能，性價(jià)比提高了一倍，功耗降低了一半。
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　　AD轉(zhuǎn)換采樣頻率指完成一次從模擬轉(zhuǎn)換到數(shù)字的AD轉(zhuǎn)換所需時(shí)間的倒數(shù)，模擬量可以是電壓、電流等電信號(hào)，也可以是壓力、溫度、濕度、位移、聲音等非電信號(hào)；而AD分辨率指數(shù)字量變化一個(gè)最小量時(shí)模擬信號(hào)的變化量。
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