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PCI-Express（peripheral component interconnect express）是一種高速串行計(jì)算機(jī)擴(kuò)展總線標(biāo)準(zhǔn)，它原來的名稱為“3GIO”，是由英特爾在2001年提出的，旨在替代舊的PCI，PCI-X和AGP總線標(biāo)準(zhǔn)。

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深度解析數(shù)據(jù)中心的通訊連接方式

AI的數(shù)據(jù)中心網(wǎng)絡(luò)以胖樹fat-tree架構(gòu)為主。比超大規(guī)模網(wǎng)絡(luò)的層數(shù)少、在各層之間幾乎無收斂。 fat-tree是業(yè)界普遍認(rèn)可的實(shí)現(xiàn)無阻塞網(wǎng)絡(luò)的技術(shù)，...

2023-06-19 標(biāo)簽：摩爾定律交換機(jī)數(shù)據(jù)中心 2264 0

淺析PCIE5.0中的仿真設(shè)計(jì)及過孔影響

本文是今年發(fā)布在DesignCon的文章，介紹了如何進(jìn)行仿真和設(shè)計(jì)，以及過孔對系統(tǒng)的影響等等，最后結(jié)合仿真與測試，一并對比了前仿真、后仿真以及測量的結(jié)果...

2023-06-19 標(biāo)簽：PCIe 過孔 2123 0

PEX8748?PCIe交換機(jī)Broadcom

Broadcom的PEX8748設(shè)備具備多主機(jī)PCI?Express的交換功能，使用戶可通過可擴(kuò)展性的、高帶寬、無阻塞相互連接將數(shù)臺顯示器連接到各自端點(diǎn)...

2023-06-12 標(biāo)簽：交換機(jī)PCIe 3774 0

加速計(jì)算卡設(shè)計(jì)資料原理圖：519-基于ZU19EG的4路100G光纖的PCIe 加速計(jì)算卡

本板卡系我司自主設(shè)計(jì)研發(fā)，基于Xilinx公司Zynq UltraScale+ MPSOC系列SOC XCZU19EG-FFVC1760架構(gòu)，支持PCI...

2023-06-09 標(biāo)簽：光纖 PCIe 計(jì)算卡 613 0

基于QAT硬件壓縮加速器和ZFS文件系統(tǒng)實(shí)現(xiàn)

壓縮作為一種有效降低SSD數(shù)據(jù)寫入量的方法由于受到CPU壓縮/解壓效率不高的影響，在某些情況下吞吐量甚至低于非壓縮IO系統(tǒng)。

2023-06-09 標(biāo)簽：加速器 SSD PCIe 1433 0

基于AMD FPGA的PCIE DMA邏輯實(shí)現(xiàn)

AMD FPGA自帶PCIE硬核，實(shí)現(xiàn)了PCIE協(xié)議，把串行數(shù)據(jù)轉(zhuǎn)換為并行的用戶數(shù)據(jù)，以UltraScale系列FPGA為例，其支持Gen1.02.03...

2023-06-09 標(biāo)簽：fpga amd 接口 1572 0

核芯互聯(lián)推出全新20路LP-HCSL差分時鐘緩沖器CLB2000

高性能的時鐘器件是高帶寬、高速率、高算力、大模型的基礎(chǔ)。核芯互聯(lián)近日推出面向下一代數(shù)據(jù)中心應(yīng)用的超低抖動全新20路LP-HCSL差分時鐘緩沖器CLB20...

2023-06-08 標(biāo)簽：時鐘緩沖器 PCIe PCIe Gen3 1009 0

PEX8749?PCIe交換機(jī)Broadcom

Broadcom?PEX8749設(shè)備提供多主機(jī)PCI?Express交換功能，使用戶可以根據(jù)可擴(kuò)展性、高帶寬、無堵塞的互連將數(shù)臺顯示器連接到不同的端點(diǎn)，...

2023-06-06 標(biāo)簽：發(fā)動機(jī)交換機(jī)PCIe 1243 0

PCIe—Bar空間是怎么生效的

PCIe接口相對來講還是打交道比較多的接口。無論是Intel還是Xilinx的IP也都接觸到過。

2023-06-05 標(biāo)簽：寄存器 PCI PCIe 6374 0

PCIe 5.0之PCB設(shè)計(jì)及挑戰(zhàn)

增強(qiáng)的速度和性能相較于PCIe 4.0，PCIe 5.0最顯著的優(yōu)勢是增強(qiáng)的速度和性能。2倍速度的提升將轉(zhuǎn)化為更快的數(shù)據(jù)傳輸率，減少延遲，并提高整體系統(tǒng)性能。

2023-05-29 標(biāo)簽：pcb 模擬技術(shù)PCIe 2112 0

一文讀懂PCIe 時鐘結(jié)構(gòu)

參考時鐘獨(dú)立，參考時鐘不需要穿越背板和連接器，從而使PCB設(shè)計(jì)變得更為簡單，使得架構(gòu)更加的靈活。

2023-05-29 標(biāo)簽：PCIe 8878 0

NVMe VIP架構(gòu)：主機(jī)功能

NVMe VIP 提供了一組功能來幫助測試。其中包括隨機(jī)化、功能窺探、簡化的 PRP 和數(shù)據(jù)緩沖區(qū)處理、內(nèi)存屏蔽和內(nèi)置記分板。我們將依次通過另一個示例來...

2023-05-26 標(biāo)簽：控制器 PCIe nvme 912 0

快速集成USB測試套件以快速開始驗(yàn)證

當(dāng)今設(shè)計(jì)的SoC日益復(fù)雜，驗(yàn)證復(fù)雜性呈指數(shù)級增長，這不僅是由于設(shè)計(jì)的復(fù)雜性，也是由于協(xié)議的復(fù)雜性。由于陡峭的學(xué)習(xí)曲線，新興的新協(xié)議使其更加困難。編寫測試...

2023-05-26 標(biāo)簽：以太網(wǎng)usb soc 791 0

PCI Express Gen 4驗(yàn)證挑戰(zhàn)和解決方案

隨著 16 GT/s 帶寬的增加，PCIe Gen 4 提出了有效利用帶寬以充分利用的新挑戰(zhàn)。第 4 代延遲沒有改變，并且引入了兩個關(guān)鍵功能來有效處理延...

2023-05-26 標(biāo)簽：開關(guān)PCIe 橋接器 1025 0

PCIe 4.0：新功能快速入門

“大數(shù)據(jù)”、“物聯(lián)網(wǎng)”、“移動”、“網(wǎng)絡(luò)”和“存儲”應(yīng)用是下一代高性能系統(tǒng)的關(guān)鍵驅(qū)動力。為了滿足新興應(yīng)用的帶寬要求，需要增加通道寬度或速度。增加車道寬度...

2023-05-26 標(biāo)簽：物聯(lián)網(wǎng)PCIe 大數(shù)據(jù) 1220 0

使用Synopsys VIP和測試套件進(jìn)行驗(yàn)證

采用 128b/130b 編碼的 ElEOS 有序集擴(kuò)展為包括更長的 0 和 1 運(yùn)行長度。在 32.0 GT/s 時，添加了另外 19 組具有各種預(yù)...

2023-05-26 標(biāo)簽：寄存器 PCI PCIe 992 0

PCIe PIPE 4.4.1：PCIe Gen4的推動者

PCIe 是一種多層串行總線協(xié)議，可實(shí)現(xiàn)雙單工鏈路。由于其專用的點(diǎn)對點(diǎn)拓?fù)?，它提供高速?shù)據(jù)傳輸和低延遲。為了加快基于 PCIe 的子系統(tǒng)的驗(yàn)證和設(shè)備開發(fā)...

2023-05-26 標(biāo)簽：接口總線 PCIe 3540 0

揭開CXL的神秘面紗：概述

CXL 是一種在主機(jī)（通常是 CPU）和設(shè)備（通常是附加了內(nèi)存的加速器）之間實(shí)現(xiàn)高帶寬、低延遲鏈接的技術(shù)。CXL 堆棧專為低延遲而設(shè)計(jì)，使用 PCIe ...

2023-05-26 標(biāo)簽：主機(jī)PCIe 加速器卡 3745 0

PCIe 5.0均衡模式：縮短鏈路啟動時間

PCIe 是用于點(diǎn)對點(diǎn)通信的高速差分串行標(biāo)準(zhǔn)。每一代 PCIe 標(biāo)準(zhǔn)都提供比上一代產(chǎn)品更多的功能和更快的數(shù)據(jù)傳輸速率。最新一代 PCIe 5.0 將使 ...

2023-05-26 標(biāo)簽：以太網(wǎng)數(shù)據(jù)中心 PCIe 1688 0

管理NVMe驗(yàn)證復(fù)雜性

NVMe 實(shí)現(xiàn)可以解決 SATA 點(diǎn)對點(diǎn)架構(gòu)和 SAS 占用的空間問題。在這兩個領(lǐng)域成功采用是由于低延遲和通用存儲接口的承諾，無論位置如何。盡管這兩個用...

2023-05-26 標(biāo)簽：控制器 PCIe nvme 909 0

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Protues

Protues

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Proteus軟件是英國Lab Center Electronics公司出版的EDA工具軟件（該軟件中國總代理為廣州風(fēng)標(biāo)電子技術(shù)有限公司）。它不僅具有其它EDA工具軟件的仿真功能，還能仿真單片機(jī)及外圍器件。
靜電防護(hù)

靜電防護(hù)

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為防止靜電積累所引起的人身電擊、火災(zāi)和爆炸、電子器件失效和損壞，以及對生產(chǎn)的不良影響而采取的防范措施。其防范原則主要是抑制靜電的產(chǎn)生，加速靜電泄漏，進(jìn)行靜電中和等。
Altium Designer

Altium Designer

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FPGA芯片

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FPGA（Field－Programmable Gate Array），即現(xiàn)場可編程門陣列，它是在PAL、GAL、CPLD等可編程器件的基礎(chǔ)上進(jìn)一步發(fā)展的產(chǎn)物。
ArduBlock

ArduBlock

+關(guān)注

ArduBlock軟件是Arduino官方編程環(huán)境的第三方軟件，目前必須依附于Arduino軟件下運(yùn)行，區(qū)別于Arduino文本式編程環(huán)境，ArduBlock是以圖形化積木搭建的方式編程的，這樣的方式會使編程的可視化和交互性加強(qiáng)，編程門檻降低，即使沒有編程經(jīng)驗(yàn)的人也可以嘗試給Arduino控制器編寫程序。
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識別

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FPGA開發(fā)板在基于MCU、定制ASIC和體積龐大的電線束來實(shí)現(xiàn)引擎及控制電子的系統(tǒng)方案已發(fā)展至接近其技術(shù)和應(yīng)用極限，汽車工業(yè)正面臨新的設(shè)計(jì)挑戰(zhàn)。過去汽車電子產(chǎn)品的開發(fā)周期是漫長的，而許多汽車制造商現(xiàn)正致力于在更短的時間內(nèi)，裝備消費(fèi)者所需的新一代汽車。
PCB封裝

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pcb封裝就是把實(shí)際的電子元器件，芯片等的各種參數(shù)（比如元器件的大小，長寬，直插，貼片，焊盤的大小，管腳的長寬，管腳的間距等）用圖形方式表現(xiàn)出來，以便可以在畫pcb圖時進(jìn)行調(diào)用。
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Quartus II 是Altera公司推出的綜合性CPLD/FPGA開發(fā)軟件，軟件支持原理圖、VHDL、VerilogHDL以及AHDL（Altera Hardware 支持Description Language）等多種設(shè)計(jì)輸入形式，內(nèi)嵌自有的綜合器以及仿真器，可以完成從設(shè)計(jì)輸入到硬件配置的完整PLD設(shè)計(jì)流程。
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　　Artix-7 系列：相對于 Spartan-6 系列而言，Artix-7 系列功耗降低了一半，成本降低了 35%，采用小型化封裝、統(tǒng)一的 Virtex 系列架構(gòu)，能滿足低成本大批量市場的性能要求，這也正是此前 ASSP、ASIC 和低成本 FPGA 所針對的市場領(lǐng)域。
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面包板是由于板子上有很多小插孔，專為電子電路的無焊接實(shí)驗(yàn)設(shè)計(jì)制造的。由于各種電子元器件可根據(jù)需要隨意插入或拔出，免去了焊接，節(jié)省了電路的組裝時間，而且元件可以重復(fù)使用，所以非常適合電子電路的組裝、調(diào)試和訓(xùn)練。
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特性阻抗又稱特征阻抗，它不是直流電阻，屬于長線傳輸中的概念。特性阻抗是射頻傳輸線影響無線電波電壓、電流的幅值和相位變化的固有特性，等于各處的電壓與電流的比值，用V/I表示。在射頻電路中，電阻、電容、電感都會阻礙交變電流的流動，合稱阻抗。電阻是吸收電磁能量的，理想電容和電感不消耗電磁能量。
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AXI是一種總線協(xié)議，該協(xié)議是ARM公司提出的AMBA3.0協(xié)議中最重要的部分，是一種面向高性能、高帶寬、低延遲的片內(nèi)總線。它的地址/控制和數(shù)據(jù)相位是分離的，支持不對齊的數(shù)據(jù)傳輸，同時在突發(fā)傳輸中，只需要首地址，同時分離的讀寫數(shù)據(jù)通道、并支持Outstanding傳輸訪問和亂序訪問，并更加容易進(jìn)行時序收斂。AXI是AMBA中一個新的高性能協(xié)議。
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時鐘源用來為環(huán)形脈沖發(fā)生器提供頻率穩(wěn)定且電平匹配的方波時鐘脈沖信號。它通常由石英晶體振蕩器和與非門組成的正反饋振蕩電路組成，其輸出送至環(huán)形脈沖發(fā)生器。
FPGA教程

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Kintex-7

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　　Kintex-7系列：Kintex-7 系列是一種新型 FPGA，能以不到 Virtex-6 系列一半的價格實(shí)現(xiàn)與其相當(dāng)性能，性價比提高了一倍，功耗降低了一半。
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　　AD轉(zhuǎn)換采樣頻率指完成一次從模擬轉(zhuǎn)換到數(shù)字的AD轉(zhuǎn)換所需時間的倒數(shù)，模擬量可以是電壓、電流等電信號，也可以是壓力、溫度、濕度、位移、聲音等非電信號；而AD分辨率指數(shù)字量變化一個最小量時模擬信號的變化量。
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