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      電子發(fā)燒友網(wǎng)>電子資料下載>電子論文>半導(dǎo)體技術(shù)論文>基于Altera在65nm半導(dǎo)體工藝上的技術(shù)和方法

      基于Altera在65nm半導(dǎo)體工藝上的技術(shù)和方法

      2017-09-04 | rar | 0.19 MB | 次下載 | 免費(fèi)

      資料介紹

      　　Altera在65nm半導(dǎo)體制造工藝上的發(fā)展策略是充分利用先進(jìn)的技術(shù)和方法，以最低的成本為客戶提供性能最好的器件，同時(shí)降低客戶風(fēng)險(xiǎn)，保證產(chǎn)品盡快面市。Altera在130nm和90nm器件上的市場份額表明，有效控制高端半導(dǎo)體技術(shù)中存在的風(fēng)險(xiǎn)，能夠提高FPGA體系結(jié)構(gòu)在市場上的受歡迎程度。因此，早自2003年初以來，Altera就一直在穩(wěn)步開發(fā)和測試其65nm技術(shù)。本文研究Altera在65nm工藝上的工程策略，介紹公司如何為客戶降低生產(chǎn)和計(jì)劃風(fēng)險(xiǎn)，并同時(shí)從根本上提高密度、性能，及降低成本和功耗。隨著半導(dǎo)體制造技術(shù)達(dá)到新的極限，在65nm工藝節(jié)點(diǎn)上出現(xiàn)了特殊的產(chǎn)品規(guī)劃、設(shè)計(jì)和交付挑戰(zhàn)。在130nm和90nm通道尺度上還可以處理的深亞微米效應(yīng)，包括功耗增加、工藝偏差以及參數(shù)失效等，成為65nm工藝最顯著的工程挑戰(zhàn)。這一工藝節(jié)點(diǎn)的IC開發(fā)存在很大的風(fēng)險(xiǎn)，會影響FPGA的工藝和性能。由于許多客戶選擇了可編程邏輯作為減小風(fēng)險(xiǎn)的策略，Altera應(yīng)用業(yè)界最前沿、最全面的方法來控制這種風(fēng)險(xiǎn)。

      基于Altera在65nm半導(dǎo)體工藝上的技術(shù)和方法

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