pcie

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PCI-Express（peripheral component interconnect express）是一種高速串行計(jì)算機(jī)擴(kuò)展總線標(biāo)準(zhǔn)，它原來(lái)的名稱(chēng)為“3GIO”，是由英特爾在2001年提出的，旨在替代舊的PCI，PCI-X和AGP總線標(biāo)準(zhǔn)。

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pcie技術(shù)

PCIe設(shè)備在一個(gè)系統(tǒng)中是如何發(fā)現(xiàn)與訪問(wèn)的

PCIe體系架構(gòu)一般由root complex，switch，endpoint等類(lèi)型的PCIe設(shè)備組成，在root complex和switch中通常會(huì)...

2019-03-11 標(biāo)簽：寄存器 PCIe 處理器系統(tǒng) 1.9萬(wàn) 0

實(shí)測(cè)：高性能PCIe通道固態(tài)硬盤(pán)帶來(lái)的實(shí)際影響

這幾款游戲都是目前比較熱門(mén)的游戲大作，有著大型的場(chǎng)景需要加載。因此測(cè)試以點(diǎn)擊進(jìn)入游戲開(kāi)始計(jì)時(shí)，到完全進(jìn)入可操作界面為止，分別進(jìn)行時(shí)間統(tǒng)計(jì)。

2018-05-16 標(biāo)簽：PCIe 固態(tài)硬盤(pán) 1.9萬(wàn) 0

【桃子同學(xué)筆記4】PCIE訓(xùn)練狀態(tài)機(jī)（LTSSM）基礎(chǔ)

LTSSM，即：Link Training and Status State Machine（鏈路訓(xùn)練及狀態(tài)機(jī)）;LTSSM 包含 11 個(gè)頂層狀態(tài)：D...

2022-09-05 標(biāo)簽：PCIe 狀態(tài)機(jī) 1.8萬(wàn) 0

PCIe4.0 x16與x8對(duì)RTX 4060級(jí)別顯卡性能有何影響？

如果是PCIe 4.0 x16插槽，那第二條PCIe插槽接入設(shè)備之后，第一條PCIe插槽也會(huì)降速到x8，如今RTX 4060系列的PCIe主動(dòng)減少到x8...

2023-05-23 標(biāo)簽：顯卡晶體管 PCIe 1.8萬(wàn) 0

PCIe總線基本概念,高速串行總線取代傳統(tǒng)并行總線是一個(gè)大的趨勢(shì)

除了差分總線，PCIe還引入了嵌入式時(shí)鐘的技術(shù)（Embedded Clock），即發(fā)送端不再向接收端發(fā)送時(shí)鐘，但是接收端可以通過(guò)8b/10b的編碼從數(shù)據(jù)...

2018-04-19 標(biāo)簽：串行總線 PCIe 1.8萬(wàn) 0

靜電對(duì)實(shí)驗(yàn)室設(shè)備太大？沒(méi)關(guān)系這些方法消除靜電有效果

靜電對(duì)電子元器件和設(shè)備的損傷在冬天更是不容忽視。生產(chǎn)線為什么會(huì)在防靜電措施投入這么大呢？就是因?yàn)楸混o電打怕了！那么在實(shí)驗(yàn)室我們?cè)撊绾伪苊忪o電對(duì)設(shè)備的損害...

2018-01-04 標(biāo)簽：靜電示波器 PCIe 1.8萬(wàn) 0

PCIE總線規(guī)范范例：PCI-Express板卡PCB設(shè)計(jì)

PCIE需要在發(fā)送端（PETPN）和對(duì)方的接收端之間進(jìn)行交流耦合，差分對(duì)的兩個(gè)交流耦合電容必須有相同的封裝尺寸，位置要對(duì)稱(chēng)，并且要擺放在靠近金手指這邊...

2018-10-04 標(biāo)簽：PCB 總線 PCIE 1.7萬(wàn) 0

PCIE一致性測(cè)試過(guò)程的詳細(xì)介紹

PCIE信號(hào)的一致性測(cè)試從來(lái)都是業(yè)界的一個(gè)重點(diǎn)和難點(diǎn)，本期借著一個(gè)電腦主板的debug案例，高速先生向大家介紹下PCIE一致性測(cè)試的過(guò)程！相信不少酷愛(ài)...

2022-02-14 標(biāo)簽：PCB設(shè)計(jì)PCIe 一致性測(cè)試 1.6萬(wàn) 1

PCIe引腳定義和PCIe協(xié)議層介紹

本文我們將向大家介紹PCIe引腳定義以及PCIe協(xié)議層。

2023-09-26 標(biāo)簽：電路板計(jì)算機(jī)總線 1.6萬(wàn) 0

常見(jiàn)差分邏輯電平和相關(guān)輸入輸出原理

本篇主要介紹常用的差分邏輯電平，包括LVDS、xECL、CML、HCSL/LPHCSL、TMDS等。 1、LVDS電平 LVDS器件是近年來(lái)Nation...

2020-12-23 標(biāo)簽：CMOS lvds PCIe 1.5萬(wàn) 0

Ack/Nak機(jī)制詳細(xì)介紹

Ack/Nak是一種由硬件實(shí)現(xiàn)的，完全自動(dòng)的機(jī)制，目的是保證TLP有效可靠地傳輸。Ack DLLP用于確認(rèn)TLP被成功接收，Nak DLLP則用于表明T...

2018-05-29 標(biāo)簽：Ack PCIe Nak 1.5萬(wàn) 0

PCIe掃盲—PCIe錯(cuò)誤檢測(cè)機(jī)制的詳細(xì)資料概述

PCIe總線錯(cuò)誤檢測(cè)囊括了鏈路（Link）上的錯(cuò)誤以及包傳遞過(guò)程中的錯(cuò)誤，如下圖所示。用戶(hù)設(shè)計(jì)的應(yīng)用程序?qū)又械腻e(cuò)誤不屬于鏈路傳輸中的錯(cuò)誤，不應(yīng)當(dāng)通過(guò)PC...

2018-08-18 標(biāo)簽：CRC Link PCIe 1.5萬(wàn) 0

對(duì)LTSSM進(jìn)行了簡(jiǎn)單的介紹

這是鏈路（Link）的正常狀態(tài)（Normal and Full-Active State），所有的TLP、DLLP和Ordered Sets都可以被正常...

2018-06-08 標(biāo)簽：PCIe 鏈路功耗管理 1.5萬(wàn) 0

PCI-Express接口連接器知識(shí)分析

PCIe鏈路的最大寬度為×32，但是在實(shí)際應(yīng)用中，×32的鏈路寬度極少使用。在一個(gè)處理器系統(tǒng)中，一般提供×16的PCIe插槽，并使用PETp0~15、P...

2018-08-21 標(biāo)簽：連接器總線 PCIE 1.4萬(wàn) 0

PCIe總線的三種錯(cuò)誤報(bào)告方式

PCIe設(shè)備的配置空間中的狀態(tài)與控制寄存器如上圖所示，通過(guò)這些寄存器可以使能（或禁止）通過(guò)錯(cuò)誤消息（Error Message）發(fā)送錯(cuò)誤報(bào)告、查詢(xún)錯(cuò)誤狀...

2018-08-23 標(biāo)簽：寄存器總線 PCIe 1.4萬(wàn) 0

詳解PCIe和NVLink兩種互聯(lián)技術(shù)

計(jì)算機(jī)網(wǎng)絡(luò)通信中兩個(gè)重要的衡量指標(biāo)是帶寬和延遲，AI 網(wǎng)絡(luò)也是如此。在向百億級(jí)及以上規(guī)模的發(fā)展過(guò)程中，影響AI計(jì)算集群性能的關(guān)鍵并不只在于單個(gè)芯片的處理...

2023-10-17 標(biāo)簽：服務(wù)器總線數(shù)據(jù)中心 1.3萬(wàn) 0

PCIe物理層實(shí)現(xiàn)了一對(duì)收發(fā)差分對(duì)，可以實(shí)現(xiàn)全雙工的通信方式

如上圖所示，PCIe物理層實(shí)現(xiàn)了一對(duì)收發(fā)差分對(duì)，因此可以實(shí)現(xiàn)全雙工的通信方式。需要注意的是，PCIe Spec只是規(guī)定了物理層需要實(shí)現(xiàn)的功能、性能與參數(shù)...

2018-05-31 標(biāo)簽：全雙工 PCIe 物理層 1.3萬(wàn) 0

什么是PCIe4.0？啟威測(cè)實(shí)測(cè)案例帶你了解U.2接口PCIe4.0信號(hào)量測(cè)

PCIe全稱(chēng)PCI-Express，中文名稱(chēng)為高速串行總線。4.0是PCIe的一個(gè)版本，代表了系統(tǒng)總線的吞吐量，與CPU、GPU、顯卡的數(shù)據(jù)傳輸速率息息相關(guān)。

2022-12-05 標(biāo)簽：接口總線 PCIe 1.3萬(wàn) 0

基于FPGA的PCIe總線接口的DMA控制器的實(shí)現(xiàn)并進(jìn)行仿真驗(yàn)證

本文實(shí)現(xiàn)的基于FPGA的PCIe總線接口的DMA控制器是在Altera PHY IP和Synopsys Core IP的基礎(chǔ)上實(shí)現(xiàn)的，利用Syno...

2018-01-11 標(biāo)簽：fpga 控制器 pcie 1.3萬(wàn) 0

PCIe總線AC耦合及高速信號(hào)調(diào)整技術(shù)

本篇主要介紹PCIe總線的AC耦合電容、總線的去加重等高速信號(hào)調(diào)整技術(shù)。 AC耦合電容可以參考之前的文章《邏輯電平之差分互連AC耦合電容（7）》，本文主...

2020-12-22 標(biāo)簽：AC PCIe 耦合電容 1.3萬(wàn) 0

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Protues

Protues

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Proteus軟件是英國(guó)Lab Center Electronics公司出版的EDA工具軟件（該軟件中國(guó)總代理為廣州風(fēng)標(biāo)電子技術(shù)有限公司）。它不僅具有其它EDA工具軟件的仿真功能，還能仿真單片機(jī)及外圍器件。
靜電防護(hù)

靜電防護(hù)

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為防止靜電積累所引起的人身電擊、火災(zāi)和爆炸、電子器件失效和損壞，以及對(duì)生產(chǎn)的不良影響而采取的防范措施。其防范原則主要是抑制靜電的產(chǎn)生，加速靜電泄漏，進(jìn)行靜電中和等。
Altium Designer

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FPGA芯片

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FPGA（Field－Programmable Gate Array），即現(xiàn)場(chǎng)可編程門(mén)陣列，它是在PAL、GAL、CPLD等可編程器件的基礎(chǔ)上進(jìn)一步發(fā)展的產(chǎn)物。
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ArduBlock軟件是Arduino官方編程環(huán)境的第三方軟件，目前必須依附于Arduino軟件下運(yùn)行，區(qū)別于Arduino文本式編程環(huán)境，ArduBlock是以圖形化積木搭建的方式編程的，這樣的方式會(huì)使編程的可視化和交互性加強(qiáng)，編程門(mén)檻降低，即使沒(méi)有編程經(jīng)驗(yàn)的人也可以嘗試給Arduino控制器編寫(xiě)程序。
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FPGA開(kāi)發(fā)板

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FPGA開(kāi)發(fā)板在基于MCU、定制ASIC和體積龐大的電線束來(lái)實(shí)現(xiàn)引擎及控制電子的系統(tǒng)方案已發(fā)展至接近其技術(shù)和應(yīng)用極限，汽車(chē)工業(yè)正面臨新的設(shè)計(jì)挑戰(zhàn)。過(guò)去汽車(chē)電子產(chǎn)品的開(kāi)發(fā)周期是漫長(zhǎng)的，而許多汽車(chē)制造商現(xiàn)正致力于在更短的時(shí)間內(nèi)，裝備消費(fèi)者所需的新一代汽車(chē)。
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pcb封裝就是把實(shí)際的電子元器件，芯片等的各種參數(shù)（比如元器件的大小，長(zhǎng)寬，直插，貼片，焊盤(pán)的大小，管腳的長(zhǎng)寬，管腳的間距等）用圖形方式表現(xiàn)出來(lái)，以便可以在畫(huà)pcb圖時(shí)進(jìn)行調(diào)用。
QUARTUS II

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Quartus II 是Altera公司推出的綜合性CPLD/FPGA開(kāi)發(fā)軟件，軟件支持原理圖、VHDL、VerilogHDL以及AHDL（Altera Hardware 支持Description Language）等多種設(shè)計(jì)輸入形式，內(nèi)嵌自有的綜合器以及仿真器，可以完成從設(shè)計(jì)輸入到硬件配置的完整PLD設(shè)計(jì)流程。
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QuickPcb

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Artix-7

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　　Artix-7 系列：相對(duì)于 Spartan-6 系列而言，Artix-7 系列功耗降低了一半，成本降低了 35%，采用小型化封裝、統(tǒng)一的 Virtex 系列架構(gòu)，能滿(mǎn)足低成本大批量市場(chǎng)的性能要求，這也正是此前 ASSP、ASIC 和低成本 FPGA 所針對(duì)的市場(chǎng)領(lǐng)域。
VHDL代碼

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Protel 99 se

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powerlink

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candence

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面包板

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面包板是由于板子上有很多小插孔，專(zhuān)為電子電路的無(wú)焊接實(shí)驗(yàn)設(shè)計(jì)制造的。由于各種電子元器件可根據(jù)需要隨意插入或拔出，免去了焊接，節(jié)省了電路的組裝時(shí)間，而且元件可以重復(fù)使用，所以非常適合電子電路的組裝、調(diào)試和訓(xùn)練。
特性阻抗

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特性阻抗又稱(chēng)特征阻抗，它不是直流電阻，屬于長(zhǎng)線傳輸中的概念。特性阻抗是射頻傳輸線影響無(wú)線電波電壓、電流的幅值和相位變化的固有特性，等于各處的電壓與電流的比值，用V/I表示。在射頻電路中，電阻、電容、電感都會(huì)阻礙交變電流的流動(dòng)，合稱(chēng)阻抗。電阻是吸收電磁能量的，理想電容和電感不消耗電磁能量。
AXI

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AXI是一種總線協(xié)議，該協(xié)議是ARM公司提出的AMBA3.0協(xié)議中最重要的部分，是一種面向高性能、高帶寬、低延遲的片內(nèi)總線。它的地址/控制和數(shù)據(jù)相位是分離的，支持不對(duì)齊的數(shù)據(jù)傳輸，同時(shí)在突發(fā)傳輸中，只需要首地址，同時(shí)分離的讀寫(xiě)數(shù)據(jù)通道、并支持Outstanding傳輸訪問(wèn)和亂序訪問(wèn)，并更加容易進(jìn)行時(shí)序收斂。AXI是AMBA中一個(gè)新的高性能協(xié)議。
驅(qū)動(dòng)電流

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時(shí)鐘源

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時(shí)鐘源用來(lái)為環(huán)形脈沖發(fā)生器提供頻率穩(wěn)定且電平匹配的方波時(shí)鐘脈沖信號(hào)。它通常由石英晶體振蕩器和與非門(mén)組成的正反饋振蕩電路組成，其輸出送至環(huán)形脈沖發(fā)生器。
FPGA教程

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Kintex-7

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　　Kintex-7系列：Kintex-7 系列是一種新型 FPGA，能以不到 Virtex-6 系列一半的價(jià)格實(shí)現(xiàn)與其相當(dāng)性能，性?xún)r(jià)比提高了一倍，功耗降低了一半。
AD采樣

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　　AD轉(zhuǎn)換采樣頻率指完成一次從模擬轉(zhuǎn)換到數(shù)字的AD轉(zhuǎn)換所需時(shí)間的倒數(shù)，模擬量可以是電壓、電流等電信號(hào)，也可以是壓力、溫度、濕度、位移、聲音等非電信號(hào)；而AD分辨率指數(shù)字量變化一個(gè)最小量時(shí)模擬信號(hào)的變化量。
紅外觸摸屏

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Protel DXP

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