Cadence設(shè)計(jì)系統(tǒng)公司公布一個(gè)新版的尖端功能驗(yàn)證平臺(tái)與方法學(xué)，擁有全套最新增強(qiáng)功能，與之前發(fā)布的版本相比，可將SoC驗(yàn)證效率提高一倍。 Incisive ?12.2提供了兩倍性能，全新Incisive調(diào)試分析器產(chǎn)品，全新低功耗建模，以及當(dāng)今復(fù)雜IP與SoC高效驗(yàn)證所需的數(shù)百種其他功能。
2013-01-27 10:44:38
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隨著集成電路深亞微米時(shí)代的到來(lái)，集成電路的規(guī)模不斷擴(kuò)大，促進(jìn)了系統(tǒng)級(jí)芯片 SoC（Systems-on-a-Chip）的發(fā)展和應(yīng)用。通常一個(gè) SoC芯片的規(guī)模在幾百萬(wàn)門至幾千萬(wàn)門左右，面對(duì)如此高的復(fù)雜度，驗(yàn)證成為 SoC設(shè)計(jì)中最困難、最具挑戰(zhàn)性的課題之一。
2019-01-15 07:56:0012777 
本文章提出了一種新的半導(dǎo)體超鹵素深度分析方法，在通過(guò)臭氧氧化去除一些硅原子層，然后用氫氟酸蝕刻氧化物后，重復(fù)測(cè)量，然后確定了成分和表面電位的深度分布，因此這種分析技術(shù)提供了優(yōu)于0.5納米的深度分辨率
2022-04-07 13:18:16949 
確保汽車 SoC 在功能上安全還可以讓駕駛員和乘客對(duì)他們的車輛充滿信心。將安全驗(yàn)證集成到功能驗(yàn)證流程中可以是加快流程和管理符合 ISO 26262 等標(biāo)準(zhǔn)的工作的有效方法。
2022-06-15 16:09:403257 
帶32位MCU和高精度ADC的SoC產(chǎn)品----SD93F系列開發(fā)指南（二）
2022-09-22 14:02:092507 
1 簡(jiǎn)介
隨著設(shè)計(jì)的復(fù)雜程度不斷增加，要求把更多的資源放到驗(yàn)證上，不但要求驗(yàn)證能夠覆蓋所有的功能，還希望能夠給出大量的異常情況來(lái)檢查DUT對(duì)應(yīng)異常的處理狀態(tài)，這在傳統(tǒng)測(cè)試方法下往往是難以實(shí)現(xiàn)
2023-08-25 16:45:55586 汽車外，還有很多其他行業(yè)也能從電子器件的增加受益，當(dāng)然保障功能安全是大的前提。本文討論SOC芯片設(shè)計(jì)驗(yàn)證、驗(yàn)證計(jì)劃和策略以及驗(yàn)證方法。它定義了功能模擬、功能覆蓋、
2023-07-31 23:45:12837 
簡(jiǎn)述SOC的設(shè)計(jì)流程跟方法，以及現(xiàn)在市場(chǎng)上跟SOC設(shè)計(jì)相關(guān)的解決方案；接下來(lái)我們會(huì)將眼光轉(zhuǎn)到OPENCORES，這是一個(gè)以opensource的精神推廣IC設(shè)計(jì)的機(jī)構(gòu)，筆者會(huì)介紹在OPENCORES
2023-09-20 07:24:04
為什么verilog可以描述硬件？在SOC設(shè)計(jì)中使用verilog，和FPGA為對(duì)象使用verilog，有什么區(qū)別？SOC流程和FPGA流程的不同之處在哪里？
2021-06-21 07:02:59
先進(jìn)的設(shè)計(jì)與仿真驗(yàn)證方法成為SoC設(shè)計(jì)成功的關(guān)鍵。一個(gè)簡(jiǎn)單可行的SoC驗(yàn)證平臺(tái)，可以加快SoC系統(tǒng)的開發(fā)與驗(yàn)證過(guò)程。FPGA器件的主要開發(fā)供應(yīng)商都針對(duì)自己的產(chǎn)品推出了SoC系統(tǒng)的開發(fā)驗(yàn)證平臺(tái)，如
2019-10-11 07:07:07
SoC驗(yàn)證超越了常規(guī)邏輯仿真，但用于加速SoC驗(yàn)證的廣泛應(yīng)用的三種備選方法不但面臨可靠性問(wèn)題，而且難以進(jìn)行權(quán)衡。而且，最重要的問(wèn)題還在于硬件加速訪問(wèn)權(quán)限、時(shí)機(jī)及其穩(wěn)定性。
2019-11-11 06:37:11
由于片上系統(tǒng)(SoC)設(shè)計(jì)變得越來(lái)越復(fù)雜，驗(yàn)證面臨著巨大的挑戰(zhàn)。大型團(tuán)隊(duì)不斷利用更多資源來(lái)尋求最高效的方法，從而將新的方法學(xué)與驗(yàn)證整合在一起，并最終將設(shè)計(jì)與驗(yàn)證整合在一起。雖然我們知道實(shí)現(xiàn)驗(yàn)證計(jì)劃
2019-07-11 07:35:58
soc計(jì)算方法，BMS中的SOC的計(jì)算其實(shí)可以分為三大部分：1、電芯層級(jí)的SOC計(jì)算（軟件中最真實(shí)的SOC計(jì)算，不涉及任何濾波處理）；2、模組或者電池包層級(jí)的SOC計(jì)算（電芯到電池包級(jí)別的SOC映射
2021-07-27 06:13:05
方法方面的最新進(jìn)展，目的是發(fā)現(xiàn)研究差距并提出進(jìn)一步的改進(jìn)建議。在簡(jiǎn)要介紹了幾種深度學(xué)習(xí)模型之后，我們回顧并分析了使用深度學(xué)習(xí)進(jìn)行故障檢測(cè)，診斷和預(yù)后的應(yīng)用。該調(diào)查驗(yàn)證了深度學(xué)習(xí)對(duì)PHM中各種類型的輸入
2021-07-12 06:46:47
驗(yàn)證方法簡(jiǎn)介 設(shè)計(jì)驗(yàn)證是用于證明設(shè)計(jì)正確性的過(guò)程，要求和規(guī)格。 在數(shù)字設(shè)計(jì)流程中，驗(yàn)證可確保芯片按照設(shè)計(jì)意圖正確運(yùn)行，然后再將設(shè)計(jì)送去制造。 具體來(lái)說(shuō)，驗(yàn)證方法是驗(yàn)證集成電路設(shè)計(jì)的標(biāo)準(zhǔn)化方法。 驗(yàn)證
2022-02-13 17:03:49
資料，實(shí)現(xiàn)資源、經(jīng)驗(yàn)共享。 崗位要求：1、具有3年以上數(shù)字類芯片或FPGA邏輯 SOC子系統(tǒng)設(shè)計(jì)經(jīng)驗(yàn)，熟悉芯片開發(fā)流程；2、熟練掌握芯片SOC內(nèi)嵌子系統(tǒng)架構(gòu)分析、系統(tǒng)設(shè)計(jì)、驗(yàn)證經(jīng)驗(yàn)，具有板級(jí)SOC子系統(tǒng)
2020-02-29 11:06:28
小編前段時(shí)間幫客戶找到一些人解決了SOC驗(yàn)證環(huán)境的問(wèn)題。在招人的時(shí)候我們和不少人進(jìn)行了溝通交流，從中發(fā)現(xiàn)SOC驗(yàn)證環(huán)境一千家公司有一千家公司的做法。那么一個(gè)優(yōu)秀的SOC驗(yàn)證環(huán)境應(yīng)該具備哪些功能呢
2022-05-31 11:39:18
隨著系統(tǒng)芯片(SoC)設(shè)計(jì)的體積與復(fù)雜度持續(xù)升高，驗(yàn)證作業(yè)變成了瓶頸：占了整個(gè)SoC研發(fā)過(guò)程中70%的時(shí)間。因此，任何能夠降低驗(yàn)證成本并能更早實(shí)現(xiàn)驗(yàn)證sign-off的方法都是眾人的注目焦點(diǎn)。
2019-08-26 07:06:04
，即使使用具有一定低位寬的數(shù)據(jù)，深度學(xué)習(xí)推理也不會(huì)降低最終精度。目前據(jù)說(shuō)8位左右可以提供穩(wěn)定的準(zhǔn)確率，但最新的研究表明，已經(jīng)出現(xiàn)了即使降低到4位或2位也能獲得很好準(zhǔn)確率的模型和學(xué)習(xí)方法，越來(lái)越多的正在
2023-02-17 16:56:59
制化FPGA原型板驗(yàn)證效率的創(chuàng)新方法，自動(dòng)化現(xiàn)有的電路仿真(in-circuit emulation)偵錯(cuò)功能，并提供更高的FPGA能見(jiàn)度。這個(gè)以FPGA為基礎(chǔ)的SoC驗(yàn)證平臺(tái)對(duì)工研院而言是前景看好
2011-07-24 09:47:50
再進(jìn)行的分析，目前希望后續(xù)能通過(guò)改進(jìn)測(cè)試方法完成對(duì)這個(gè)ADC的評(píng)估驗(yàn)證。后面還有涉及到不少的指標(biāo)測(cè)試，免不了ADI專家與高手的指點(diǎn)啦。 今天先寫這些了，上面肯定有很多不足的地方，也請(qǐng)也請(qǐng)高手與專家指正。希望進(jìn)行深度交流，感謝支持。
2018-11-01 09:26:31
關(guān)于創(chuàng)新高精度數(shù)據(jù)采集SoC的設(shè)計(jì)方案
2021-04-07 06:19:32
求大神分享基于SOC的高精度傾角測(cè)量系統(tǒng)的設(shè)計(jì)方案
2021-04-15 06:15:37
檢測(cè)儀器的實(shí)現(xiàn)方法。該方法的硬件集成度高，設(shè)計(jì)實(shí)現(xiàn)簡(jiǎn)便；軟件設(shè)計(jì)集合了形態(tài)濾波等多種先進(jìn)算法，精確度高，抗干擾性強(qiáng)。實(shí)驗(yàn)證明，這種血壓檢測(cè)儀具有很好的精度，能夠滿足血壓測(cè)量的一般要求。參考文獻(xiàn)[1
2009-11-28 10:08:51
本文通過(guò)對(duì)基于ARM7的SOC系統(tǒng)的設(shè)計(jì)，介紹了一種Flash結(jié)構(gòu)的FPGA器件及其片上系統(tǒng)的設(shè)計(jì)方法，進(jìn)而給出了兩種驗(yàn)證該片上系統(tǒng)準(zhǔn)確性的方法，通過(guò)實(shí)際驗(yàn)證，該系統(tǒng)不僅能準(zhǔn)確進(jìn)行片外存
2021-02-05 07:52:41
onchip，片上系統(tǒng))開發(fā)效率和質(zhì)量的重要手段。如果能對(duì)IP核進(jìn)行驗(yàn)證、測(cè)試和集成．就可以加速SoC的設(shè)計(jì)，而這需要從以下5個(gè)方面進(jìn)行考慮。代碼純化．指在代碼設(shè)計(jì)中及完成后進(jìn)行自定義的、IEEE標(biāo)準(zhǔn)
2021-09-01 19:32:45
1 簡(jiǎn)介隨著設(shè)計(jì)的復(fù)雜程度不斷增加，要求把更多的資源放到驗(yàn)證上，不但要求驗(yàn)證能夠覆蓋所有的功能，還希望能夠給出大量的異常情況來(lái)檢查DUT對(duì)應(yīng)異常的處理狀態(tài)，這在傳統(tǒng)測(cè)試方法下往往是難以實(shí)現(xiàn)的。此外
2019-07-03 07:40:26
各部門借閱學(xué)習(xí)。下面就分析思路及方法進(jìn)行講解，首先是分析思路；第一步：失效分析的“五大步驟” 失效分析的過(guò)程主要分為5個(gè)步驟：“①收集不良板信息→②失效現(xiàn)象確認(rèn)→③失效原因分析→④失效根因驗(yàn)證→⑤報(bào)告
2020-03-10 10:42:44
ERD上執(zhí)行的冒煙測(cè)試生成的輸出“由于此參考設(shè)計(jì)未綁定到任何特定項(xiàng)目，因此我們的主要目標(biāo)不是要達(dá)到設(shè)計(jì)的完整驗(yàn)證，”Salinari說(shuō)，“最重要的是，我們希望能夠執(zhí)行性能分析并創(chuàng)建驗(yàn)證方法和技巧，這樣
2017-04-05 14:17:46
SoC系統(tǒng)驗(yàn)證平臺(tái)總體框架是怎樣的？SoC系統(tǒng)驗(yàn)證平臺(tái)如何去構(gòu)建？
2021-04-28 07:13:41
上次說(shuō)到CPU的boot，今天說(shuō)說(shuō)SOC環(huán)境的另外一種啟動(dòng)方式。用C啟動(dòng)SOC驗(yàn)證環(huán)境有幾個(gè)問(wèn)題。一是CPU boot過(guò)程比較慢，每次仿真前都需要很長(zhǎng)的一段初始化時(shí)間。二是IP驗(yàn)證環(huán)境的測(cè)試用例無(wú)法
2022-06-17 14:41:50
SoC與IP有什么關(guān)系？如何去驗(yàn)證IP？
2021-04-28 06:02:37
智能家庭現(xiàn)有技術(shù)及驗(yàn)證要點(diǎn)分析
2021-05-08 06:02:33
請(qǐng)問(wèn)一下，如何利用AMSVF來(lái)進(jìn)行混合信號(hào)SoC的全芯片驗(yàn)證？
2021-05-06 07:56:08
固網(wǎng)短信電話專用SoC芯片介紹一種數(shù)模混合SoC設(shè)計(jì)協(xié)同仿真的驗(yàn)證方法
2021-04-23 06:06:39
、包和庫(kù)，特別是半導(dǎo)體知識(shí)產(chǎn)權(quán) (IP) 核心設(shè)計(jì)過(guò)程，包括以下章節(jié)：驗(yàn)證方法——概述驗(yàn)證方法——簡(jiǎn)介驗(yàn)證 IP - 方法論的作用如何選擇驗(yàn)證方法基于標(biāo)準(zhǔn)的 IP 和 SoC 的驗(yàn)證方法功能驗(yàn)證方法
2022-11-26 20:43:20
數(shù)模混合信號(hào)仿真已經(jīng)成為SoC芯片驗(yàn)證的重要環(huán)節(jié)。文章以一款固網(wǎng)短信電話專用SoC芯片為例，介紹一種使用Synopsys公司的NanoSim-VCS協(xié)同仿真環(huán)境進(jìn)行仿真的驗(yàn)證方法，并給出驗(yàn)證結(jié)
2009-05-15 15:41:26
19 數(shù)?；旌闲盘?hào)仿真已經(jīng)成為SoC芯片驗(yàn)證的重要環(huán)節(jié)。文章以一款固網(wǎng)短信電話專用SoC芯片為例，介紹一種使用Synopsys公司的NanoSim-VCS協(xié)同仿真環(huán)境進(jìn)行仿真的驗(yàn)證方法，并給出驗(yàn)證結(jié)
2009-05-15 15:41:265 本文介紹了以超深亞微米技術(shù)為支撐的 SOC 的定義以及芯片設(shè)計(jì)方法，并闡述了軟硬件協(xié)同設(shè)計(jì)理論、IP 核生成及復(fù)用技術(shù)、超深亞微米IC 設(shè)計(jì)面對(duì)的難題以及SOC 測(cè)試與驗(yàn)證技術(shù)。
2009-06-19 09:28:1235 近幾年來(lái)，SoC 技術(shù)已經(jīng)得到了迅速的發(fā)展，隨之而來(lái)的是 SoC 設(shè)計(jì)的驗(yàn)證也變得更加復(fù)雜，花費(fèi)的時(shí)間和人力成倍增加。一個(gè)SoC 芯片的驗(yàn)證可能會(huì)用到多種驗(yàn)證技術(shù)，常用的 SoC 的
2009-08-31 10:33:2524 本文首先介紹RVM驗(yàn)證方法學(xué)和覆蓋率驅(qū)動(dòng)技術(shù)，然后詳細(xì)分析如何使用結(jié)合覆蓋率驅(qū)動(dòng)技術(shù)的RVM驗(yàn)證方法學(xué)對(duì)SOC(System On Chip)進(jìn)行完備的功能驗(yàn)證, 最
2009-09-05 08:53:0015 隨著大容量高速度的FPGA的出現(xiàn)，在流片前建立一個(gè)高性價(jià)比的原型驗(yàn)證系統(tǒng)已經(jīng)成為縮短系統(tǒng)級(jí)芯片（SoC）驗(yàn)證時(shí)間，提高首次流片成功率的重要方法。本文著重討論了用FPGA建
2009-09-11 15:50:0916 ESL 設(shè)計(jì)和驗(yàn)證方法使設(shè)計(jì)工程師能夠?qū)Ｗ⒂谀切┙o產(chǎn)品及IP 帶來(lái)差異化和價(jià)值的系統(tǒng)設(shè)計(jì)屬性，即功能性和性能。本文討論電子系統(tǒng)級(jí)(ESL)設(shè)計(jì)和驗(yàn)證方法學(xué)在系統(tǒng)級(jí)芯片(SoC)設(shè)
2009-11-30 16:15:1533 本文從SoC (System on a Chip)驗(yàn)證環(huán)境外在的框架結(jié)構(gòu)、內(nèi)在的驗(yàn)證數(shù)據(jù)的組織與管理和體現(xiàn)其工作原理的系統(tǒng)腳本的設(shè)計(jì)思想三方面出發(fā)，討論SoC 驗(yàn)證環(huán)境的搭建方法，并搭建的驗(yàn)證環(huán)
2009-12-14 09:52:5822 基于SOC 的USB 主設(shè)備的軟硬件協(xié)同驗(yàn)證李棟1，李正衛(wèi)2(桂林電子科技大學(xué)通信與信息工程系，廣西 桂林 541004）摘 要：本文首先介紹了SOC 軟硬件協(xié)同驗(yàn)證方法及其平臺(tái)Seamless
2009-12-14 11:31:2115 本文介紹了基于事務(wù)的SoC驗(yàn)證方法,詳細(xì)說(shuō)明了事務(wù)、事務(wù)處理器的概念和事務(wù)級(jí)驗(yàn)證平臺(tái)的功能結(jié)構(gòu)。Synopsys公司的RVM驗(yàn)證方法學(xué)是當(dāng)前比較流行的基于事務(wù)的SoC驗(yàn)證方法,文中詳細(xì)
2010-02-24 11:44:048 無(wú)線溫度驗(yàn)證系統(tǒng) 溫度壓力一體 溫度驗(yàn)證儀分有線系統(tǒng)與無(wú)線系統(tǒng)。有線的溫度驗(yàn)證系統(tǒng)精度低，價(jià)格相對(duì)于無(wú)線產(chǎn)品的價(jià)格要低廉的多，無(wú)線驗(yàn)證系統(tǒng)操作方便，節(jié)省時(shí)間，而有線布線特別麻煩。所以在某些全封閉
2023-12-20 10:10:23
以SoC軟硬件協(xié)同設(shè)計(jì)方法學(xué)及驗(yàn)證方法學(xué)為指導(dǎo)，系統(tǒng)介紹了以ARM9為核心的AFDX-ES SoC設(shè)計(jì)過(guò)程中，軟硬件協(xié)同設(shè)計(jì)和驗(yàn)證平臺(tái)的構(gòu)建過(guò)程及具體實(shí)施。應(yīng)用實(shí)踐表明該平臺(tái)具有良
2010-11-22 15:18:5256 為解決自動(dòng)水平調(diào)節(jié)系統(tǒng)和工程應(yīng)用中傾角測(cè)量高成本、低精度的問(wèn)題，提出了一種利用MEMS雙軸傾角傳感器、信號(hào)調(diào)理和SOC等電路實(shí)現(xiàn)高精度傾角測(cè)量的方法，并從傳感器信號(hào)穩(wěn)定
2010-12-07 13:56:3525 設(shè)計(jì)與驗(yàn)證復(fù)雜SoC中可綜合的模擬及射頻模型
設(shè)計(jì)用于SoC集成的復(fù)雜模擬及射頻模塊是一項(xiàng)艱巨任務(wù)。本文介紹的采用基于性能指標(biāo)規(guī)格來(lái)優(yōu)化設(shè)計(jì)(如PLL或ADC等)的方
2009-12-26 14:38:13557 
全球電子設(shè)計(jì)創(chuàng)新領(lǐng)先企業(yè)Cadence設(shè)計(jì)系統(tǒng)公司，今天宣布了業(yè)界最全面的用于系統(tǒng)級(jí)芯片（SoC）驗(yàn)證的通用驗(yàn)證方法學(xué)(UVM)開源參考流程。為了配合Cadence EDA360中SoC實(shí)現(xiàn)能力的策略，
2010-06-28 08:29:142241 摘 要： 以SoC軟硬件協(xié)同設(shè)計(jì)方法學(xué)及驗(yàn)證方法學(xué)為指導(dǎo)，系統(tǒng)介紹了以ARM9為核心的AFDX-ES SoC設(shè)計(jì)過(guò)程中，軟硬件協(xié)同設(shè)計(jì)和驗(yàn)證平臺(tái)的構(gòu)建過(guò)程及具體實(shí)施。應(yīng)用實(shí)踐表明該
2010-12-08 10:44:411027 
功能驗(yàn)證已經(jīng)成為集成電路設(shè)計(jì)和開發(fā)的瓶頸，這就使得驗(yàn)證的方法逐漸受到業(yè)界人士的高度重視。工程師們?cè)谠O(shè)計(jì)時(shí)不可能考慮到萬(wàn)無(wú)一失，所以很多系統(tǒng)行為是不能緊緊通過(guò)測(cè)試文
2011-04-19 11:48:27782 介紹了基于深亞微米 CMOS 工藝A S IC 電路設(shè)計(jì)流程中的靜態(tài)驗(yàn)證方法。將這種驗(yàn)證方法與以往的動(dòng)態(tài)驗(yàn)證方法進(jìn)行了比較, 結(jié)果表明, 前者比后者更加高效和準(zhǔn)確。由此可以說(shuō)明, 靜態(tài)驗(yàn)證
2011-06-21 15:05:000 芯片驗(yàn)證的工作量約占整個(gè)芯片研發(fā)的70%，已然成為縮短芯片上市時(shí)間的瓶頸。應(yīng)用OVM方法學(xué)搭建SoC設(shè)計(jì)中的DMA IP驗(yàn)證平臺(tái)，可有效提高驗(yàn)證效率。
2012-06-20 09:03:292629 本專題為你簡(jiǎn)述片上系統(tǒng)SoC相關(guān)知識(shí)及設(shè)計(jì)測(cè)試。包括SoC定義，SoC設(shè)計(jì)流程，SoC設(shè)計(jì)的關(guān)鍵技術(shù)，SoC設(shè)計(jì)范例，SoC設(shè)計(jì)測(cè)試及驗(yàn)證方法，最新SoC芯片解決方案。
2012-10-12 17:57:20
SoC基于IP設(shè)計(jì)的特點(diǎn)使驗(yàn)證項(xiàng)目中多語(yǔ)言VIP（Verification IP）協(xié)同驗(yàn)證的需求不斷增加，給驗(yàn)證工作帶來(lái)了很大的挑戰(zhàn)。為了解決多語(yǔ)言VIP在SoC驗(yàn)證環(huán)境靈活重用的問(wèn)題。提出了一種
2015-12-31 09:25:1312 射程修正引信彈道辨識(shí)方法及精度分析，下來(lái)看看
2016-12-17 16:33:394 控制器設(shè)計(jì)出的新型元器件通用驗(yàn)證方法，硬件由通用驗(yàn)證平臺(tái)和功能應(yīng)用子板兩部分組成。軟件包含有上位機(jī)調(diào)試工具、命令解析模塊、通信模塊、數(shù)據(jù)智能處理模塊等。解決了新型元器件驗(yàn)證周期長(zhǎng)、成本高、難以實(shí)時(shí)控制和智能數(shù)據(jù)分析等缺點(diǎn)。用此方法已成功對(duì)芯片JS71238進(jìn)行了性能功能的驗(yàn)證，取得了理想的驗(yàn)證效果。
2017-11-17 03:00:451027 
設(shè)計(jì)了一種基于FPGA的驗(yàn)證平臺(tái)及有效的SoC驗(yàn)證方法，介紹了此FPGA驗(yàn)證軟硬件平臺(tái)及軟硬件協(xié)同驗(yàn)證架構(gòu)，討論和分析了利用FPGA軟硬件協(xié)同系統(tǒng)驗(yàn)證SoC系統(tǒng)的過(guò)程和方法。利用此軟硬件協(xié)同驗(yàn)證
2017-11-17 03:06:0113139 
設(shè)計(jì)了一種基于FPGA的驗(yàn)證平臺(tái)及有效的SoC驗(yàn)證方法，介紹了此FPGA驗(yàn)證軟硬件平臺(tái)及軟硬件協(xié)同驗(yàn)證架構(gòu)，討論和分析了利用FPGA軟硬件協(xié)同系統(tǒng)驗(yàn)證SoC系統(tǒng)的過(guò)程和方法。利用此軟硬件協(xié)同驗(yàn)證
2017-11-17 03:06:013770 
確定最佳深度可以降低運(yùn)算成本，同時(shí)可以進(jìn)一步提高精度。針對(duì)深度置信網(wǎng)絡(luò)深度選擇的問(wèn)題，文章分析了通過(guò)設(shè)定閾值方法選擇最佳深度的不足之處。
2018-04-04 15:46:003601 
本文檔內(nèi)容介紹了基于零成本快速完成 SoC 概念驗(yàn)證，供參考
2018-03-19 11:21:525 為了充分利用系統(tǒng)級(jí)芯片（SoC）設(shè)計(jì)帶來(lái)的優(yōu)點(diǎn)，業(yè)界需要一種可以擴(kuò)展的驗(yàn)證解決方案，解決設(shè)計(jì)周期中各個(gè)階段的問(wèn)題，縮短驗(yàn)證鴻溝。本文將探討可擴(kuò)展驗(yàn)證解決方案為何能夠以及如何解決SoC設(shè)計(jì)目前面臨的功能方面的嚴(yán)峻挑戰(zhàn)，以達(dá)到提高設(shè)計(jì)生產(chǎn)力、保證設(shè)計(jì)質(zhì)量、縮短產(chǎn)品上市時(shí)間以及提高投資回報(bào)率的目的。
2018-06-04 03:13:00743 
在片上系統(tǒng)的設(shè)計(jì)與實(shí)現(xiàn)中，驗(yàn)證這一環(huán)節(jié)日益重要，整個(gè)過(guò)程中花在驗(yàn)證的時(shí)間比重越來(lái)越大，主要原因在于隨著SOC 芯片復(fù)雜度的提高，驗(yàn)證的規(guī)模也成指數(shù)級(jí)的增加。系統(tǒng)芯片的時(shí)代已經(jīng)到來(lái)，在RTL級(jí)硬件
2018-06-01 07:18:001367 局間總線代理（如OCP 2.2，AXI 3.0，APB 3.0）。在這里，我們通過(guò)使用前兩篇文章中提到的一致方法描述了我們?cè)?b class="flag-6" style="color: red">SoC驗(yàn)證早期階段捕獲的一些主要問(wèn)題。
2019-08-12 11:22:542299 
SAN JOSE - Cadence Design Systems Inc.今天宣布推出基于塊的設(shè)計(jì)（BBD）和基于平臺(tái)的設(shè)計(jì)（PBD） ）方法和工具流向蘇格蘭的阿爾巴中心。 BBD和PBD是用于片上系統(tǒng)（SoC）開發(fā)的一套完全編碼和驗(yàn)證的設(shè)計(jì)方法。
2019-08-13 09:03:451273 實(shí)現(xiàn)PCB高精度深度銑的關(guān)鍵是每軸上裝置的光柵尺可感知板面，使各Z 軸的下降深度被單獨(dú)控制， 各軸間協(xié)調(diào)獨(dú)立作業(yè)，實(shí)現(xiàn)量產(chǎn)化加工。
2019-11-15 11:24:341498 由于電磁流量計(jì)必須是在線連續(xù)使用，幾乎不可能拆除再運(yùn)輸?shù)絿?guó)家計(jì)量檢測(cè)中心進(jìn)行檢定。因此，對(duì)于現(xiàn)場(chǎng)使用的大口徑電磁流量計(jì)的精度驗(yàn)證是很有必要的。電磁流量計(jì)的精度驗(yàn)證對(duì)于電磁流量計(jì)的管理，保證其
2019-08-26 15:23:591958 深度學(xué)習(xí)仍是視覺(jué)大數(shù)據(jù)領(lǐng)域的最好分析方法之一
2019-08-26 15:48:334664 本文以軟件工程的視角切入，分析中科院計(jì)算所某片上系統(tǒng)（SoC）項(xiàng)目的驗(yàn)證平臺(tái)，同時(shí)也介紹當(dāng)前較為流行的驗(yàn)證方法，即以專門的驗(yàn)汪語(yǔ)言結(jié)合商用的驗(yàn)證模型，快速建立測(cè)試平臺(tái)（test-bench）并在今后的項(xiàng)目中重用（reuse）之。
2020-04-10 09:23:231151 
，已成為驗(yàn)證進(jìn)程管理的棘手問(wèn)題。本文主要跟小伙伴們聊一聊智能跟蹤SoC驗(yàn)證進(jìn)度的方法。 EDA工具兩大巨頭Synopsys和Cadence都有自己的驗(yàn)證計(jì)劃工具，分別是Synopsys公司
2021-03-28 10:52:023292 
SoC設(shè)計(jì)中的驗(yàn)證技術(shù)有哪些。
2021-03-29 10:37:3012 擁有如此多的利益相關(guān)者和優(yōu)先事項(xiàng)正在推動(dòng)迫切需要一種更好的方法來(lái)完成 SoC 驗(yàn)證。軟件定義的驗(yàn)證和驗(yàn)證環(huán)境和方法將使工程團(tuán)隊(duì)能夠交付復(fù)雜的 SoC，滿足上市時(shí)間，提供更徹底的檢查，并降低風(fēng)險(xiǎn)和成本。
2022-06-02 10:00:021034 確保汽車 SoC 在功能上安全還可以讓駕駛員和乘客對(duì)他們的車輛充滿信心。將安全驗(yàn)證集成到功能驗(yàn)證流程中可以是加快流程和管理符合 ISO 26262 等標(biāo)準(zhǔn)的工作的有效方法。
2022-06-13 15:17:201177 
面對(duì)持續(xù)不斷的上市時(shí)間壓力和日益復(fù)雜的 SoC 設(shè)計(jì)，很難找到不想從設(shè)計(jì)周期中縮短時(shí)間的工程師。特別是在高級(jí)節(jié)點(diǎn)，驗(yàn)證 SoC 互連已成為一個(gè)耗時(shí)的步驟。但是，工具現(xiàn)在可以高效且有效地執(zhí)行周期精確的性能分析和互連驗(yàn)證。
2022-06-14 10:12:171692 
利用Systemverilog+UVM搭建soc驗(yàn)證環(huán)境
2022-08-08 14:35:055 實(shí)時(shí)動(dòng)態(tài)定位（Real Time Kinematic，RTK）是一種基于載波相位觀測(cè)值的相對(duì)定位技術(shù)。RTK高精度定位方法可以消除接收機(jī)及衛(wèi)星鐘差、削弱衛(wèi)星軌道、大氣層延遲等誤差源對(duì)定位的影響，獲得
2022-10-11 14:59:382767 傳統(tǒng)的電路設(shè)計(jì)分析方法是僅僅采用動(dòng)態(tài)仿真的方法來(lái)驗(yàn)證設(shè)計(jì)的正確性。隨著集成電路的發(fā)展，這一驗(yàn)證方法就成為了大規(guī)模復(fù)雜的設(shè)計(jì)驗(yàn)證時(shí)的瓶頸。
2022-11-28 15:26:18624 在現(xiàn)代SoC芯片驗(yàn)證過(guò)程中，不可避免的都會(huì)使用FPGA原型驗(yàn)證，或許原型驗(yàn)證一詞對(duì)你而言非常新鮮，但是FPGA上板驗(yàn)證應(yīng)該是非常熟悉的場(chǎng)景了。
2023-03-28 09:33:16854 FPGA原型驗(yàn)證系統(tǒng)要盡可能多的復(fù)用SoC相關(guān)的模塊，這樣才是復(fù)刻SoC原型的意義所在。
2023-04-19 09:08:15852 FPGA原型驗(yàn)證系統(tǒng)要盡可能多的復(fù)用SoC相關(guān)的模塊，這樣才是復(fù)刻SoC原型的意義所在。
2023-05-23 16:50:34381 
在現(xiàn)代SoC芯片驗(yàn)證過(guò)程中，不可避免的都會(huì)使用FPGA原型驗(yàn)證，或許原型驗(yàn)證一詞對(duì)你而言非常新鮮，但是FPGA上板驗(yàn)證應(yīng)該是非常熟悉的場(chǎng)景了。
2023-05-30 15:04:06905 
剖析》分析了用戶在進(jìn)行大規(guī)模原型驗(yàn)證過(guò)程中的多FPGA聯(lián)合調(diào)試難題，并介紹了一種新型FPGA原型驗(yàn)證深度跟蹤調(diào)試解決方案，用于幫助客戶在SoC開發(fā)過(guò)程中解決調(diào)試問(wèn)
2022-06-16 10:16:48629 
些更低的幾何尺寸下設(shè)計(jì)和驗(yàn)證時(shí)鐘帶來(lái)了越來(lái)越多的復(fù)雜性和驗(yàn)證挑戰(zhàn)。在這種快速發(fā)展的形勢(shì)下，必須重新評(píng)估當(dāng)前的時(shí)鐘驗(yàn)證方法，以確保最佳的時(shí)鐘性能和可靠性。
2023-07-17 10:12:18434 
很多其他行業(yè)也能從電子器件的增加受益，當(dāng)然保障功能安全是大的前提。本文討論SOC芯片設(shè)計(jì)驗(yàn)證、驗(yàn)證計(jì)劃和策略以及驗(yàn)證方法。它定義了功能模擬、功能覆蓋、代碼覆蓋以及設(shè)計(jì)驗(yàn)證中使用的重要術(shù)語(yǔ)。本文還涉及FPGA驗(yàn)證及其在S
2023-07-20 09:05:59597 2023DVConChina將于9月20日在上海淳大萬(wàn)麗酒店舉行。思爾芯受邀出席此次會(huì)議，并將深度探討思爾芯的產(chǎn)品和技術(shù)，如何協(xié)助用戶加速SoC設(shè)計(jì)。在本次會(huì)議上，思爾芯研發(fā)中心副總裁陳正國(guó)先生
2023-09-06 08:25:25494 就像芯片本身一樣，SoC上的CSR設(shè)計(jì)也沿用了層級(jí)設(shè)計(jì)的方法。從最底層往上，寄存器可以被分為以下幾個(gè)層級(jí)。
2023-10-20 10:39:39395 
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